board/renesas/stout/stout.c

   1 // SPDX-License-Identifier: GPL-2.0
   2 /*
   3  * board/renesas/stout/stout.c
   4  *     This file is Stout board support.
   5  *
   6  * Copyright (C) 2015 Renesas Electronics Europe GmbH
   7  * Copyright (C) 2015 Renesas Electronics Corporation
   8  * Copyright (C) 2015 Cogent Embedded, Inc.
   9  */
  10
  11 #include <common.h>
  12 #include <env.h>
  13 #include <init.h>
  14 #include <malloc.h>
  15 #include <netdev.h>
  16 #include <dm.h>
  17 #include <dm/platform_data/serial_sh.h>
  18 #include <env_internal.h>
  19 #include <asm/processor.h>
  20 #include <asm/mach-types.h>
  21 #include <asm/io.h>
  22 #include <linux/errno.h>
  23 #include <asm/arch/sys_proto.h>
  24 #include <asm/gpio.h>
  25 #include <asm/arch/rmobile.h>
  26 #include <asm/arch/rcar-mstp.h>
  27 #include <asm/arch/mmc.h>
  28 #include <asm/arch/sh_sdhi.h>
  29 #include <miiphy.h>
  30 #include <i2c.h>
  31 #include <mmc.h>
  32 #include "qos.h"
  33 #include "cpld.h"
  34
  35 DECLARE_GLOBAL_DATA_PTR;
  36
  37 #define CLK2MHZ(clk)    (clk / 1000 / 1000)
  38 void s_init(void)
  39 {
  40         struct rcar_rwdt *rwdt = (struct rcar_rwdt *)RWDT_BASE;
  41         struct rcar_swdt *swdt = (struct rcar_swdt *)SWDT_BASE;
  42
  43         /* Watchdog init */
  44         writel(0xA5A5A500, &rwdt->rwtcsra);
  45         writel(0xA5A5A500, &swdt->swtcsra);
  46
  47         /* CPU frequency setting. Set to 1.4GHz */
  48         if (rmobile_get_cpu_rev_integer() >= R8A7790_CUT_ES2X) {
  49                 u32 stat = 0;
  50                 u32 stc = ((1400 / CLK2MHZ(CONFIG_SYS_CLK_FREQ)) - 1)
  51                         << PLL0_STC_BIT;
  52                 clrsetbits_le32(PLL0CR, PLL0_STC_MASK, stc);
  53
  54                 do {
  55                         stat = readl(PLLECR) & PLL0ST;
  56                 } while (stat == 0x0);
  57         }
  58
  59         /* QoS(Quality-of-Service) Init */
  60         qos_init();
  61 }
  62
  63 #define TMU0_MSTP125    BIT(25)
  64
  65 #define SD2CKCR         0xE6150078
  66 #define SD2_97500KHZ    0x7
  67
  68 int board_early_init_f(void)
  69 {
  70         /* TMU0 */
  71         mstp_clrbits_le32(MSTPSR1, SMSTPCR1, TMU0_MSTP125);
  72
  73         /*
  74          * SD0 clock is set to 97.5MHz by default.
  75          * Set SD2 to the 97.5MHz as well.
  76          */
  77         writel(SD2_97500KHZ, SD2CKCR);
  78
  79         return 0;
  80 }
  81
  82 #define ETHERNET_PHY_RESET      123     /* GPIO 3 31 */
  83
  84 int board_init(void)
  85 {
  86         /* adress of boot parameters */
  87         gd->bd->bi_boot_params = CONFIG_SYS_SDRAM_BASE + 0x100;
  88
  89         cpld_init();
  90
  91         /* Force ethernet PHY out of reset */
  92         gpio_request(ETHERNET_PHY_RESET, "phy_reset");
  93         gpio_direction_output(ETHERNET_PHY_RESET, 0);
  94         mdelay(20);
  95         gpio_direction_output(ETHERNET_PHY_RESET, 1);
  96
  97         return 0;
  98 }
  99
 100 int dram_init(void)
 101 {
 102         if (fdtdec_setup_mem_size_base() != 0)
 103                 return -EINVAL;
 104
 105         return 0;
 106 }
 107
 108 int dram_init_banksize(void)
 109 {
 110         fdtdec_setup_memory_banksize();
 111
 112         return 0;
 113 }
 114
 115 /* Stout has KSZ8041NL/RNL */
 116 #define PHY_CONTROL1            0x1E
 117 #define PHY_LED_MODE            0xC000
 118 #define PHY_LED_MODE_ACK        0x4000
 119 int board_phy_config(struct phy_device *phydev)
 120 {
 121         int ret = phy_read(phydev, MDIO_DEVAD_NONE, PHY_CONTROL1);
 122         ret &= ~PHY_LED_MODE;
 123         ret |= PHY_LED_MODE_ACK;
 124         ret = phy_write(phydev, MDIO_DEVAD_NONE, PHY_CONTROL1, (u16)ret);
 125
 126         return 0;
 127 }
 128
 129 enum env_location env_get_location(enum env_operation op, int prio)
 130 {
 131         const u32 load_magic = 0xb33fc0de;
 132
 133         /* Block environment access if loaded using JTAG */
 134         if ((readl(CONFIG_SPL_TEXT_BASE + 0x24) == load_magic) &&
 135             (op != ENVOP_INIT))
 136                 return ENVL_UNKNOWN;
 137
 138         if (prio)
 139                 return ENVL_UNKNOWN;
 140
 141         return ENVL_SPI_FLASH;
 142 }