1 // SPDX-License-Identifier: GPL-2.0+
3 * Copyright (C) 2013 Gateworks Corporation
5 * Author: Tim Harvey <tharvey@gateworks.com>
10 #include <asm/arch/clock.h>
11 #include <asm/arch/mx6-pins.h>
12 #include <asm/arch/sys_proto.h>
14 #include <asm/mach-imx/mxc_i2c.h>
16 #include <fsl_esdhc_imx.h>
18 #include <power/pmic.h>
19 #include <power/ltc3676_pmic.h>
20 #include <power/pfuze100_pmic.h>
24 /* UART2: Serial Console */
25 static iomux_v3_cfg_t const uart2_pads[] = {
26 IOMUX_PADS(PAD_SD4_DAT7__UART2_TX_DATA | MUX_PAD_CTRL(UART_PAD_CTRL)),
27 IOMUX_PADS(PAD_SD4_DAT4__UART2_RX_DATA | MUX_PAD_CTRL(UART_PAD_CTRL)),
30 void setup_iomux_uart(void)
32 SETUP_IOMUX_PADS(uart2_pads);
36 static iomux_v3_cfg_t const gw5904_emmc_pads[] = {
37 IOMUX_PADS(PAD_SD3_DAT0__SD3_DATA0 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
38 IOMUX_PADS(PAD_SD3_DAT1__SD3_DATA1 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
39 IOMUX_PADS(PAD_SD3_DAT2__SD3_DATA2 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
40 IOMUX_PADS(PAD_SD3_DAT3__SD3_DATA3 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
41 IOMUX_PADS(PAD_SD3_DAT4__SD3_DATA4 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
42 IOMUX_PADS(PAD_SD3_DAT5__SD3_DATA5 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
43 IOMUX_PADS(PAD_SD3_DAT6__SD3_DATA6 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
44 IOMUX_PADS(PAD_SD3_DAT7__SD3_DATA7 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
45 IOMUX_PADS(PAD_SD3_CLK__SD3_CLK | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
46 IOMUX_PADS(PAD_SD3_CMD__SD3_CMD | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
47 IOMUX_PADS(PAD_SD3_RST__SD3_RESET | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
49 /* 4-bit microSD on SD2 */
50 static iomux_v3_cfg_t const gw5904_mmc_pads[] = {
51 IOMUX_PADS(PAD_SD2_CLK__SD2_CLK | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
52 IOMUX_PADS(PAD_SD2_CMD__SD2_CMD | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
53 IOMUX_PADS(PAD_SD2_DAT0__SD2_DATA0 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
54 IOMUX_PADS(PAD_SD2_DAT1__SD2_DATA1 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
55 IOMUX_PADS(PAD_SD2_DAT2__SD2_DATA2 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
56 IOMUX_PADS(PAD_SD2_DAT3__SD2_DATA3 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
58 IOMUX_PADS(PAD_NANDF_CS0__GPIO6_IO11 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
60 /* 8-bit eMMC on SD2/NAND */
61 static iomux_v3_cfg_t const gw560x_emmc_sd2_pads[] = {
62 IOMUX_PADS(PAD_SD2_CLK__SD2_CLK | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
63 IOMUX_PADS(PAD_SD2_CMD__SD2_CMD | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
64 IOMUX_PADS(PAD_SD2_DAT0__SD2_DATA0 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
65 IOMUX_PADS(PAD_SD2_DAT1__SD2_DATA1 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
66 IOMUX_PADS(PAD_SD2_DAT2__SD2_DATA2 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
67 IOMUX_PADS(PAD_SD2_DAT3__SD2_DATA3 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
68 IOMUX_PADS(PAD_NANDF_D4__SD2_DATA4 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
69 IOMUX_PADS(PAD_NANDF_D5__SD2_DATA5 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
70 IOMUX_PADS(PAD_NANDF_D6__SD2_DATA6 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
71 IOMUX_PADS(PAD_NANDF_D7__SD2_DATA7 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
74 static iomux_v3_cfg_t const usdhc3_pads[] = {
75 IOMUX_PADS(PAD_SD3_CLK__SD3_CLK | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
76 IOMUX_PADS(PAD_SD3_CMD__SD3_CMD | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
77 IOMUX_PADS(PAD_SD3_DAT0__SD3_DATA0 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
78 IOMUX_PADS(PAD_SD3_DAT1__SD3_DATA1 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
79 IOMUX_PADS(PAD_SD3_DAT2__SD3_DATA2 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
80 IOMUX_PADS(PAD_SD3_DAT3__SD3_DATA3 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
81 IOMUX_PADS(PAD_SD3_DAT5__GPIO7_IO00 | MUX_PAD_CTRL(USDHC_PAD_CTRL)),
87 * I2C2: PMIC,PCIe Switch,Clock,Mezz
88 * I2C3: Multimedia/Expansion
90 static struct i2c_pads_info mx6q_i2c_pad_info[] = {
93 .i2c_mode = MX6Q_PAD_EIM_D21__I2C1_SCL | PC,
94 .gpio_mode = MX6Q_PAD_EIM_D21__GPIO3_IO21 | PC,
95 .gp = IMX_GPIO_NR(3, 21)
98 .i2c_mode = MX6Q_PAD_EIM_D28__I2C1_SDA | PC,
99 .gpio_mode = MX6Q_PAD_EIM_D28__GPIO3_IO28 | PC,
100 .gp = IMX_GPIO_NR(3, 28)
104 .i2c_mode = MX6Q_PAD_KEY_COL3__I2C2_SCL | PC,
105 .gpio_mode = MX6Q_PAD_KEY_COL3__GPIO4_IO12 | PC,
106 .gp = IMX_GPIO_NR(4, 12)
109 .i2c_mode = MX6Q_PAD_KEY_ROW3__I2C2_SDA | PC,
110 .gpio_mode = MX6Q_PAD_KEY_ROW3__GPIO4_IO13 | PC,
111 .gp = IMX_GPIO_NR(4, 13)
115 .i2c_mode = MX6Q_PAD_GPIO_3__I2C3_SCL | PC,
116 .gpio_mode = MX6Q_PAD_GPIO_3__GPIO1_IO03 | PC,
117 .gp = IMX_GPIO_NR(1, 3)
120 .i2c_mode = MX6Q_PAD_GPIO_6__I2C3_SDA | PC,
121 .gpio_mode = MX6Q_PAD_GPIO_6__GPIO1_IO06 | PC,
122 .gp = IMX_GPIO_NR(1, 6)
127 static struct i2c_pads_info mx6dl_i2c_pad_info[] = {
130 .i2c_mode = MX6DL_PAD_EIM_D21__I2C1_SCL | PC,
131 .gpio_mode = MX6DL_PAD_EIM_D21__GPIO3_IO21 | PC,
132 .gp = IMX_GPIO_NR(3, 21)
135 .i2c_mode = MX6DL_PAD_EIM_D28__I2C1_SDA | PC,
136 .gpio_mode = MX6DL_PAD_EIM_D28__GPIO3_IO28 | PC,
137 .gp = IMX_GPIO_NR(3, 28)
141 .i2c_mode = MX6DL_PAD_KEY_COL3__I2C2_SCL | PC,
142 .gpio_mode = MX6DL_PAD_KEY_COL3__GPIO4_IO12 | PC,
143 .gp = IMX_GPIO_NR(4, 12)
146 .i2c_mode = MX6DL_PAD_KEY_ROW3__I2C2_SDA | PC,
147 .gpio_mode = MX6DL_PAD_KEY_ROW3__GPIO4_IO13 | PC,
148 .gp = IMX_GPIO_NR(4, 13)
152 .i2c_mode = MX6DL_PAD_GPIO_3__I2C3_SCL | PC,
153 .gpio_mode = MX6DL_PAD_GPIO_3__GPIO1_IO03 | PC,
154 .gp = IMX_GPIO_NR(1, 3)
157 .i2c_mode = MX6DL_PAD_GPIO_6__I2C3_SDA | PC,
158 .gpio_mode = MX6DL_PAD_GPIO_6__GPIO1_IO06 | PC,
159 .gp = IMX_GPIO_NR(1, 6)
164 void setup_ventana_i2c(int i2c)
166 struct i2c_pads_info *p;
168 if (is_cpu_type(MXC_CPU_MX6Q))
169 p = &mx6q_i2c_pad_info[i2c];
171 p = &mx6dl_i2c_pad_info[i2c];
173 setup_i2c(i2c, CONFIG_SYS_I2C_SPEED, 0x7f, p);
177 * Baseboard specific GPIO
179 static iomux_v3_cfg_t const gw51xx_gpio_pads[] = {
181 IOMUX_PADS(PAD_KEY_COL0__GPIO4_IO06 | DIO_PAD_CFG),
183 IOMUX_PADS(PAD_KEY_ROW0__GPIO4_IO07 | DIO_PAD_CFG),
185 IOMUX_PADS(PAD_EIM_A19__GPIO2_IO19 | DIO_PAD_CFG),
187 IOMUX_PADS(PAD_EIM_A20__GPIO2_IO18 | MUX_PAD_CTRL(IRQ_PAD_CTRL)),
190 IOMUX_PADS(PAD_GPIO_2__GPIO1_IO02 | DIO_PAD_CFG),
192 IOMUX_PADS(PAD_CSI0_DATA_EN__GPIO5_IO20 | DIO_PAD_CFG),
194 IOMUX_PADS(PAD_GPIO_0__GPIO1_IO00 | DIO_PAD_CFG),
196 IOMUX_PADS(PAD_GPIO_17__GPIO7_IO12 | DIO_PAD_CFG),
199 static iomux_v3_cfg_t const gw52xx_gpio_pads[] = {
201 IOMUX_PADS(PAD_NANDF_CS1__GPIO6_IO14 | DIO_PAD_CFG),
203 IOMUX_PADS(PAD_SD4_DAT3__GPIO2_IO11 | DIO_PAD_CFG),
205 IOMUX_PADS(PAD_SD4_DAT0__GPIO2_IO08 | DIO_PAD_CFG),
207 IOMUX_PADS(PAD_KEY_COL0__GPIO4_IO06 | DIO_PAD_CFG),
209 IOMUX_PADS(PAD_KEY_ROW0__GPIO4_IO07 | DIO_PAD_CFG),
211 IOMUX_PADS(PAD_EIM_A19__GPIO2_IO19 | DIO_PAD_CFG),
213 IOMUX_PADS(PAD_EIM_A20__GPIO2_IO18 | MUX_PAD_CTRL(IRQ_PAD_CTRL)),
215 IOMUX_PADS(PAD_GPIO_9__GPIO1_IO09 | DIO_PAD_CFG),
217 IOMUX_PADS(PAD_KEY_ROW4__GPIO4_IO15 | DIO_PAD_CFG),
219 IOMUX_PADS(PAD_ENET_RXD0__GPIO1_IO27 | DIO_PAD_CFG),
221 IOMUX_PADS(PAD_GPIO_2__GPIO1_IO02 | DIO_PAD_CFG),
223 IOMUX_PADS(PAD_EIM_D31__GPIO3_IO31 | DIO_PAD_CFG),
225 IOMUX_PADS(PAD_ENET_TXD1__GPIO1_IO29 | DIO_PAD_CFG),
226 /* PCI_RST# (GW522x) */
227 IOMUX_PADS(PAD_EIM_D23__GPIO3_IO23 | DIO_PAD_CFG),
229 IOMUX_PADS(PAD_SD3_DAT4__GPIO7_IO01 | DIO_PAD_CFG),
231 IOMUX_PADS(PAD_GPIO_17__GPIO7_IO12 | DIO_PAD_CFG),
234 static iomux_v3_cfg_t const gw53xx_gpio_pads[] = {
236 IOMUX_PADS(PAD_NANDF_CS1__GPIO6_IO14 | DIO_PAD_CFG),
238 IOMUX_PADS(PAD_SD4_DAT3__GPIO2_IO11 | DIO_PAD_CFG),
240 IOMUX_PADS(PAD_SD4_DAT0__GPIO2_IO08 | DIO_PAD_CFG),
242 IOMUX_PADS(PAD_GPIO_2__GPIO1_IO02 | DIO_PAD_CFG),
244 IOMUX_PADS(PAD_GPIO_9__GPIO1_IO09 | DIO_PAD_CFG),
246 IOMUX_PADS(PAD_KEY_COL0__GPIO4_IO06 | DIO_PAD_CFG),
248 IOMUX_PADS(PAD_KEY_ROW0__GPIO4_IO07 | DIO_PAD_CFG),
250 IOMUX_PADS(PAD_KEY_ROW4__GPIO4_IO15 | DIO_PAD_CFG),
252 IOMUX_PADS(PAD_EIM_A19__GPIO2_IO19 | DIO_PAD_CFG),
254 IOMUX_PADS(PAD_EIM_A20__GPIO2_IO18 | MUX_PAD_CTRL(IRQ_PAD_CTRL)),
256 IOMUX_PADS(PAD_GPIO_19__GPIO4_IO05 | DIO_PAD_CFG),
258 IOMUX_PADS(PAD_ENET_RXD0__GPIO1_IO27 | DIO_PAD_CFG),
260 IOMUX_PADS(PAD_EIM_D31__GPIO3_IO31 | DIO_PAD_CFG),
262 IOMUX_PADS(PAD_ENET_TXD1__GPIO1_IO29 | DIO_PAD_CFG),
264 IOMUX_PADS(PAD_SD3_DAT4__GPIO7_IO01 | DIO_PAD_CFG),
266 IOMUX_PADS(PAD_GPIO_17__GPIO7_IO12 | DIO_PAD_CFG),
269 static iomux_v3_cfg_t const gw54xx_gpio_pads[] = {
271 IOMUX_PADS(PAD_NANDF_CS1__GPIO6_IO14 | DIO_PAD_CFG),
273 IOMUX_PADS(PAD_SD4_DAT3__GPIO2_IO11 | DIO_PAD_CFG),
275 IOMUX_PADS(PAD_SD4_DAT0__GPIO2_IO08 | DIO_PAD_CFG),
277 IOMUX_PADS(PAD_GPIO_2__GPIO1_IO02 | DIO_PAD_CFG),
279 IOMUX_PADS(PAD_KEY_COL0__GPIO4_IO06 | DIO_PAD_CFG),
281 IOMUX_PADS(PAD_KEY_ROW0__GPIO4_IO07 | DIO_PAD_CFG),
283 IOMUX_PADS(PAD_KEY_ROW4__GPIO4_IO15 | DIO_PAD_CFG),
285 IOMUX_PADS(PAD_SD1_DAT0__GPIO1_IO16 | DIO_PAD_CFG),
287 IOMUX_PADS(PAD_SD1_DAT3__GPIO1_IO21 | DIO_PAD_CFG),
289 IOMUX_PADS(PAD_EIM_D24__GPIO3_IO24 | DIO_PAD_CFG),
291 IOMUX_PADS(PAD_EIM_A19__GPIO2_IO19 | DIO_PAD_CFG),
293 IOMUX_PADS(PAD_EIM_A20__GPIO2_IO18 | MUX_PAD_CTRL(IRQ_PAD_CTRL)),
295 IOMUX_PADS(PAD_GPIO_19__GPIO4_IO05 | DIO_PAD_CFG),
297 IOMUX_PADS(PAD_ENET_TXD1__GPIO1_IO29 | DIO_PAD_CFG),
299 IOMUX_PADS(PAD_EIM_D31__GPIO3_IO31 | DIO_PAD_CFG),
301 IOMUX_PADS(PAD_SD3_DAT4__GPIO7_IO01 | DIO_PAD_CFG),
303 IOMUX_PADS(PAD_DISP0_DAT23__GPIO5_IO17 | DIO_PAD_CFG),
306 static iomux_v3_cfg_t const gw551x_gpio_pads[] = {
308 IOMUX_PADS(PAD_GPIO_9__GPIO1_IO09 | DIO_PAD_CFG),
310 IOMUX_PADS(PAD_KEY_ROW0__GPIO4_IO07 | DIO_PAD_CFG),
312 IOMUX_PADS(PAD_GPIO_0__GPIO1_IO00 | DIO_PAD_CFG),
314 IOMUX_PADS(PAD_GPIO_17__GPIO7_IO12 | DIO_PAD_CFG),
317 static iomux_v3_cfg_t const gw552x_gpio_pads[] = {
319 IOMUX_PADS(PAD_SD4_DAT0__GPIO2_IO08 | DIO_PAD_CFG),
321 IOMUX_PADS(PAD_GPIO_7__GPIO1_IO07 | DIO_PAD_CFG),
323 IOMUX_PADS(PAD_GPIO_9__GPIO1_IO09 | DIO_PAD_CFG),
325 IOMUX_PADS(PAD_KEY_COL0__GPIO4_IO06 | DIO_PAD_CFG),
327 IOMUX_PADS(PAD_KEY_ROW0__GPIO4_IO07 | DIO_PAD_CFG),
329 IOMUX_PADS(PAD_KEY_ROW4__GPIO4_IO15 | DIO_PAD_CFG),
331 IOMUX_PADS(PAD_ENET_TXD1__GPIO1_IO29 | DIO_PAD_CFG),
333 IOMUX_PADS(PAD_CSI0_PIXCLK__GPIO5_IO18 | DIO_PAD_CFG),
334 IOMUX_PADS(PAD_CSI0_DATA_EN__GPIO5_IO20 | DIO_PAD_CFG),
335 IOMUX_PADS(PAD_CSI0_VSYNC__GPIO5_IO21 | DIO_PAD_CFG),
336 IOMUX_PADS(PAD_CSI0_DAT4__GPIO5_IO22 | DIO_PAD_CFG),
337 IOMUX_PADS(PAD_CSI0_DAT5__GPIO5_IO23 | DIO_PAD_CFG),
338 IOMUX_PADS(PAD_CSI0_DAT7__GPIO5_IO25 | DIO_PAD_CFG),
340 IOMUX_PADS(PAD_GPIO_1__GPIO1_IO01 | DIO_PAD_CFG),
342 IOMUX_PADS(PAD_GPIO_2__GPIO1_IO02 | DIO_PAD_CFG),
344 IOMUX_PADS(PAD_GPIO_17__GPIO7_IO12 | DIO_PAD_CFG),
347 static iomux_v3_cfg_t const gw553x_gpio_pads[] = {
349 IOMUX_PADS(PAD_NANDF_CS1__GPIO6_IO14 | DIO_PAD_CFG),
351 IOMUX_PADS(PAD_KEY_COL2__GPIO4_IO10 | DIO_PAD_CFG),
353 IOMUX_PADS(PAD_KEY_ROW2__GPIO4_IO11 | DIO_PAD_CFG),
355 IOMUX_PADS(PAD_CSI0_DATA_EN__GPIO5_IO20 | DIO_PAD_CFG),
357 IOMUX_PADS(PAD_GPIO_0__GPIO1_IO00 | DIO_PAD_CFG),
359 IOMUX_PADS(PAD_GPIO_17__GPIO7_IO12 | DIO_PAD_CFG),
362 static iomux_v3_cfg_t const gw560x_gpio_pads[] = {
364 IOMUX_PADS(PAD_SD4_DAT3__GPIO2_IO11 | DIO_PAD_CFG),
366 IOMUX_PADS(PAD_GPIO_2__GPIO1_IO02 | DIO_PAD_CFG),
368 IOMUX_PADS(PAD_GPIO_9__GPIO1_IO09 | DIO_PAD_CFG),
370 IOMUX_PADS(PAD_KEY_COL0__GPIO4_IO06 | DIO_PAD_CFG),
372 IOMUX_PADS(PAD_KEY_ROW0__GPIO4_IO07 | DIO_PAD_CFG),
374 IOMUX_PADS(PAD_KEY_ROW4__GPIO4_IO15 | DIO_PAD_CFG),
376 IOMUX_PADS(PAD_EIM_A19__GPIO2_IO19 | DIO_PAD_CFG),
378 IOMUX_PADS(PAD_EIM_A20__GPIO2_IO18 | MUX_PAD_CTRL(IRQ_PAD_CTRL)),
380 IOMUX_PADS(PAD_GPIO_19__GPIO4_IO05 | DIO_PAD_CFG),
382 IOMUX_PADS(PAD_EIM_D31__GPIO3_IO31 | DIO_PAD_CFG),
384 IOMUX_PADS(PAD_DISP0_DAT10__GPIO4_IO31 | DIO_PAD_CFG),
386 IOMUX_PADS(PAD_SD3_DAT4__GPIO7_IO01 | DIO_PAD_CFG),
388 IOMUX_PADS(PAD_GPIO_17__GPIO7_IO12 | DIO_PAD_CFG),
389 /* USBH2_PEN (OTG) */
390 IOMUX_PADS(PAD_KEY_ROW4__GPIO4_IO15 | DIO_PAD_CFG),
392 IOMUX_PADS(PAD_DISP0_DAT5__GPIO4_IO26 | DIO_PAD_CFG),
395 static iomux_v3_cfg_t const gw5901_gpio_pads[] = {
397 IOMUX_PADS(PAD_KEY_ROW4__GPIO4_IO15 | DIO_PAD_CFG),
399 IOMUX_PADS(PAD_GPIO_1__GPIO1_IO01 | DIO_PAD_CFG),
401 IOMUX_PADS(PAD_GPIO_2__GPIO1_IO02 | DIO_PAD_CFG),
403 IOMUX_PADS(PAD_ENET_TXD1__GPIO1_IO29 | DIO_PAD_CFG),
405 IOMUX_PADS(PAD_DISP0_DAT8__WDOG1_B | DIO_PAD_CFG),
407 IOMUX_PADS(PAD_DISP0_DAT20__GPIO5_IO14 | DIO_PAD_CFG),
408 IOMUX_PADS(PAD_DISP0_DAT21__GPIO5_IO15 | DIO_PAD_CFG),
409 IOMUX_PADS(PAD_DISP0_DAT22__GPIO5_IO16 | DIO_PAD_CFG),
410 IOMUX_PADS(PAD_DISP0_DAT23__GPIO5_IO17 | DIO_PAD_CFG),
412 IOMUX_PADS(PAD_GPIO_5__GPIO1_IO05 | DIO_PAD_CFG),
414 IOMUX_PADS(PAD_GPIO_7__GPIO1_IO07 | DIO_PAD_CFG),
416 IOMUX_PADS(PAD_GPIO_9__GPIO1_IO09 | DIO_PAD_CFG),
419 static iomux_v3_cfg_t const gw5902_gpio_pads[] = {
421 IOMUX_PADS(PAD_KEY_ROW4__GPIO4_IO15 | DIO_PAD_CFG),
423 IOMUX_PADS(PAD_GPIO_2__GPIO1_IO02 | DIO_PAD_CFG),
425 IOMUX_PADS(PAD_SD3_CLK__GPIO7_IO03 | DIO_PAD_CFG),
427 IOMUX_PADS(PAD_SD4_DAT3__GPIO2_IO11 | DIO_PAD_CFG),
429 IOMUX_PADS(PAD_GPIO_0__GPIO1_IO00 | DIO_PAD_CFG),
431 IOMUX_PADS(PAD_GPIO_17__GPIO7_IO12 | DIO_PAD_CFG),
433 IOMUX_PADS(PAD_GPIO_5__GPIO1_IO05 | DIO_PAD_CFG),
435 IOMUX_PADS(PAD_GPIO_7__GPIO1_IO07 | DIO_PAD_CFG),
437 IOMUX_PADS(PAD_EIM_D23__GPIO3_IO23 | DIO_PAD_CFG),
440 static iomux_v3_cfg_t const gw5903_gpio_pads[] = {
442 IOMUX_PADS(PAD_GPIO_7__GPIO1_IO07 | DIO_PAD_CFG),
444 IOMUX_PADS(PAD_NANDF_D2__GPIO2_IO02 | DIO_PAD_CFG),
446 IOMUX_PADS(PAD_NANDF_D3__GPIO2_IO03 | DIO_PAD_CFG),
448 IOMUX_PADS(PAD_NANDF_D4__GPIO2_IO04 | DIO_PAD_CFG),
449 /* USBH1_PEN (EHCI) */
450 IOMUX_PADS(PAD_EIM_D31__GPIO3_IO31 | DIO_PAD_CFG),
451 /* USBH2_PEN (OTG) */
452 IOMUX_PADS(PAD_KEY_ROW4__GPIO4_IO15 | DIO_PAD_CFG),
454 IOMUX_PADS(PAD_KEY_ROW0__GPIO4_IO07 | DIO_PAD_CFG),
456 IOMUX_PADS(PAD_KEY_COL1__GPIO4_IO08 | DIO_PAD_CFG),
458 IOMUX_PADS(PAD_DISP0_DAT23__GPIO5_IO17 | DIO_PAD_CFG),
460 IOMUX_PADS(PAD_CSI0_DAT12__GPIO5_IO30 | DIO_PAD_CFG),
462 IOMUX_PADS(PAD_NANDF_CS1__GPIO6_IO14 | DIO_PAD_CFG),
464 IOMUX_PADS(PAD_GPIO_17__GPIO7_IO12 | DIO_PAD_CFG),
466 IOMUX_PADS(PAD_ENET_CRS_DV__GPIO1_IO25 | DIO_PAD_CFG),
468 IOMUX_PADS(PAD_KEY_COL0__GPIO4_IO06 | DIO_PAD_CFG),
470 IOMUX_PADS(PAD_KEY_COL1__GPIO4_IO08 | DIO_PAD_CFG),
473 static iomux_v3_cfg_t const gw5904_gpio_pads[] = {
475 IOMUX_PADS(PAD_GPIO_9__GPIO1_IO09 | DIO_PAD_CFG),
477 IOMUX_PADS(PAD_KEY_COL0__GPIO4_IO06 | DIO_PAD_CFG),
479 IOMUX_PADS(PAD_KEY_ROW0__GPIO4_IO07 | DIO_PAD_CFG),
481 IOMUX_PADS(PAD_KEY_ROW4__GPIO4_IO15 | DIO_PAD_CFG),
483 IOMUX_PADS(PAD_EIM_A19__GPIO2_IO19 | DIO_PAD_CFG),
485 IOMUX_PADS(PAD_EIM_A20__GPIO2_IO18 | MUX_PAD_CTRL(IRQ_PAD_CTRL)),
487 IOMUX_PADS(PAD_GPIO_19__GPIO4_IO05 | DIO_PAD_CFG),
489 IOMUX_PADS(PAD_DISP0_DAT2__GPIO4_IO23 | DIO_PAD_CFG),
491 IOMUX_PADS(PAD_DISP0_DAT3__GPIO4_IO24 | DIO_PAD_CFG),
493 IOMUX_PADS(PAD_DISP0_DAT17__GPIO5_IO11 | DIO_PAD_CFG),
495 IOMUX_PADS(PAD_DISP0_DAT18__GPIO5_IO12 | DIO_PAD_CFG),
497 IOMUX_PADS(PAD_DISP0_DAT19__GPIO5_IO13 | DIO_PAD_CFG),
499 IOMUX_PADS(PAD_GPIO_0__GPIO1_IO00 | DIO_PAD_CFG),
501 IOMUX_PADS(PAD_SD2_DAT0__GPIO1_IO15 | DIO_PAD_CFG),
503 IOMUX_PADS(PAD_SD2_DAT1__GPIO1_IO14 | DIO_PAD_CFG),
505 IOMUX_PADS(PAD_SD2_DAT2__GPIO1_IO13 | DIO_PAD_CFG),
507 IOMUX_PADS(PAD_SD4_DAT3__GPIO2_IO11 | DIO_PAD_CFG),
510 static iomux_v3_cfg_t const gw5905_gpio_pads[] = {
512 IOMUX_PADS(PAD_NANDF_D3__GPIO2_IO03 | DIO_PAD_CFG),
514 IOMUX_PADS(PAD_NANDF_CS1__GPIO6_IO14 | DIO_PAD_CFG),
516 IOMUX_PADS(PAD_SD2_DAT0__GPIO1_IO15 | DIO_PAD_CFG),
518 IOMUX_PADS(PAD_SD2_DAT1__GPIO1_IO14 | DIO_PAD_CFG),
520 IOMUX_PADS(PAD_GPIO_7__GPIO1_IO07 | DIO_PAD_CFG),
522 IOMUX_PADS(PAD_GPIO_16__GPIO7_IO11 | DIO_PAD_CFG),
524 IOMUX_PADS(PAD_GPIO_17__GPIO7_IO12 | DIO_PAD_CFG),
526 IOMUX_PADS(PAD_GPIO_18__GPIO7_IO13 | DIO_PAD_CFG),
528 IOMUX_PADS(PAD_GPIO_19__GPIO4_IO05 | DIO_PAD_CFG),
530 IOMUX_PADS(PAD_NANDF_CS1__GPIO6_IO14 | DIO_PAD_CFG),
532 IOMUX_PADS(PAD_DISP0_DAT11__GPIO5_IO05 | DIO_PAD_CFG),
534 IOMUX_PADS(PAD_DISP0_DAT12__GPIO5_IO06 | DIO_PAD_CFG),
536 IOMUX_PADS(PAD_DISP0_DAT20__GPIO5_IO14 | DIO_PAD_CFG),
537 /* USBH1_PEN (EHCI) */
538 IOMUX_PADS(PAD_EIM_D31__GPIO3_IO31 | DIO_PAD_CFG),
540 IOMUX_PADS(PAD_GPIO_9__GPIO1_IO09 | DIO_PAD_CFG),
542 IOMUX_PADS(PAD_DISP0_DAT23__GPIO5_IO17 | DIO_PAD_CFG),
543 /* GYRO_CONTROL/DATA_EN */
544 IOMUX_PADS(PAD_CSI0_DAT8__GPIO5_IO26 | DIO_PAD_CFG),
546 IOMUX_PADS(PAD_KEY_COL1__GPIO4_IO08 | DIO_PAD_CFG),
548 IOMUX_PADS(PAD_KEY_COL0__GPIO4_IO06 | DIO_PAD_CFG),
552 struct dio_cfg gw51xx_dio[] = {
554 { IOMUX_PADS(PAD_SD1_DAT0__GPIO1_IO16) },
560 { IOMUX_PADS(PAD_SD1_DAT2__GPIO1_IO19) },
562 { IOMUX_PADS(PAD_SD1_DAT2__PWM2_OUT) },
566 { IOMUX_PADS(PAD_SD1_DAT1__GPIO1_IO17) },
568 { IOMUX_PADS(PAD_SD1_DAT1__PWM3_OUT) },
572 { IOMUX_PADS(PAD_SD1_CMD__GPIO1_IO18) },
574 { IOMUX_PADS(PAD_SD1_CMD__PWM4_OUT) },
579 struct dio_cfg gw52xx_dio[] = {
581 { IOMUX_PADS(PAD_SD1_DAT0__GPIO1_IO16) },
587 { IOMUX_PADS(PAD_SD1_DAT2__GPIO1_IO19) },
589 { IOMUX_PADS(PAD_SD1_DAT2__PWM2_OUT) },
593 { IOMUX_PADS(PAD_SD1_DAT1__GPIO1_IO17) },
595 { IOMUX_PADS(PAD_SD1_DAT1__PWM3_OUT) },
599 { IOMUX_PADS(PAD_SD1_CLK__GPIO1_IO20) },
606 struct dio_cfg gw53xx_dio[] = {
608 { IOMUX_PADS(PAD_SD1_DAT0__GPIO1_IO16) },
614 { IOMUX_PADS(PAD_SD1_DAT2__GPIO1_IO19) },
616 { IOMUX_PADS(PAD_SD1_DAT2__PWM2_OUT) },
620 { IOMUX_PADS(PAD_SD1_DAT1__GPIO1_IO17) },
622 { IOMUX_PADS(PAD_SD1_DAT1__PWM3_OUT) },
626 {IOMUX_PADS(PAD_SD1_CLK__GPIO1_IO20) },
633 struct dio_cfg gw54xx_dio[] = {
635 { IOMUX_PADS(PAD_GPIO_9__GPIO1_IO09) },
637 { IOMUX_PADS(PAD_GPIO_9__PWM1_OUT) },
641 { IOMUX_PADS(PAD_SD1_DAT2__GPIO1_IO19) },
643 { IOMUX_PADS(PAD_SD1_DAT2__PWM2_OUT) },
647 { IOMUX_PADS(PAD_SD4_DAT1__GPIO2_IO09) },
649 { IOMUX_PADS(PAD_SD4_DAT1__PWM3_OUT) },
653 { IOMUX_PADS(PAD_SD4_DAT2__GPIO2_IO10) },
655 { IOMUX_PADS(PAD_SD4_DAT2__PWM4_OUT) },
660 struct dio_cfg gw551x_dio[] = {
662 { IOMUX_PADS(PAD_SD1_DAT2__GPIO1_IO19) },
664 { IOMUX_PADS(PAD_SD1_DAT2__PWM2_OUT) },
668 { IOMUX_PADS(PAD_SD1_DAT1__GPIO1_IO17) },
670 { IOMUX_PADS(PAD_SD1_DAT1__PWM3_OUT) },
675 struct dio_cfg gw552x_dio[] = {
677 { IOMUX_PADS(PAD_SD1_DAT0__GPIO1_IO16) },
683 { IOMUX_PADS(PAD_SD1_DAT2__GPIO1_IO19) },
685 { IOMUX_PADS(PAD_SD1_DAT2__PWM2_OUT) },
689 { IOMUX_PADS(PAD_SD1_DAT1__GPIO1_IO17) },
691 { IOMUX_PADS(PAD_SD1_DAT1__PWM3_OUT) },
695 {IOMUX_PADS(PAD_SD1_CLK__GPIO1_IO20) },
701 {IOMUX_PADS(PAD_CSI0_PIXCLK__GPIO5_IO18) },
707 {IOMUX_PADS(PAD_CSI0_DATA_EN__GPIO5_IO20) },
713 {IOMUX_PADS(PAD_CSI0_VSYNC__GPIO5_IO21) },
719 {IOMUX_PADS(PAD_CSI0_DAT4__GPIO5_IO22) },
725 {IOMUX_PADS(PAD_CSI0_DAT5__GPIO5_IO23) },
731 {IOMUX_PADS(PAD_CSI0_DAT7__GPIO5_IO25) },
738 struct dio_cfg gw553x_dio[] = {
740 { IOMUX_PADS(PAD_SD1_DAT0__GPIO1_IO16) },
746 { IOMUX_PADS(PAD_SD1_DAT2__GPIO1_IO19) },
748 { IOMUX_PADS(PAD_SD1_DAT2__PWM2_OUT) },
752 { IOMUX_PADS(PAD_SD1_DAT1__GPIO1_IO17) },
754 { IOMUX_PADS(PAD_SD1_DAT1__PWM3_OUT) },
758 { IOMUX_PADS(PAD_SD1_CMD__GPIO1_IO18) },
760 { IOMUX_PADS(PAD_SD1_CMD__PWM4_OUT) },
765 struct dio_cfg gw560x_dio[] = {
767 { IOMUX_PADS(PAD_SD1_DAT0__GPIO1_IO16) },
773 { IOMUX_PADS(PAD_SD1_DAT2__GPIO1_IO19) },
775 { IOMUX_PADS(PAD_SD1_DAT2__PWM2_OUT) },
779 { IOMUX_PADS(PAD_SD1_DAT1__GPIO1_IO17) },
781 { IOMUX_PADS(PAD_SD1_DAT1__PWM3_OUT) },
785 {IOMUX_PADS(PAD_SD1_CLK__GPIO1_IO20) },
792 struct dio_cfg gw5901_dio[] = {
794 { IOMUX_PADS(PAD_DISP0_DAT20__GPIO5_IO14) },
800 { IOMUX_PADS(PAD_DISP0_DAT21__GPIO5_IO15) },
806 { IOMUX_PADS(PAD_DISP0_DAT22__GPIO5_IO16) },
812 { IOMUX_PADS(PAD_DISP0_DAT23__GPIO5_IO17) },
819 struct dio_cfg gw5902_dio[] = {
821 { IOMUX_PADS(PAD_DISP0_DAT20__GPIO5_IO14) },
827 { IOMUX_PADS(PAD_DISP0_DAT21__GPIO5_IO15) },
833 { IOMUX_PADS(PAD_DISP0_DAT22__GPIO5_IO16) },
839 { IOMUX_PADS(PAD_DISP0_DAT23__GPIO5_IO17) },
846 struct dio_cfg gw5903_dio[] = {
849 struct dio_cfg gw5904_dio[] = {
851 { IOMUX_PADS(PAD_SD1_DAT0__GPIO1_IO16) },
857 { IOMUX_PADS(PAD_SD1_DAT2__GPIO1_IO19) },
859 { IOMUX_PADS(PAD_SD1_DAT2__PWM2_OUT) },
863 { IOMUX_PADS(PAD_SD1_DAT1__GPIO1_IO17) },
865 { IOMUX_PADS(PAD_SD1_DAT1__PWM3_OUT) },
869 {IOMUX_PADS(PAD_SD1_CLK__GPIO1_IO20) },
875 {IOMUX_PADS(PAD_NANDF_D0__GPIO2_IO00) },
881 {IOMUX_PADS(PAD_NANDF_D1__GPIO2_IO01) },
887 {IOMUX_PADS(PAD_NANDF_D2__GPIO2_IO02) },
893 {IOMUX_PADS(PAD_NANDF_D3__GPIO2_IO03) },
899 {IOMUX_PADS(PAD_NANDF_D4__GPIO2_IO04) },
905 {IOMUX_PADS(PAD_NANDF_D5__GPIO2_IO05) },
911 {IOMUX_PADS(PAD_NANDF_D6__GPIO2_IO06) },
917 {IOMUX_PADS(PAD_NANDF_D7__GPIO2_IO07) },
924 struct dio_cfg gw5906_dio[] = {
926 { IOMUX_PADS(PAD_SD1_DAT0__GPIO1_IO16) },
932 { IOMUX_PADS(PAD_SD1_DAT2__GPIO1_IO19) },
934 { IOMUX_PADS(PAD_SD1_DAT2__PWM2_OUT) },
938 { IOMUX_PADS(PAD_SD1_DAT1__GPIO1_IO17) },
940 { IOMUX_PADS(PAD_SD1_DAT1__PWM3_OUT) },
944 {IOMUX_PADS(PAD_SD1_CLK__GPIO1_IO20) },
952 * Board Specific GPIO
954 struct ventana gpio_cfg[GW_UNKNOWN] = {
957 .gpio_pads = gw54xx_gpio_pads,
958 .num_pads = ARRAY_SIZE(gw54xx_gpio_pads)/2,
959 .dio_cfg = gw54xx_dio,
960 .dio_num = ARRAY_SIZE(gw54xx_dio),
966 .pcie_rst = IMX_GPIO_NR(1, 29),
967 .mezz_pwren = IMX_GPIO_NR(4, 7),
968 .mezz_irq = IMX_GPIO_NR(4, 9),
969 .rs485en = IMX_GPIO_NR(3, 24),
970 .dioi2c_en = IMX_GPIO_NR(4, 5),
971 .pcie_sson = IMX_GPIO_NR(1, 20),
972 .otgpwr_en = IMX_GPIO_NR(3, 22),
973 .mmc_cd = IMX_GPIO_NR(7, 0),
978 .gpio_pads = gw51xx_gpio_pads,
979 .num_pads = ARRAY_SIZE(gw51xx_gpio_pads)/2,
980 .dio_cfg = gw51xx_dio,
981 .dio_num = ARRAY_SIZE(gw51xx_dio),
986 .pcie_rst = IMX_GPIO_NR(1, 0),
987 .mezz_pwren = IMX_GPIO_NR(2, 19),
988 .mezz_irq = IMX_GPIO_NR(2, 18),
989 .gps_shdn = IMX_GPIO_NR(1, 2),
990 .vidin_en = IMX_GPIO_NR(5, 20),
991 .wdis = IMX_GPIO_NR(7, 12),
992 .otgpwr_en = IMX_GPIO_NR(3, 22),
998 .gpio_pads = gw52xx_gpio_pads,
999 .num_pads = ARRAY_SIZE(gw52xx_gpio_pads)/2,
1000 .dio_cfg = gw52xx_dio,
1001 .dio_num = ARRAY_SIZE(gw52xx_dio),
1007 .pcie_rst = IMX_GPIO_NR(1, 29),
1008 .mezz_pwren = IMX_GPIO_NR(2, 19),
1009 .mezz_irq = IMX_GPIO_NR(2, 18),
1010 .gps_shdn = IMX_GPIO_NR(1, 27),
1011 .vidin_en = IMX_GPIO_NR(3, 31),
1012 .usb_sel = IMX_GPIO_NR(1, 2),
1013 .wdis = IMX_GPIO_NR(7, 12),
1014 .msata_en = GP_MSATA_SEL,
1015 .rs232_en = GP_RS232_EN,
1016 .otgpwr_en = IMX_GPIO_NR(3, 22),
1017 .vsel_pin = IMX_GPIO_NR(6, 14),
1018 .mmc_cd = IMX_GPIO_NR(7, 0),
1024 .gpio_pads = gw53xx_gpio_pads,
1025 .num_pads = ARRAY_SIZE(gw53xx_gpio_pads)/2,
1026 .dio_cfg = gw53xx_dio,
1027 .dio_num = ARRAY_SIZE(gw53xx_dio),
1033 .pcie_rst = IMX_GPIO_NR(1, 29),
1034 .mezz_pwren = IMX_GPIO_NR(2, 19),
1035 .mezz_irq = IMX_GPIO_NR(2, 18),
1036 .gps_shdn = IMX_GPIO_NR(1, 27),
1037 .vidin_en = IMX_GPIO_NR(3, 31),
1038 .wdis = IMX_GPIO_NR(7, 12),
1039 .msata_en = GP_MSATA_SEL,
1040 .rs232_en = GP_RS232_EN,
1041 .otgpwr_en = IMX_GPIO_NR(3, 22),
1042 .vsel_pin = IMX_GPIO_NR(6, 14),
1043 .mmc_cd = IMX_GPIO_NR(7, 0),
1049 .gpio_pads = gw54xx_gpio_pads,
1050 .num_pads = ARRAY_SIZE(gw54xx_gpio_pads)/2,
1051 .dio_cfg = gw54xx_dio,
1052 .dio_num = ARRAY_SIZE(gw54xx_dio),
1058 .pcie_rst = IMX_GPIO_NR(1, 29),
1059 .mezz_pwren = IMX_GPIO_NR(2, 19),
1060 .mezz_irq = IMX_GPIO_NR(2, 18),
1061 .rs485en = IMX_GPIO_NR(7, 1),
1062 .vidin_en = IMX_GPIO_NR(3, 31),
1063 .dioi2c_en = IMX_GPIO_NR(4, 5),
1064 .pcie_sson = IMX_GPIO_NR(1, 20),
1065 .wdis = IMX_GPIO_NR(5, 17),
1066 .msata_en = GP_MSATA_SEL,
1067 .rs232_en = GP_RS232_EN,
1068 .otgpwr_en = IMX_GPIO_NR(3, 22),
1069 .vsel_pin = IMX_GPIO_NR(6, 14),
1070 .mmc_cd = IMX_GPIO_NR(7, 0),
1076 .gpio_pads = gw551x_gpio_pads,
1077 .num_pads = ARRAY_SIZE(gw551x_gpio_pads)/2,
1078 .dio_cfg = gw551x_dio,
1079 .dio_num = ARRAY_SIZE(gw551x_dio),
1083 .pcie_rst = IMX_GPIO_NR(1, 0),
1084 .wdis = IMX_GPIO_NR(7, 12),
1090 .gpio_pads = gw552x_gpio_pads,
1091 .num_pads = ARRAY_SIZE(gw552x_gpio_pads)/2,
1092 .dio_cfg = gw552x_dio,
1093 .dio_num = ARRAY_SIZE(gw552x_dio),
1099 .pcie_rst = IMX_GPIO_NR(1, 29),
1100 .usb_sel = IMX_GPIO_NR(1, 7),
1101 .wdis = IMX_GPIO_NR(7, 12),
1102 .msata_en = GP_MSATA_SEL,
1108 .gpio_pads = gw553x_gpio_pads,
1109 .num_pads = ARRAY_SIZE(gw553x_gpio_pads)/2,
1110 .dio_cfg = gw553x_dio,
1111 .dio_num = ARRAY_SIZE(gw553x_dio),
1116 .pcie_rst = IMX_GPIO_NR(1, 0),
1117 .vidin_en = IMX_GPIO_NR(5, 20),
1118 .wdis = IMX_GPIO_NR(7, 12),
1119 .otgpwr_en = IMX_GPIO_NR(3, 22),
1120 .vsel_pin = IMX_GPIO_NR(6, 14),
1121 .mmc_cd = IMX_GPIO_NR(7, 0),
1127 .gpio_pads = gw560x_gpio_pads,
1128 .num_pads = ARRAY_SIZE(gw560x_gpio_pads)/2,
1129 .dio_cfg = gw560x_dio,
1130 .dio_num = ARRAY_SIZE(gw560x_dio),
1136 .pcie_rst = IMX_GPIO_NR(4, 31),
1137 .mezz_pwren = IMX_GPIO_NR(2, 19),
1138 .mezz_irq = IMX_GPIO_NR(2, 18),
1139 .rs232_en = GP_RS232_EN,
1140 .vidin_en = IMX_GPIO_NR(3, 31),
1141 .wdis = IMX_GPIO_NR(7, 12),
1142 .otgpwr_en = IMX_GPIO_NR(4, 15),
1143 .mmc_cd = IMX_GPIO_NR(7, 0),
1148 .gpio_pads = gw5901_gpio_pads,
1149 .num_pads = ARRAY_SIZE(gw5901_gpio_pads)/2,
1150 .dio_cfg = gw5901_dio,
1154 .pcie_rst = IMX_GPIO_NR(1, 29),
1160 .gpio_pads = gw5902_gpio_pads,
1161 .num_pads = ARRAY_SIZE(gw5902_gpio_pads)/2,
1162 .dio_cfg = gw5902_dio,
1166 .pcie_rst = IMX_GPIO_NR(1, 0),
1167 .rs232_en = GP_RS232_EN,
1168 .otgpwr_en = IMX_GPIO_NR(3, 23),
1174 .gpio_pads = gw5903_gpio_pads,
1175 .num_pads = ARRAY_SIZE(gw5903_gpio_pads)/2,
1176 .dio_cfg = gw5903_dio,
1177 .dio_num = ARRAY_SIZE(gw5903_dio),
1181 .otgpwr_en = IMX_GPIO_NR(4, 15),
1182 .mmc_cd = IMX_GPIO_NR(6, 11),
1187 .gpio_pads = gw5904_gpio_pads,
1188 .num_pads = ARRAY_SIZE(gw5904_gpio_pads)/2,
1189 .dio_cfg = gw5904_dio,
1190 .dio_num = ARRAY_SIZE(gw5904_dio),
1196 .pcie_rst = IMX_GPIO_NR(1, 0),
1197 .mezz_pwren = IMX_GPIO_NR(2, 19),
1198 .mezz_irq = IMX_GPIO_NR(2, 18),
1199 .otgpwr_en = IMX_GPIO_NR(3, 22),
1204 .gpio_pads = gw5905_gpio_pads,
1205 .num_pads = ARRAY_SIZE(gw5905_gpio_pads)/2,
1209 .pcie_rst = IMX_GPIO_NR(7, 11),
1210 .wdis = IMX_GPIO_NR(7, 13),
1215 .gpio_pads = gw552x_gpio_pads,
1216 .num_pads = ARRAY_SIZE(gw552x_gpio_pads)/2,
1217 .dio_cfg = gw5906_dio,
1218 .dio_num = ARRAY_SIZE(gw5906_dio),
1224 .pcie_rst = IMX_GPIO_NR(1, 29),
1225 .usb_sel = IMX_GPIO_NR(1, 7),
1226 .wdis = IMX_GPIO_NR(7, 12),
1227 .msata_en = GP_MSATA_SEL,
1233 .gpio_pads = gw51xx_gpio_pads,
1234 .num_pads = ARRAY_SIZE(gw51xx_gpio_pads)/2,
1235 .dio_cfg = gw51xx_dio,
1236 .dio_num = ARRAY_SIZE(gw51xx_dio),
1241 .pcie_rst = IMX_GPIO_NR(1, 0),
1242 .wdis = IMX_GPIO_NR(7, 12),
1248 .gpio_pads = gw53xx_gpio_pads,
1249 .num_pads = ARRAY_SIZE(gw53xx_gpio_pads)/2,
1250 .dio_cfg = gw53xx_dio,
1251 .dio_num = ARRAY_SIZE(gw53xx_dio),
1257 .pcie_rst = IMX_GPIO_NR(1, 29),
1258 .mezz_pwren = IMX_GPIO_NR(2, 19),
1259 .mezz_irq = IMX_GPIO_NR(2, 18),
1260 .gps_shdn = IMX_GPIO_NR(1, 27),
1261 .vidin_en = IMX_GPIO_NR(3, 31),
1262 .wdis = IMX_GPIO_NR(7, 12),
1263 .msata_en = GP_MSATA_SEL,
1264 .rs232_en = GP_RS232_EN,
1269 .gpio_pads = gw5904_gpio_pads,
1270 .num_pads = ARRAY_SIZE(gw5904_gpio_pads)/2,
1271 .dio_cfg = gw5904_dio,
1272 .dio_num = ARRAY_SIZE(gw5904_dio),
1278 .pcie_rst = IMX_GPIO_NR(1, 0),
1279 .mezz_pwren = IMX_GPIO_NR(2, 19),
1280 .mezz_irq = IMX_GPIO_NR(2, 18),
1281 .otgpwr_en = IMX_GPIO_NR(3, 22),
1285 #define SETUP_GPIO_OUTPUT(gpio, name, level) \
1286 gpio_request(gpio, name); \
1287 gpio_direction_output(gpio, level);
1288 #define SETUP_GPIO_INPUT(gpio, name) \
1289 gpio_request(gpio, name); \
1290 gpio_direction_input(gpio);
1291 void setup_iomux_gpio(int board, struct ventana_board_info *info)
1295 if (board >= GW_UNKNOWN)
1298 /* board specific iomux */
1299 imx_iomux_v3_setup_multiple_pads(gpio_cfg[board].gpio_pads,
1300 gpio_cfg[board].num_pads);
1303 if (gpio_cfg[board].rs232_en) {
1304 gpio_request(gpio_cfg[board].rs232_en, "rs232_en#");
1305 gpio_direction_output(gpio_cfg[board].rs232_en, 0);
1308 /* GW522x Uses GPIO3_IO23 for PCIE_RST# */
1309 if (board == GW52xx && info->model[4] == '2')
1310 gpio_cfg[board].pcie_rst = IMX_GPIO_NR(3, 23);
1312 /* assert PCI_RST# */
1313 gpio_request(gpio_cfg[board].pcie_rst, "pci_rst#");
1314 gpio_direction_output(gpio_cfg[board].pcie_rst, 0);
1316 /* turn off (active-high) user LED's */
1317 for (i = 0; i < ARRAY_SIZE(gpio_cfg[board].leds); i++) {
1319 if (gpio_cfg[board].leds[i]) {
1320 sprintf(name, "led_user%d", i);
1321 gpio_request(gpio_cfg[board].leds[i], name);
1322 gpio_direction_output(gpio_cfg[board].leds[i], 1);
1326 /* MSATA Enable - default to PCI */
1327 if (gpio_cfg[board].msata_en) {
1328 gpio_request(gpio_cfg[board].msata_en, "msata_en");
1329 gpio_direction_output(gpio_cfg[board].msata_en, 0);
1332 /* Expansion Mezzanine IO */
1333 if (gpio_cfg[board].mezz_pwren) {
1334 gpio_request(gpio_cfg[board].mezz_pwren, "mezz_pwr");
1335 gpio_direction_output(gpio_cfg[board].mezz_pwren, 0);
1337 if (gpio_cfg[board].mezz_irq) {
1338 gpio_request(gpio_cfg[board].mezz_irq, "mezz_irq#");
1339 gpio_direction_input(gpio_cfg[board].mezz_irq);
1342 /* RS485 Transmit Enable */
1343 if (gpio_cfg[board].rs485en) {
1344 gpio_request(gpio_cfg[board].rs485en, "rs485_en");
1345 gpio_direction_output(gpio_cfg[board].rs485en, 0);
1349 if (gpio_cfg[board].gps_shdn) {
1350 gpio_request(gpio_cfg[board].gps_shdn, "gps_shdn");
1351 gpio_direction_output(gpio_cfg[board].gps_shdn, 1);
1354 /* Analog video codec power enable */
1355 if (gpio_cfg[board].vidin_en) {
1356 gpio_request(gpio_cfg[board].vidin_en, "anavidin_en");
1357 gpio_direction_output(gpio_cfg[board].vidin_en, 1);
1361 if (gpio_cfg[board].dioi2c_en) {
1362 gpio_request(gpio_cfg[board].dioi2c_en, "dioi2c_dis#");
1363 gpio_direction_output(gpio_cfg[board].dioi2c_en, 0);
1366 /* PCICK_SSON: disable spread-spectrum clock */
1367 if (gpio_cfg[board].pcie_sson) {
1368 gpio_request(gpio_cfg[board].pcie_sson, "pci_sson");
1369 gpio_direction_output(gpio_cfg[board].pcie_sson, 0);
1372 /* USBOTG mux routing */
1373 if (gpio_cfg[board].usb_sel) {
1374 gpio_request(gpio_cfg[board].usb_sel, "usb_pcisel");
1375 gpio_direction_output(gpio_cfg[board].usb_sel, 0);
1378 /* PCISKT_WDIS# (Wireless disable GPIO to miniPCIe sockets) */
1379 if (gpio_cfg[board].wdis) {
1380 gpio_request(gpio_cfg[board].wdis, "wlan_dis");
1381 gpio_direction_output(gpio_cfg[board].wdis, 1);
1385 if (gpio_cfg[board].otgpwr_en) {
1386 gpio_request(gpio_cfg[board].otgpwr_en, "usbotg_pwr");
1387 gpio_direction_output(gpio_cfg[board].otgpwr_en, 0);
1390 /* sense vselect pin to see if we support uhs-i */
1391 if (gpio_cfg[board].vsel_pin) {
1392 gpio_request(gpio_cfg[board].vsel_pin, "sd3_vselect");
1393 gpio_direction_input(gpio_cfg[board].vsel_pin);
1394 gpio_cfg[board].usd_vsel = !gpio_get_value(gpio_cfg[board].vsel_pin);
1398 if (gpio_cfg[board].mmc_cd) {
1399 gpio_request(gpio_cfg[board].mmc_cd, "sd_cd");
1400 gpio_direction_input(gpio_cfg[board].mmc_cd);
1403 /* Anything else board specific */
1406 gpio_request(IMX_GPIO_NR(4, 26), "12p0_en");
1407 gpio_direction_output(IMX_GPIO_NR(4, 26), 1);
1410 SETUP_GPIO_OUTPUT(IMX_GPIO_NR(1, 2), "can_stby", 0);
1413 SETUP_GPIO_OUTPUT(IMX_GPIO_NR(1, 2), "can1_stby", 0);
1414 SETUP_GPIO_OUTPUT(IMX_GPIO_NR(7, 3), "can2_stby", 0);
1415 SETUP_GPIO_OUTPUT(IMX_GPIO_NR(7, 12), "5P0V_EN", 1);
1418 gpio_request(IMX_GPIO_NR(3, 31) , "usbh1-ehci_pwr");
1419 gpio_direction_output(IMX_GPIO_NR(3, 31), 1);
1420 gpio_request(IMX_GPIO_NR(4, 15) , "usbh2-otg_pwr");
1421 gpio_direction_output(IMX_GPIO_NR(4, 15), 1);
1422 gpio_request(IMX_GPIO_NR(4, 7) , "usbdpc_pwr");
1423 gpio_direction_output(IMX_GPIO_NR(4, 15), 1);
1424 gpio_request(IMX_GPIO_NR(1, 25) , "rgmii_en");
1425 gpio_direction_output(IMX_GPIO_NR(1, 25), 1);
1426 gpio_request(IMX_GPIO_NR(4, 6) , "touch_irq#");
1427 gpio_direction_input(IMX_GPIO_NR(4, 6));
1428 gpio_request(IMX_GPIO_NR(4, 8) , "touch_rst");
1429 gpio_direction_output(IMX_GPIO_NR(4, 8), 1);
1430 gpio_request(IMX_GPIO_NR(1, 7) , "bklt_12ven");
1431 gpio_direction_output(IMX_GPIO_NR(1, 7), 1);
1435 gpio_request(IMX_GPIO_NR(4, 23), "rs485_en");
1436 gpio_direction_output(IMX_GPIO_NR(4, 23), 0);
1437 gpio_request(IMX_GPIO_NR(5, 11), "skt1_wdis#");
1438 gpio_direction_output(IMX_GPIO_NR(5, 11), 1);
1439 gpio_request(IMX_GPIO_NR(5, 12), "skt1_rst#");
1440 gpio_direction_output(IMX_GPIO_NR(5, 12), 1);
1441 gpio_request(IMX_GPIO_NR(5, 13), "skt2_wdis#");
1442 gpio_direction_output(IMX_GPIO_NR(5, 13), 1);
1443 gpio_request(IMX_GPIO_NR(1, 15), "m2_off#");
1444 gpio_direction_output(IMX_GPIO_NR(1, 15), 1);
1445 gpio_request(IMX_GPIO_NR(1, 14), "m2_wdis#");
1446 gpio_direction_output(IMX_GPIO_NR(1, 14), 1);
1447 gpio_request(IMX_GPIO_NR(1, 13), "m2_rst#");
1448 gpio_direction_output(IMX_GPIO_NR(1, 13), 1);
1451 SETUP_GPIO_OUTPUT(IMX_GPIO_NR(1, 7), "usb_pcisel", 0);
1452 SETUP_GPIO_OUTPUT(IMX_GPIO_NR(1, 9), "lvds_cabc", 1);
1453 SETUP_GPIO_OUTPUT(IMX_GPIO_NR(1, 14), "mipi_pdwn", 1);
1454 SETUP_GPIO_OUTPUT(IMX_GPIO_NR(1, 15), "mipi_rst#", 0);
1455 SETUP_GPIO_OUTPUT(IMX_GPIO_NR(2, 3), "emmy_pdwn#", 1);
1456 SETUP_GPIO_OUTPUT(IMX_GPIO_NR(4, 5), "spk_shdn#", 0);
1457 SETUP_GPIO_OUTPUT(IMX_GPIO_NR(4, 8), "touch_rst", 0);
1458 SETUP_GPIO_OUTPUT(IMX_GPIO_NR(4, 6), "touch_irq", 0);
1459 SETUP_GPIO_OUTPUT(IMX_GPIO_NR(5, 5), "flash_en1", 0);
1460 SETUP_GPIO_OUTPUT(IMX_GPIO_NR(5, 6), "flash_en2", 0);
1461 SETUP_GPIO_OUTPUT(IMX_GPIO_NR(5, 14), "dect_rst#", 1);
1462 SETUP_GPIO_OUTPUT(IMX_GPIO_NR(5, 17), "codec_rst#", 0);
1463 SETUP_GPIO_OUTPUT(IMX_GPIO_NR(5, 26), "imu_den", 1);
1464 SETUP_GPIO_OUTPUT(IMX_GPIO_NR(7, 12), "lvds_cabc", 0);
1467 * gauruntee touch controller comes out of reset with INT
1470 SETUP_GPIO_OUTPUT(IMX_GPIO_NR(4, 8), "touch_rst", 1);
1475 /* setup GPIO pinmux and default configuration per baseboard and env */
1476 void setup_board_gpio(int board, struct ventana_board_info *info)
1482 int quiet = simple_strtol(env_get("quiet"), NULL, 10);
1484 if (board >= GW_UNKNOWN)
1488 if (gpio_cfg[board].rs232_en) {
1489 gpio_direction_output(gpio_cfg[board].rs232_en,
1490 (hwconfig("rs232")) ? 0 : 1);
1494 if (gpio_cfg[board].msata_en && is_cpu_type(MXC_CPU_MX6Q)) {
1495 gpio_direction_output(GP_MSATA_SEL,
1496 (hwconfig("msata")) ? 1 : 0);
1499 /* USBOTG Select (PCISKT or FrontPanel) */
1500 if (gpio_cfg[board].usb_sel) {
1501 gpio_direction_output(gpio_cfg[board].usb_sel,
1502 (hwconfig("usb_pcisel")) ? 1 : 0);
1506 * Configure DIO pinmux/padctl registers
1507 * see IMX6DQRM/IMX6SDLRM IOMUXC_SW_PAD_CTL_PAD_* register definitions
1509 for (i = 0; i < gpio_cfg[board].dio_num; i++) {
1510 struct dio_cfg *cfg = &gpio_cfg[board].dio_cfg[i];
1511 iomux_v3_cfg_t ctrl = DIO_PAD_CFG;
1512 unsigned cputype = is_cpu_type(MXC_CPU_MX6Q) ? 0 : 1;
1514 if (!cfg->gpio_padmux[0] && !cfg->gpio_padmux[1])
1516 sprintf(arg, "dio%d", i);
1519 s = hwconfig_subarg(arg, "padctrl", &len);
1521 ctrl = MUX_PAD_CTRL(simple_strtoul(s, NULL, 16)
1522 & 0x1ffff) | MUX_MODE_SION;
1524 if (hwconfig_subarg_cmp(arg, "mode", "gpio")) {
1526 printf("DIO%d: GPIO%d_IO%02d (gpio-%d)\n", i,
1527 (cfg->gpio_param/32)+1,
1531 imx_iomux_v3_setup_pad(cfg->gpio_padmux[cputype] |
1533 gpio_requestf(cfg->gpio_param, "dio%d", i);
1534 gpio_direction_input(cfg->gpio_param);
1535 } else if (hwconfig_subarg_cmp(arg, "mode", "pwm") &&
1537 if (!cfg->pwm_param) {
1538 printf("DIO%d: Error: pwm config invalid\n",
1543 printf("DIO%d: pwm%d\n", i, cfg->pwm_param);
1544 imx_iomux_v3_setup_pad(cfg->pwm_padmux[cputype] |
1545 MUX_PAD_CTRL(ctrl));
1550 if (gpio_cfg[board].msata_en && is_cpu_type(MXC_CPU_MX6Q)) {
1551 printf("MSATA: %s\n", (hwconfig("msata") ?
1552 "enabled" : "disabled"));
1554 if (gpio_cfg[board].rs232_en) {
1555 printf("RS232: %s\n", (hwconfig("rs232")) ?
1556 "enabled" : "disabled");
1561 /* setup board specific PMIC */
1562 void setup_pmic(void)
1565 struct ventana_board_info ventana_info;
1566 int board = read_eeprom(CONFIG_I2C_GSC, &ventana_info);
1567 const int i2c_pmic = 1;
1570 i2c_set_bus_num(i2c_pmic);
1572 /* configure PFUZE100 PMIC */
1573 if (!i2c_probe(CONFIG_POWER_PFUZE100_I2C_ADDR)) {
1574 debug("probed PFUZE100@0x%x\n", CONFIG_POWER_PFUZE100_I2C_ADDR);
1575 power_pfuze100_init(i2c_pmic);
1576 p = pmic_get("PFUZE100");
1577 if (p && !pmic_probe(p)) {
1578 pmic_reg_read(p, PFUZE100_DEVICEID, ®);
1579 printf("PMIC: PFUZE100 ID=0x%02x\n", reg);
1581 /* Set VGEN1 to 1.5V and enable */
1582 pmic_reg_read(p, PFUZE100_VGEN1VOL, ®);
1583 reg &= ~(LDO_VOL_MASK);
1584 reg |= (LDOA_1_50V | LDO_EN);
1585 pmic_reg_write(p, PFUZE100_VGEN1VOL, reg);
1587 /* Set SWBST to 5.0V and enable */
1588 pmic_reg_read(p, PFUZE100_SWBSTCON1, ®);
1589 reg &= ~(SWBST_MODE_MASK | SWBST_VOL_MASK);
1590 reg |= (SWBST_5_00V | (SWBST_MODE_AUTO << SWBST_MODE_SHIFT));
1591 pmic_reg_write(p, PFUZE100_SWBSTCON1, reg);
1595 /* configure LTC3676 PMIC */
1596 else if (!i2c_probe(CONFIG_POWER_LTC3676_I2C_ADDR)) {
1597 debug("probed LTC3676@0x%x\n", CONFIG_POWER_LTC3676_I2C_ADDR);
1598 power_ltc3676_init(i2c_pmic);
1599 p = pmic_get("LTC3676_PMIC");
1600 if (!p || pmic_probe(p))
1602 puts("PMIC: LTC3676\n");
1604 * set board-specific scalar for max CPU frequency
1605 * per CPU based on the LDO enabled Operating Ranges
1606 * defined in the respective IMX6DQ and IMX6SDL
1607 * datasheets. The voltage resulting from the R1/R2
1608 * feedback inputs on Ventana is 1308mV. Note that this
1609 * is a bit shy of the Vmin of 1350mV in the datasheet
1610 * for LDO enabled mode but is as high as we can go.
1614 /* mask PGOOD during SW3 transition */
1615 pmic_reg_write(p, LTC3676_DVB3B,
1616 0x1f | LTC3676_PGOOD_MASK);
1617 /* set SW3 (VDD_ARM) */
1618 pmic_reg_write(p, LTC3676_DVB3A, 0x1f);
1621 /* mask PGOOD during SW3 transition */
1622 pmic_reg_write(p, LTC3676_DVB3B,
1623 0x1f | LTC3676_PGOOD_MASK);
1624 /* set SW3 (VDD_ARM) */
1625 pmic_reg_write(p, LTC3676_DVB3A, 0x1f);
1627 /* mask PGOOD during SW4 transition */
1628 pmic_reg_write(p, LTC3676_DVB4B,
1629 0x1f | LTC3676_PGOOD_MASK);
1630 /* set SW4 (VDD_SOC) */
1631 pmic_reg_write(p, LTC3676_DVB4A, 0x1f);
1634 /* mask PGOOD during SW1 transition */
1635 pmic_reg_write(p, LTC3676_DVB1B,
1636 0x1f | LTC3676_PGOOD_MASK);
1637 /* set SW1 (VDD_ARM) */
1638 pmic_reg_write(p, LTC3676_DVB1A, 0x1f);
1640 /* mask PGOOD during SW3 transition */
1641 pmic_reg_write(p, LTC3676_DVB3B,
1642 0x1f | LTC3676_PGOOD_MASK);
1643 /* set SW3 (VDD_SOC) */
1644 pmic_reg_write(p, LTC3676_DVB3A, 0x1f);
1647 /* mask PGOOD during SW1 transition */
1648 pmic_reg_write(p, LTC3676_DVB1B,
1649 0x1f | LTC3676_PGOOD_MASK);
1650 /* set SW1 (VDD_SOC) */
1651 pmic_reg_write(p, LTC3676_DVB1A, 0x1f);
1653 /* mask PGOOD during SW3 transition */
1654 pmic_reg_write(p, LTC3676_DVB3B,
1655 0x1f | LTC3676_PGOOD_MASK);
1656 /* set SW3 (VDD_ARM) */
1657 pmic_reg_write(p, LTC3676_DVB3A, 0x1f);
1662 #ifdef CONFIG_FSL_ESDHC_IMX
1663 static struct fsl_esdhc_cfg usdhc_cfg[2];
1665 int board_mmc_init(bd_t *bis)
1667 struct ventana_board_info ventana_info;
1668 int board_type = read_eeprom(CONFIG_I2C_GSC, &ventana_info);
1671 switch (board_type) {
1676 /* usdhc3: 4bit microSD */
1677 SETUP_IOMUX_PADS(usdhc3_pads);
1678 usdhc_cfg[0].esdhc_base = USDHC3_BASE_ADDR;
1679 usdhc_cfg[0].sdhc_clk = mxc_get_clock(MXC_ESDHC3_CLK);
1680 usdhc_cfg[0].max_bus_width = 4;
1681 return fsl_esdhc_initialize(bis, &usdhc_cfg[0]);
1683 /* usdhc2: 8-bit eMMC */
1684 SETUP_IOMUX_PADS(gw560x_emmc_sd2_pads);
1685 usdhc_cfg[0].esdhc_base = USDHC2_BASE_ADDR;
1686 usdhc_cfg[0].sdhc_clk = mxc_get_clock(MXC_ESDHC2_CLK);
1687 usdhc_cfg[0].max_bus_width = 8;
1688 ret = fsl_esdhc_initialize(bis, &usdhc_cfg[0]);
1691 /* usdhc3: 4-bit microSD */
1692 SETUP_IOMUX_PADS(usdhc3_pads);
1693 usdhc_cfg[1].esdhc_base = USDHC3_BASE_ADDR;
1694 usdhc_cfg[1].sdhc_clk = mxc_get_clock(MXC_ESDHC3_CLK);
1695 usdhc_cfg[1].max_bus_width = 4;
1696 return fsl_esdhc_initialize(bis, &usdhc_cfg[1]);
1698 /* usdhc3: 8-bit eMMC */
1699 SETUP_IOMUX_PADS(gw5904_emmc_pads);
1700 usdhc_cfg[0].esdhc_base = USDHC3_BASE_ADDR;
1701 usdhc_cfg[0].sdhc_clk = mxc_get_clock(MXC_ESDHC3_CLK);
1702 usdhc_cfg[0].max_bus_width = 8;
1703 ret = fsl_esdhc_initialize(bis, &usdhc_cfg[0]);
1706 /* usdhc2: 4-bit microSD */
1707 SETUP_IOMUX_PADS(gw5904_mmc_pads);
1708 usdhc_cfg[1].esdhc_base = USDHC2_BASE_ADDR;
1709 usdhc_cfg[1].sdhc_clk = mxc_get_clock(MXC_ESDHC2_CLK);
1710 usdhc_cfg[1].max_bus_width = 4;
1711 return fsl_esdhc_initialize(bis, &usdhc_cfg[1]);
1715 /* usdhc3: 8bit eMMC */
1716 SETUP_IOMUX_PADS(gw5904_emmc_pads);
1717 usdhc_cfg[0].esdhc_base = USDHC3_BASE_ADDR;
1718 usdhc_cfg[0].sdhc_clk = mxc_get_clock(MXC_ESDHC3_CLK);
1719 usdhc_cfg[0].max_bus_width = 8;
1720 return fsl_esdhc_initialize(bis, &usdhc_cfg[0]);
1722 /* doesn't have MMC */
1727 int board_mmc_getcd(struct mmc *mmc)
1729 struct ventana_board_info ventana_info;
1730 struct fsl_esdhc_cfg *cfg = (struct fsl_esdhc_cfg *)mmc->priv;
1731 int board = read_eeprom(CONFIG_I2C_GSC, &ventana_info);
1732 int gpio = gpio_cfg[board].mmc_cd;
1737 /* emmc is always present */
1738 if (cfg->esdhc_base == USDHC2_BASE_ADDR)
1745 /* emmc is always present */
1746 if (cfg->esdhc_base == USDHC3_BASE_ADDR)
1752 debug("%s: gpio%d=%d\n", __func__, gpio, gpio_get_value(gpio));
1753 return !gpio_get_value(gpio);
1759 #endif /* CONFIG_FSL_ESDHC_IMX */