sound/soc/codecs/msm8916-wcd-analog.c

   1 // SPDX-License-Identifier: GPL-2.0
   2 // Copyright (c) 2016, The Linux Foundation. All rights reserved.
   3
   4 #include <linux/module.h>
   5 #include <linux/err.h>
   6 #include <linux/kernel.h>
   7 #include <linux/delay.h>
   8 #include <linux/regulator/consumer.h>
   9 #include <linux/types.h>
  10 #include <linux/clk.h>
  11 #include <linux/of.h>
  12 #include <linux/platform_device.h>
  13 #include <linux/regmap.h>
  14 #include <sound/soc.h>
  15 #include <sound/pcm.h>
  16 #include <sound/pcm_params.h>
  17 #include <sound/tlv.h>
  18 #include <sound/jack.h>
  19
  20 #define CDC_D_REVISION1                 (0xf000)
  21 #define CDC_D_PERPH_SUBTYPE             (0xf005)
  22 #define CDC_D_INT_EN_SET                (0x015)
  23 #define CDC_D_INT_EN_CLR                (0x016)
  24 #define MBHC_SWITCH_INT                 BIT(7)
  25 #define MBHC_MIC_ELECTRICAL_INS_REM_DET BIT(6)
  26 #define MBHC_BUTTON_PRESS_DET           BIT(5)
  27 #define MBHC_BUTTON_RELEASE_DET         BIT(4)
  28 #define CDC_D_CDC_RST_CTL               (0xf046)
  29 #define RST_CTL_DIG_SW_RST_N_MASK       BIT(7)
  30 #define RST_CTL_DIG_SW_RST_N_RESET      0
  31 #define RST_CTL_DIG_SW_RST_N_REMOVE_RESET BIT(7)
  32
  33 #define CDC_D_CDC_TOP_CLK_CTL           (0xf048)
  34 #define TOP_CLK_CTL_A_MCLK_MCLK2_EN_MASK (BIT(2) | BIT(3))
  35 #define TOP_CLK_CTL_A_MCLK_EN_ENABLE     BIT(2)
  36 #define TOP_CLK_CTL_A_MCLK2_EN_ENABLE   BIT(3)
  37
  38 #define CDC_D_CDC_ANA_CLK_CTL           (0xf049)
  39 #define ANA_CLK_CTL_EAR_HPHR_CLK_EN_MASK BIT(0)
  40 #define ANA_CLK_CTL_EAR_HPHR_CLK_EN     BIT(0)
  41 #define ANA_CLK_CTL_EAR_HPHL_CLK_EN     BIT(1)
  42 #define ANA_CLK_CTL_SPKR_CLK_EN_MASK    BIT(4)
  43 #define ANA_CLK_CTL_SPKR_CLK_EN BIT(4)
  44 #define ANA_CLK_CTL_TXA_CLK25_EN        BIT(5)
  45
  46 #define CDC_D_CDC_DIG_CLK_CTL           (0xf04A)
  47 #define DIG_CLK_CTL_RXD1_CLK_EN         BIT(0)
  48 #define DIG_CLK_CTL_RXD2_CLK_EN         BIT(1)
  49 #define DIG_CLK_CTL_RXD3_CLK_EN         BIT(2)
  50 #define DIG_CLK_CTL_D_MBHC_CLK_EN_MASK  BIT(3)
  51 #define DIG_CLK_CTL_D_MBHC_CLK_EN       BIT(3)
  52 #define DIG_CLK_CTL_TXD_CLK_EN          BIT(4)
  53 #define DIG_CLK_CTL_NCP_CLK_EN_MASK     BIT(6)
  54 #define DIG_CLK_CTL_NCP_CLK_EN          BIT(6)
  55 #define DIG_CLK_CTL_RXD_PDM_CLK_EN_MASK BIT(7)
  56 #define DIG_CLK_CTL_RXD_PDM_CLK_EN      BIT(7)
  57
  58 #define CDC_D_CDC_CONN_TX1_CTL          (0xf050)
  59 #define CONN_TX1_SERIAL_TX1_MUX         GENMASK(1, 0)
  60 #define CONN_TX1_SERIAL_TX1_ADC_1       0x0
  61 #define CONN_TX1_SERIAL_TX1_RX_PDM_LB   0x1
  62 #define CONN_TX1_SERIAL_TX1_ZERO        0x2
  63
  64 #define CDC_D_CDC_CONN_TX2_CTL          (0xf051)
  65 #define CONN_TX2_SERIAL_TX2_MUX         GENMASK(1, 0)
  66 #define CONN_TX2_SERIAL_TX2_ADC_2       0x0
  67 #define CONN_TX2_SERIAL_TX2_RX_PDM_LB   0x1
  68 #define CONN_TX2_SERIAL_TX2_ZERO        0x2
  69 #define CDC_D_CDC_CONN_HPHR_DAC_CTL     (0xf052)
  70 #define CDC_D_CDC_CONN_RX1_CTL          (0xf053)
  71 #define CDC_D_CDC_CONN_RX2_CTL          (0xf054)
  72 #define CDC_D_CDC_CONN_RX3_CTL          (0xf055)
  73 #define CDC_D_CDC_CONN_RX_LB_CTL        (0xf056)
  74 #define CDC_D_SEC_ACCESS                (0xf0D0)
  75 #define CDC_D_PERPH_RESET_CTL3          (0xf0DA)
  76 #define CDC_D_PERPH_RESET_CTL4          (0xf0DB)
  77 #define CDC_A_REVISION1                 (0xf100)
  78 #define CDC_A_REVISION2                 (0xf101)
  79 #define CDC_A_REVISION3                 (0xf102)
  80 #define CDC_A_REVISION4                 (0xf103)
  81 #define CDC_A_PERPH_TYPE                (0xf104)
  82 #define CDC_A_PERPH_SUBTYPE             (0xf105)
  83 #define CDC_A_INT_RT_STS                (0xf110)
  84 #define CDC_A_INT_SET_TYPE              (0xf111)
  85 #define CDC_A_INT_POLARITY_HIGH         (0xf112)
  86 #define CDC_A_INT_POLARITY_LOW          (0xf113)
  87 #define CDC_A_INT_LATCHED_CLR           (0xf114)
  88 #define CDC_A_INT_EN_SET                (0xf115)
  89 #define CDC_A_INT_EN_CLR                (0xf116)
  90 #define CDC_A_INT_LATCHED_STS           (0xf118)
  91 #define CDC_A_INT_PENDING_STS           (0xf119)
  92 #define CDC_A_INT_MID_SEL               (0xf11A)
  93 #define CDC_A_INT_PRIORITY              (0xf11B)
  94 #define CDC_A_MICB_1_EN                 (0xf140)
  95 #define MICB_1_EN_MICB_ENABLE           BIT(7)
  96 #define MICB_1_EN_BYP_CAP_MASK          BIT(6)
  97 #define MICB_1_EN_NO_EXT_BYP_CAP        BIT(6)
  98 #define MICB_1_EN_EXT_BYP_CAP           0
  99 #define MICB_1_EN_PULL_DOWN_EN_MASK     BIT(5)
 100 #define MICB_1_EN_PULL_DOWN_EN_ENABLE   BIT(5)
 101 #define MICB_1_EN_OPA_STG2_TAIL_CURR_MASK GENMASK(3, 1)
 102 #define MICB_1_EN_OPA_STG2_TAIL_CURR_1_60UA     (0x4)
 103 #define MICB_1_EN_PULL_UP_EN_MASK       BIT(4)
 104 #define MICB_1_EN_TX3_GND_SEL_MASK      BIT(0)
 105 #define MICB_1_EN_TX3_GND_SEL_TX_GND    0
 106
 107 #define CDC_A_MICB_1_VAL                (0xf141)
 108 #define MICB_MIN_VAL 1600
 109 #define MICB_STEP_SIZE 50
 110 #define MICB_VOLTAGE_REGVAL(v)          (((v - MICB_MIN_VAL)/MICB_STEP_SIZE) << 3)
 111 #define MICB_1_VAL_MICB_OUT_VAL_MASK    GENMASK(7, 3)
 112 #define MICB_1_VAL_MICB_OUT_VAL_V2P70V  ((0x16)  << 3)
 113 #define MICB_1_VAL_MICB_OUT_VAL_V1P80V  ((0x4)  << 3)
 114 #define CDC_A_MICB_1_CTL                (0xf142)
 115
 116 #define MICB_1_CTL_CFILT_REF_SEL_MASK           BIT(1)
 117 #define MICB_1_CTL_CFILT_REF_SEL_HPF_REF        BIT(1)
 118 #define MICB_1_CTL_EXT_PRECHARG_EN_MASK         BIT(5)
 119 #define MICB_1_CTL_EXT_PRECHARG_EN_ENABLE       BIT(5)
 120 #define MICB_1_CTL_INT_PRECHARG_BYP_MASK        BIT(6)
 121 #define MICB_1_CTL_INT_PRECHARG_BYP_EXT_PRECHRG_SEL     BIT(6)
 122
 123 #define CDC_A_MICB_1_INT_RBIAS                  (0xf143)
 124 #define MICB_1_INT_TX1_INT_RBIAS_EN_MASK        BIT(7)
 125 #define MICB_1_INT_TX1_INT_RBIAS_EN_ENABLE      BIT(7)
 126 #define MICB_1_INT_TX1_INT_RBIAS_EN_DISABLE     0
 127
 128 #define MICB_1_INT_TX1_INT_PULLUP_EN_MASK       BIT(6)
 129 #define MICB_1_INT_TX1_INT_PULLUP_EN_TX1N_TO_MICBIAS BIT(6)
 130 #define MICB_1_INT_TX1_INT_PULLUP_EN_TX1N_TO_GND        0
 131
 132 #define MICB_1_INT_TX2_INT_RBIAS_EN_MASK        BIT(4)
 133 #define MICB_1_INT_TX2_INT_RBIAS_EN_ENABLE      BIT(4)
 134 #define MICB_1_INT_TX2_INT_RBIAS_EN_DISABLE     0
 135 #define MICB_1_INT_TX2_INT_PULLUP_EN_MASK       BIT(3)
 136 #define MICB_1_INT_TX2_INT_PULLUP_EN_TX1N_TO_MICBIAS BIT(3)
 137 #define MICB_1_INT_TX2_INT_PULLUP_EN_TX1N_TO_GND        0
 138
 139 #define MICB_1_INT_TX3_INT_RBIAS_EN_MASK        BIT(1)
 140 #define MICB_1_INT_TX3_INT_RBIAS_EN_ENABLE      BIT(1)
 141 #define MICB_1_INT_TX3_INT_RBIAS_EN_DISABLE     0
 142 #define MICB_1_INT_TX3_INT_PULLUP_EN_MASK       BIT(0)
 143 #define MICB_1_INT_TX3_INT_PULLUP_EN_TX1N_TO_MICBIAS BIT(0)
 144 #define MICB_1_INT_TX3_INT_PULLUP_EN_TX1N_TO_GND        0
 145
 146 #define CDC_A_MICB_2_EN                 (0xf144)
 147 #define CDC_A_MICB_2_EN_ENABLE          BIT(7)
 148 #define CDC_A_MICB_2_PULL_DOWN_EN_MASK  BIT(5)
 149 #define CDC_A_MICB_2_PULL_DOWN_EN       BIT(5)
 150 #define CDC_A_TX_1_2_ATEST_CTL_2        (0xf145)
 151 #define CDC_A_MASTER_BIAS_CTL           (0xf146)
 152 #define CDC_A_MBHC_DET_CTL_1            (0xf147)
 153 #define CDC_A_MBHC_DET_CTL_L_DET_EN                     BIT(7)
 154 #define CDC_A_MBHC_DET_CTL_GND_DET_EN                   BIT(6)
 155 #define CDC_A_MBHC_DET_CTL_MECH_DET_TYPE_INSERTION      BIT(5)
 156 #define CDC_A_MBHC_DET_CTL_MECH_DET_TYPE_REMOVAL        (0)
 157 #define CDC_A_MBHC_DET_CTL_MECH_DET_TYPE_MASK           BIT(5)
 158 #define CDC_A_MBHC_DET_CTL_MECH_DET_TYPE_SHIFT          (5)
 159 #define CDC_A_MBHC_DET_CTL_MIC_CLAMP_CTL_AUTO           BIT(4)
 160 #define CDC_A_MBHC_DET_CTL_MIC_CLAMP_CTL_MANUAL         BIT(3)
 161 #define CDC_A_MBHC_DET_CTL_MIC_CLAMP_CTL_MASK           GENMASK(4, 3)
 162 #define CDC_A_MBHC_DET_CTL_MBHC_BIAS_EN                 BIT(2)
 163 #define CDC_A_MBHC_DET_CTL_2            (0xf150)
 164 #define CDC_A_MBHC_DET_CTL_HS_L_DET_PULL_UP_CTRL_I_3P0  (BIT(7) | BIT(6))
 165 #define CDC_A_MBHC_DET_CTL_HS_L_DET_COMPA_CTRL_V0P9_VDD BIT(5)
 166 #define CDC_A_PLUG_TYPE_MASK                            GENMASK(4, 3)
 167 #define CDC_A_HPHL_PLUG_TYPE_NO                         BIT(4)
 168 #define CDC_A_GND_PLUG_TYPE_NO                          BIT(3)
 169 #define CDC_A_MBHC_DET_CTL_HPHL_100K_TO_GND_EN_MASK     BIT(0)
 170 #define CDC_A_MBHC_DET_CTL_HPHL_100K_TO_GND_EN          BIT(0)
 171 #define CDC_A_MBHC_FSM_CTL              (0xf151)
 172 #define CDC_A_MBHC_FSM_CTL_MBHC_FSM_EN                  BIT(7)
 173 #define CDC_A_MBHC_FSM_CTL_MBHC_FSM_EN_MASK             BIT(7)
 174 #define CDC_A_MBHC_FSM_CTL_BTN_ISRC_CTRL_I_100UA        (0x3 << 4)
 175 #define CDC_A_MBHC_FSM_CTL_BTN_ISRC_CTRL_MASK           GENMASK(6, 4)
 176 #define CDC_A_MBHC_DBNC_TIMER           (0xf152)
 177 #define CDC_A_MBHC_DBNC_TIMER_BTN_DBNC_T_16MS           BIT(3)
 178 #define CDC_A_MBHC_DBNC_TIMER_INSREM_DBNC_T_256_MS      (0x9 << 4)
 179 #define CDC_A_MBHC_BTN0_ZDET_CTL_0      (0xf153)
 180 #define CDC_A_MBHC_BTN1_ZDET_CTL_1      (0xf154)
 181 #define CDC_A_MBHC_BTN2_ZDET_CTL_2      (0xf155)
 182 #define CDC_A_MBHC_BTN3_CTL             (0xf156)
 183 #define CDC_A_MBHC_BTN4_CTL             (0xf157)
 184 #define CDC_A_MBHC_BTN_VREF_FINE_SHIFT  (2)
 185 #define CDC_A_MBHC_BTN_VREF_FINE_MASK   GENMASK(4, 2)
 186 #define CDC_A_MBHC_BTN_VREF_COARSE_MASK GENMASK(7, 5)
 187 #define CDC_A_MBHC_BTN_VREF_COARSE_SHIFT (5)
 188 #define CDC_A_MBHC_BTN_VREF_MASK        (CDC_A_MBHC_BTN_VREF_COARSE_MASK | \
 189                                         CDC_A_MBHC_BTN_VREF_FINE_MASK)
 190 #define CDC_A_MBHC_RESULT_1             (0xf158)
 191 #define CDC_A_MBHC_RESULT_1_BTN_RESULT_MASK     GENMASK(4, 0)
 192 #define CDC_A_TX_1_EN                   (0xf160)
 193 #define CDC_A_TX_2_EN                   (0xf161)
 194 #define CDC_A_TX_1_2_TEST_CTL_1         (0xf162)
 195 #define CDC_A_TX_1_2_TEST_CTL_2         (0xf163)
 196 #define CDC_A_TX_1_2_ATEST_CTL          (0xf164)
 197 #define CDC_A_TX_1_2_OPAMP_BIAS         (0xf165)
 198 #define CDC_A_TX_3_EN                   (0xf167)
 199 #define CDC_A_NCP_EN                    (0xf180)
 200 #define CDC_A_NCP_CLK                   (0xf181)
 201 #define CDC_A_NCP_FBCTRL                (0xf183)
 202 #define CDC_A_NCP_FBCTRL_FB_CLK_INV_MASK        BIT(5)
 203 #define CDC_A_NCP_FBCTRL_FB_CLK_INV             BIT(5)
 204 #define CDC_A_NCP_BIAS                  (0xf184)
 205 #define CDC_A_NCP_VCTRL                 (0xf185)
 206 #define CDC_A_NCP_TEST                  (0xf186)
 207 #define CDC_A_NCP_CLIM_ADDR             (0xf187)
 208 #define CDC_A_RX_CLOCK_DIVIDER          (0xf190)
 209 #define CDC_A_RX_COM_OCP_CTL            (0xf191)
 210 #define CDC_A_RX_COM_OCP_COUNT          (0xf192)
 211 #define CDC_A_RX_COM_BIAS_DAC           (0xf193)
 212 #define RX_COM_BIAS_DAC_RX_BIAS_EN_MASK         BIT(7)
 213 #define RX_COM_BIAS_DAC_RX_BIAS_EN_ENABLE       BIT(7)
 214 #define RX_COM_BIAS_DAC_DAC_REF_EN_MASK         BIT(0)
 215 #define RX_COM_BIAS_DAC_DAC_REF_EN_ENABLE       BIT(0)
 216
 217 #define CDC_A_RX_HPH_BIAS_PA            (0xf194)
 218 #define CDC_A_RX_HPH_BIAS_LDO_OCP       (0xf195)
 219 #define CDC_A_RX_HPH_BIAS_CNP           (0xf196)
 220 #define CDC_A_RX_HPH_CNP_EN             (0xf197)
 221 #define CDC_A_RX_HPH_L_PA_DAC_CTL       (0xf19B)
 222 #define RX_HPA_L_PA_DAC_CTL_DATA_RESET_MASK     BIT(1)
 223 #define RX_HPA_L_PA_DAC_CTL_DATA_RESET_RESET    BIT(1)
 224 #define CDC_A_RX_HPH_R_PA_DAC_CTL       (0xf19D)
 225 #define RX_HPH_R_PA_DAC_CTL_DATA_RESET  BIT(1)
 226 #define RX_HPH_R_PA_DAC_CTL_DATA_RESET_MASK BIT(1)
 227
 228 #define CDC_A_RX_EAR_CTL                        (0xf19E)
 229 #define RX_EAR_CTL_SPK_VBAT_LDO_EN_MASK         BIT(0)
 230 #define RX_EAR_CTL_SPK_VBAT_LDO_EN_ENABLE       BIT(0)
 231
 232 #define CDC_A_SPKR_DAC_CTL              (0xf1B0)
 233 #define SPKR_DAC_CTL_DAC_RESET_MASK     BIT(4)
 234 #define SPKR_DAC_CTL_DAC_RESET_NORMAL   0
 235
 236 #define CDC_A_SPKR_DRV_CTL              (0xf1B2)
 237 #define SPKR_DRV_CTL_DEF_MASK           0xEF
 238 #define SPKR_DRV_CLASSD_PA_EN_MASK      BIT(7)
 239 #define SPKR_DRV_CLASSD_PA_EN_ENABLE    BIT(7)
 240 #define SPKR_DRV_CAL_EN                 BIT(6)
 241 #define SPKR_DRV_SETTLE_EN              BIT(5)
 242 #define SPKR_DRV_FW_EN                  BIT(3)
 243 #define SPKR_DRV_BOOST_SET              BIT(2)
 244 #define SPKR_DRV_CMFB_SET               BIT(1)
 245 #define SPKR_DRV_GAIN_SET               BIT(0)
 246 #define SPKR_DRV_CTL_DEF_VAL (SPKR_DRV_CLASSD_PA_EN_ENABLE | \
 247                 SPKR_DRV_CAL_EN | SPKR_DRV_SETTLE_EN | \
 248                 SPKR_DRV_FW_EN | SPKR_DRV_BOOST_SET | \
 249                 SPKR_DRV_CMFB_SET | SPKR_DRV_GAIN_SET)
 250 #define CDC_A_SPKR_OCP_CTL              (0xf1B4)
 251 #define CDC_A_SPKR_PWRSTG_CTL           (0xf1B5)
 252 #define SPKR_PWRSTG_CTL_DAC_EN_MASK     BIT(0)
 253 #define SPKR_PWRSTG_CTL_DAC_EN          BIT(0)
 254 #define SPKR_PWRSTG_CTL_MASK            0xE0
 255 #define SPKR_PWRSTG_CTL_BBM_MASK        BIT(7)
 256 #define SPKR_PWRSTG_CTL_BBM_EN          BIT(7)
 257 #define SPKR_PWRSTG_CTL_HBRDGE_EN_MASK  BIT(6)
 258 #define SPKR_PWRSTG_CTL_HBRDGE_EN       BIT(6)
 259 #define SPKR_PWRSTG_CTL_CLAMP_EN_MASK   BIT(5)
 260 #define SPKR_PWRSTG_CTL_CLAMP_EN        BIT(5)
 261
 262 #define CDC_A_SPKR_DRV_DBG              (0xf1B7)
 263 #define CDC_A_CURRENT_LIMIT             (0xf1C0)
 264 #define CDC_A_BOOST_EN_CTL              (0xf1C3)
 265 #define CDC_A_SLOPE_COMP_IP_ZERO        (0xf1C4)
 266 #define CDC_A_SEC_ACCESS                (0xf1D0)
 267 #define CDC_A_PERPH_RESET_CTL3          (0xf1DA)
 268 #define CDC_A_PERPH_RESET_CTL4          (0xf1DB)
 269
 270 #define MSM8916_WCD_ANALOG_RATES (SNDRV_PCM_RATE_8000 | SNDRV_PCM_RATE_16000 |\
 271                         SNDRV_PCM_RATE_32000 | SNDRV_PCM_RATE_48000)
 272 #define MSM8916_WCD_ANALOG_FORMATS (SNDRV_PCM_FMTBIT_S16_LE |\
 273                                     SNDRV_PCM_FMTBIT_S32_LE)
 274
 275 static int btn_mask = SND_JACK_BTN_0 | SND_JACK_BTN_1 |
 276                SND_JACK_BTN_2 | SND_JACK_BTN_3 | SND_JACK_BTN_4;
 277 static int hs_jack_mask = SND_JACK_HEADPHONE | SND_JACK_HEADSET;
 278
 279 static const char * const supply_names[] = {
 280         "vdd-cdc-io",
 281         "vdd-cdc-tx-rx-cx",
 282 };
 283
 284 #define MBHC_MAX_BUTTONS        (5)
 285
 286 struct pm8916_wcd_analog_priv {
 287         u16 pmic_rev;
 288         u16 codec_version;
 289         bool    mbhc_btn_enabled;
 290         /* special event to detect accessory type */
 291         int     mbhc_btn0_released;
 292         bool    detect_accessory_type;
 293         struct clk *mclk;
 294         struct snd_soc_component *component;
 295         struct regulator_bulk_data supplies[ARRAY_SIZE(supply_names)];
 296         struct snd_soc_jack *jack;
 297         bool hphl_jack_type_normally_open;
 298         bool gnd_jack_type_normally_open;
 299         /* Voltage threshold when internal current source of 100uA is used */
 300         u32 vref_btn_cs[MBHC_MAX_BUTTONS];
 301         /* Voltage threshold when microphone bias is ON */
 302         u32 vref_btn_micb[MBHC_MAX_BUTTONS];
 303         unsigned int micbias1_cap_mode;
 304         unsigned int micbias2_cap_mode;
 305         unsigned int micbias_mv;
 306 };
 307
 308 static const char *const adc2_mux_text[] = { "ZERO", "INP2", "INP3" };
 309 static const char *const rdac2_mux_text[] = { "ZERO", "RX2", "RX1" };
 310 static const char *const hph_text[] = { "ZERO", "Switch", };
 311
 312 static const struct soc_enum hph_enum = SOC_ENUM_SINGLE_VIRT(
 313                                         ARRAY_SIZE(hph_text), hph_text);
 314
 315 static const struct snd_kcontrol_new hphl_mux = SOC_DAPM_ENUM("HPHL", hph_enum);
 316 static const struct snd_kcontrol_new hphr_mux = SOC_DAPM_ENUM("HPHR", hph_enum);
 317
 318 /* ADC2 MUX */
 319 static const struct soc_enum adc2_enum = SOC_ENUM_SINGLE_VIRT(
 320                         ARRAY_SIZE(adc2_mux_text), adc2_mux_text);
 321
 322 /* RDAC2 MUX */
 323 static const struct soc_enum rdac2_mux_enum = SOC_ENUM_SINGLE(
 324                         CDC_D_CDC_CONN_HPHR_DAC_CTL, 0, 3, rdac2_mux_text);
 325
 326 static const struct snd_kcontrol_new spkr_switch[] = {
 327         SOC_DAPM_SINGLE("Switch", CDC_A_SPKR_DAC_CTL, 7, 1, 0)
 328 };
 329
 330 static const struct snd_kcontrol_new rdac2_mux = SOC_DAPM_ENUM(
 331                                         "RDAC2 MUX Mux", rdac2_mux_enum);
 332 static const struct snd_kcontrol_new tx_adc2_mux = SOC_DAPM_ENUM(
 333                                         "ADC2 MUX Mux", adc2_enum);
 334
 335 /* Analog Gain control 0 dB to +24 dB in 6 dB steps */
 336 static const DECLARE_TLV_DB_SCALE(analog_gain, 0, 600, 0);
 337
 338 static const struct snd_kcontrol_new pm8916_wcd_analog_snd_controls[] = {
 339         SOC_SINGLE_TLV("ADC1 Volume", CDC_A_TX_1_EN, 3, 8, 0, analog_gain),
 340         SOC_SINGLE_TLV("ADC2 Volume", CDC_A_TX_2_EN, 3, 8, 0, analog_gain),
 341         SOC_SINGLE_TLV("ADC3 Volume", CDC_A_TX_3_EN, 3, 8, 0, analog_gain),
 342 };
 343
 344 static void pm8916_wcd_analog_micbias_enable(struct snd_soc_component *component)
 345 {
 346         struct pm8916_wcd_analog_priv *wcd = snd_soc_component_get_drvdata(component);
 347
 348         snd_soc_component_update_bits(component, CDC_A_MICB_1_CTL,
 349                             MICB_1_CTL_EXT_PRECHARG_EN_MASK |
 350                             MICB_1_CTL_INT_PRECHARG_BYP_MASK,
 351                             MICB_1_CTL_INT_PRECHARG_BYP_EXT_PRECHRG_SEL
 352                             | MICB_1_CTL_EXT_PRECHARG_EN_ENABLE);
 353
 354         if (wcd->micbias_mv) {
 355                 snd_soc_component_update_bits(component, CDC_A_MICB_1_VAL,
 356                                     MICB_1_VAL_MICB_OUT_VAL_MASK,
 357                                     MICB_VOLTAGE_REGVAL(wcd->micbias_mv));
 358                 /*
 359                  * Special headset needs MICBIAS as 2.7V so wait for
 360                  * 50 msec for the MICBIAS to reach 2.7 volts.
 361                  */
 362                 if (wcd->micbias_mv >= 2700)
 363                         msleep(50);
 364         }
 365
 366         snd_soc_component_update_bits(component, CDC_A_MICB_1_CTL,
 367                             MICB_1_CTL_EXT_PRECHARG_EN_MASK |
 368                             MICB_1_CTL_INT_PRECHARG_BYP_MASK, 0);
 369
 370 }
 371
 372 static int pm8916_wcd_analog_enable_micbias_ext(struct snd_soc_component
 373                                                  *component, int event,
 374                                                  int reg, unsigned int cap_mode)
 375 {
 376         switch (event) {
 377         case SND_SOC_DAPM_POST_PMU:
 378                 pm8916_wcd_analog_micbias_enable(component);
 379                 snd_soc_component_update_bits(component, CDC_A_MICB_1_EN,
 380                                     MICB_1_EN_BYP_CAP_MASK, cap_mode);
 381                 break;
 382         }
 383
 384         return 0;
 385 }
 386
 387 static int pm8916_wcd_analog_enable_micbias_int(struct snd_soc_component
 388                                                  *component, int event,
 389                                                  int reg, u32 cap_mode)
 390 {
 391
 392         switch (event) {
 393         case SND_SOC_DAPM_PRE_PMU:
 394                 snd_soc_component_update_bits(component, CDC_A_MICB_1_INT_RBIAS,
 395                                     MICB_1_INT_TX2_INT_RBIAS_EN_MASK,
 396                                     MICB_1_INT_TX2_INT_RBIAS_EN_ENABLE);
 397                 snd_soc_component_update_bits(component, reg, MICB_1_EN_PULL_DOWN_EN_MASK, 0);
 398                 snd_soc_component_update_bits(component, CDC_A_MICB_1_EN,
 399                                     MICB_1_EN_OPA_STG2_TAIL_CURR_MASK,
 400                                     MICB_1_EN_OPA_STG2_TAIL_CURR_1_60UA);
 401
 402                 break;
 403         case SND_SOC_DAPM_POST_PMU:
 404                 pm8916_wcd_analog_micbias_enable(component);
 405                 snd_soc_component_update_bits(component, CDC_A_MICB_1_EN,
 406                                     MICB_1_EN_BYP_CAP_MASK, cap_mode);
 407                 break;
 408         }
 409
 410         return 0;
 411 }
 412
 413 static int pm8916_wcd_analog_enable_micbias_ext1(struct
 414                                                   snd_soc_dapm_widget
 415                                                   *w, struct snd_kcontrol
 416                                                   *kcontrol, int event)
 417 {
 418         struct snd_soc_component *component = snd_soc_dapm_to_component(w->dapm);
 419         struct pm8916_wcd_analog_priv *wcd = snd_soc_component_get_drvdata(component);
 420
 421         return pm8916_wcd_analog_enable_micbias_ext(component, event, w->reg,
 422                                                      wcd->micbias1_cap_mode);
 423 }
 424
 425 static int pm8916_wcd_analog_enable_micbias_ext2(struct
 426                                                   snd_soc_dapm_widget
 427                                                   *w, struct snd_kcontrol
 428                                                   *kcontrol, int event)
 429 {
 430         struct snd_soc_component *component = snd_soc_dapm_to_component(w->dapm);
 431         struct pm8916_wcd_analog_priv *wcd = snd_soc_component_get_drvdata(component);
 432
 433         return pm8916_wcd_analog_enable_micbias_ext(component, event, w->reg,
 434                                                      wcd->micbias2_cap_mode);
 435
 436 }
 437
 438 static int pm8916_wcd_analog_enable_micbias_int1(struct
 439                                                   snd_soc_dapm_widget
 440                                                   *w, struct snd_kcontrol
 441                                                   *kcontrol, int event)
 442 {
 443         struct snd_soc_component *component = snd_soc_dapm_to_component(w->dapm);
 444         struct pm8916_wcd_analog_priv *wcd = snd_soc_component_get_drvdata(component);
 445
 446         return pm8916_wcd_analog_enable_micbias_int(component, event, w->reg,
 447                                                      wcd->micbias1_cap_mode);
 448 }
 449
 450 static int pm8916_mbhc_configure_bias(struct pm8916_wcd_analog_priv *priv,
 451                                       bool micbias2_enabled)
 452 {
 453         struct snd_soc_component *component = priv->component;
 454         u32 coarse, fine, reg_val, reg_addr;
 455         int *vrefs, i;
 456
 457         if (!micbias2_enabled) { /* use internal 100uA Current source */
 458                 /* Enable internal 2.2k Internal Rbias Resistor */
 459                 snd_soc_component_update_bits(component, CDC_A_MICB_1_INT_RBIAS,
 460                                     MICB_1_INT_TX2_INT_RBIAS_EN_MASK,
 461                                     MICB_1_INT_TX2_INT_RBIAS_EN_ENABLE);
 462                 /* Remove pull down on MIC BIAS2 */
 463                 snd_soc_component_update_bits(component, CDC_A_MICB_2_EN,
 464                                    CDC_A_MICB_2_PULL_DOWN_EN_MASK,
 465                                    0);
 466                 /* enable 100uA internal current source */
 467                 snd_soc_component_update_bits(component, CDC_A_MBHC_FSM_CTL,
 468                                     CDC_A_MBHC_FSM_CTL_BTN_ISRC_CTRL_MASK,
 469                                     CDC_A_MBHC_FSM_CTL_BTN_ISRC_CTRL_I_100UA);
 470         }
 471         snd_soc_component_update_bits(component, CDC_A_MBHC_FSM_CTL,
 472                         CDC_A_MBHC_FSM_CTL_MBHC_FSM_EN_MASK,
 473                         CDC_A_MBHC_FSM_CTL_MBHC_FSM_EN);
 474
 475         if (micbias2_enabled)
 476                 vrefs = &priv->vref_btn_micb[0];
 477         else
 478                 vrefs = &priv->vref_btn_cs[0];
 479
 480         /* program vref ranges for all the buttons */
 481         reg_addr = CDC_A_MBHC_BTN0_ZDET_CTL_0;
 482         for (i = 0; i <  MBHC_MAX_BUTTONS; i++) {
 483                 /* split mv in to coarse parts of 100mv & fine parts of 12mv */
 484                 coarse = (vrefs[i] / 100);
 485                 fine = ((vrefs[i] % 100) / 12);
 486                 reg_val = (coarse << CDC_A_MBHC_BTN_VREF_COARSE_SHIFT) |
 487                          (fine << CDC_A_MBHC_BTN_VREF_FINE_SHIFT);
 488                 snd_soc_component_update_bits(component, reg_addr,
 489                                CDC_A_MBHC_BTN_VREF_MASK,
 490                                reg_val);
 491                 reg_addr++;
 492         }
 493
 494         return 0;
 495 }
 496
 497 static void pm8916_wcd_setup_mbhc(struct pm8916_wcd_analog_priv *wcd)
 498 {
 499         struct snd_soc_component *component = wcd->component;
 500         bool micbias_enabled = false;
 501         u32 plug_type = 0;
 502         u32 int_en_mask;
 503
 504         snd_soc_component_write(component, CDC_A_MBHC_DET_CTL_1,
 505                       CDC_A_MBHC_DET_CTL_L_DET_EN |
 506                       CDC_A_MBHC_DET_CTL_MECH_DET_TYPE_INSERTION |
 507                       CDC_A_MBHC_DET_CTL_MIC_CLAMP_CTL_AUTO |
 508                       CDC_A_MBHC_DET_CTL_MBHC_BIAS_EN);
 509
 510         if (wcd->hphl_jack_type_normally_open)
 511                 plug_type |= CDC_A_HPHL_PLUG_TYPE_NO;
 512
 513         if (wcd->gnd_jack_type_normally_open)
 514                 plug_type |= CDC_A_GND_PLUG_TYPE_NO;
 515
 516         snd_soc_component_write(component, CDC_A_MBHC_DET_CTL_2,
 517                       CDC_A_MBHC_DET_CTL_HS_L_DET_PULL_UP_CTRL_I_3P0 |
 518                       CDC_A_MBHC_DET_CTL_HS_L_DET_COMPA_CTRL_V0P9_VDD |
 519                       plug_type |
 520                       CDC_A_MBHC_DET_CTL_HPHL_100K_TO_GND_EN);
 521
 522
 523         snd_soc_component_write(component, CDC_A_MBHC_DBNC_TIMER,
 524                       CDC_A_MBHC_DBNC_TIMER_INSREM_DBNC_T_256_MS |
 525                       CDC_A_MBHC_DBNC_TIMER_BTN_DBNC_T_16MS);
 526
 527         /* enable MBHC clock */
 528         snd_soc_component_update_bits(component, CDC_D_CDC_DIG_CLK_CTL,
 529                             DIG_CLK_CTL_D_MBHC_CLK_EN_MASK,
 530                             DIG_CLK_CTL_D_MBHC_CLK_EN);
 531
 532         if (snd_soc_component_read32(component, CDC_A_MICB_2_EN) & CDC_A_MICB_2_EN_ENABLE)
 533                 micbias_enabled = true;
 534
 535         pm8916_mbhc_configure_bias(wcd, micbias_enabled);
 536
 537         int_en_mask = MBHC_SWITCH_INT;
 538         if (wcd->mbhc_btn_enabled)
 539                 int_en_mask |= MBHC_BUTTON_PRESS_DET | MBHC_BUTTON_RELEASE_DET;
 540
 541         snd_soc_component_update_bits(component, CDC_D_INT_EN_CLR, int_en_mask, 0);
 542         snd_soc_component_update_bits(component, CDC_D_INT_EN_SET, int_en_mask, int_en_mask);
 543         wcd->mbhc_btn0_released = false;
 544         wcd->detect_accessory_type = true;
 545 }
 546
 547 static int pm8916_wcd_analog_enable_micbias_int2(struct
 548                                                   snd_soc_dapm_widget
 549                                                   *w, struct snd_kcontrol
 550                                                   *kcontrol, int event)
 551 {
 552         struct snd_soc_component *component = snd_soc_dapm_to_component(w->dapm);
 553         struct pm8916_wcd_analog_priv *wcd = snd_soc_component_get_drvdata(component);
 554
 555         switch (event) {
 556         case SND_SOC_DAPM_POST_PMU:
 557                 pm8916_mbhc_configure_bias(wcd, true);
 558                 break;
 559         case SND_SOC_DAPM_POST_PMD:
 560                 pm8916_mbhc_configure_bias(wcd, false);
 561                 break;
 562         }
 563
 564         return pm8916_wcd_analog_enable_micbias_int(component, event, w->reg,
 565                                                      wcd->micbias2_cap_mode);
 566 }
 567
 568 static int pm8916_wcd_analog_enable_adc(struct snd_soc_dapm_widget *w,
 569                                          struct snd_kcontrol *kcontrol,
 570                                          int event)
 571 {
 572         struct snd_soc_component *component = snd_soc_dapm_to_component(w->dapm);
 573         u16 adc_reg = CDC_A_TX_1_2_TEST_CTL_2;
 574         u8 init_bit_shift;
 575
 576         if (w->reg == CDC_A_TX_1_EN)
 577                 init_bit_shift = 5;
 578         else
 579                 init_bit_shift = 4;
 580
 581         switch (event) {
 582         case SND_SOC_DAPM_PRE_PMU:
 583                 if (w->reg == CDC_A_TX_2_EN)
 584                         snd_soc_component_update_bits(component, CDC_A_MICB_1_CTL,
 585                                             MICB_1_CTL_CFILT_REF_SEL_MASK,
 586                                             MICB_1_CTL_CFILT_REF_SEL_HPF_REF);
 587                 /*
 588                  * Add delay of 10 ms to give sufficient time for the voltage
 589                  * to shoot up and settle so that the txfe init does not
 590                  * happen when the input voltage is changing too much.
 591                  */
 592                 usleep_range(10000, 10010);
 593                 snd_soc_component_update_bits(component, adc_reg, 1 << init_bit_shift,
 594                                     1 << init_bit_shift);
 595                 switch (w->reg) {
 596                 case CDC_A_TX_1_EN:
 597                         snd_soc_component_update_bits(component, CDC_D_CDC_CONN_TX1_CTL,
 598                                             CONN_TX1_SERIAL_TX1_MUX,
 599                                             CONN_TX1_SERIAL_TX1_ADC_1);
 600                         break;
 601                 case CDC_A_TX_2_EN:
 602                 case CDC_A_TX_3_EN:
 603                         snd_soc_component_update_bits(component, CDC_D_CDC_CONN_TX2_CTL,
 604                                             CONN_TX2_SERIAL_TX2_MUX,
 605                                             CONN_TX2_SERIAL_TX2_ADC_2);
 606                         break;
 607                 }
 608                 break;
 609         case SND_SOC_DAPM_POST_PMU:
 610                 /*
 611                  * Add delay of 12 ms before deasserting the init
 612                  * to reduce the tx pop
 613                  */
 614                 usleep_range(12000, 12010);
 615                 snd_soc_component_update_bits(component, adc_reg, 1 << init_bit_shift, 0x00);
 616                 break;
 617         case SND_SOC_DAPM_POST_PMD:
 618                 switch (w->reg) {
 619                 case CDC_A_TX_1_EN:
 620                         snd_soc_component_update_bits(component, CDC_D_CDC_CONN_TX1_CTL,
 621                                             CONN_TX1_SERIAL_TX1_MUX,
 622                                             CONN_TX1_SERIAL_TX1_ZERO);
 623                         break;
 624                 case CDC_A_TX_2_EN:
 625                         snd_soc_component_update_bits(component, CDC_A_MICB_1_CTL,
 626                                             MICB_1_CTL_CFILT_REF_SEL_MASK, 0);
 627                         /* fall through */
 628                 case CDC_A_TX_3_EN:
 629                         snd_soc_component_update_bits(component, CDC_D_CDC_CONN_TX2_CTL,
 630                                             CONN_TX2_SERIAL_TX2_MUX,
 631                                             CONN_TX2_SERIAL_TX2_ZERO);
 632                         break;
 633                 }
 634
 635
 636                 break;
 637         }
 638         return 0;
 639 }
 640
 641 static int pm8916_wcd_analog_enable_spk_pa(struct snd_soc_dapm_widget *w,
 642                                             struct snd_kcontrol *kcontrol,
 643                                             int event)
 644 {
 645         struct snd_soc_component *component = snd_soc_dapm_to_component(w->dapm);
 646
 647         switch (event) {
 648         case SND_SOC_DAPM_PRE_PMU:
 649                 snd_soc_component_update_bits(component, CDC_A_SPKR_PWRSTG_CTL,
 650                                     SPKR_PWRSTG_CTL_DAC_EN_MASK |
 651                                     SPKR_PWRSTG_CTL_BBM_MASK |
 652                                     SPKR_PWRSTG_CTL_HBRDGE_EN_MASK |
 653                                     SPKR_PWRSTG_CTL_CLAMP_EN_MASK,
 654                                     SPKR_PWRSTG_CTL_DAC_EN|
 655                                     SPKR_PWRSTG_CTL_BBM_EN |
 656                                     SPKR_PWRSTG_CTL_HBRDGE_EN |
 657                                     SPKR_PWRSTG_CTL_CLAMP_EN);
 658
 659                 snd_soc_component_update_bits(component, CDC_A_RX_EAR_CTL,
 660                                     RX_EAR_CTL_SPK_VBAT_LDO_EN_MASK,
 661                                     RX_EAR_CTL_SPK_VBAT_LDO_EN_ENABLE);
 662                 break;
 663         case SND_SOC_DAPM_POST_PMU:
 664                 snd_soc_component_update_bits(component, CDC_A_SPKR_DRV_CTL,
 665                                     SPKR_DRV_CTL_DEF_MASK,
 666                                     SPKR_DRV_CTL_DEF_VAL);
 667                 snd_soc_component_update_bits(component, w->reg,
 668                                     SPKR_DRV_CLASSD_PA_EN_MASK,
 669                                     SPKR_DRV_CLASSD_PA_EN_ENABLE);
 670                 break;
 671         case SND_SOC_DAPM_POST_PMD:
 672                 snd_soc_component_update_bits(component, CDC_A_SPKR_PWRSTG_CTL,
 673                                     SPKR_PWRSTG_CTL_DAC_EN_MASK|
 674                                     SPKR_PWRSTG_CTL_BBM_MASK |
 675                                     SPKR_PWRSTG_CTL_HBRDGE_EN_MASK |
 676                                     SPKR_PWRSTG_CTL_CLAMP_EN_MASK, 0);
 677
 678                 snd_soc_component_update_bits(component, CDC_A_SPKR_DAC_CTL,
 679                                     SPKR_DAC_CTL_DAC_RESET_MASK,
 680                                     SPKR_DAC_CTL_DAC_RESET_NORMAL);
 681                 snd_soc_component_update_bits(component, CDC_A_RX_EAR_CTL,
 682                                     RX_EAR_CTL_SPK_VBAT_LDO_EN_MASK, 0);
 683                 break;
 684         }
 685         return 0;
 686 }
 687
 688 static const struct reg_default wcd_reg_defaults_2_0[] = {
 689         {CDC_A_RX_COM_OCP_CTL, 0xD1},
 690         {CDC_A_RX_COM_OCP_COUNT, 0xFF},
 691         {CDC_D_SEC_ACCESS, 0xA5},
 692         {CDC_D_PERPH_RESET_CTL3, 0x0F},
 693         {CDC_A_TX_1_2_OPAMP_BIAS, 0x4F},
 694         {CDC_A_NCP_FBCTRL, 0x28},
 695         {CDC_A_SPKR_DRV_CTL, 0x69},
 696         {CDC_A_SPKR_DRV_DBG, 0x01},
 697         {CDC_A_BOOST_EN_CTL, 0x5F},
 698         {CDC_A_SLOPE_COMP_IP_ZERO, 0x88},
 699         {CDC_A_SEC_ACCESS, 0xA5},
 700         {CDC_A_PERPH_RESET_CTL3, 0x0F},
 701         {CDC_A_CURRENT_LIMIT, 0x82},
 702         {CDC_A_SPKR_DAC_CTL, 0x03},
 703         {CDC_A_SPKR_OCP_CTL, 0xE1},
 704         {CDC_A_MASTER_BIAS_CTL, 0x30},
 705 };
 706
 707 static int pm8916_wcd_analog_probe(struct snd_soc_component *component)
 708 {
 709         struct pm8916_wcd_analog_priv *priv = dev_get_drvdata(component->dev);
 710         int err, reg;
 711
 712         err = regulator_bulk_enable(ARRAY_SIZE(priv->supplies), priv->supplies);
 713         if (err != 0) {
 714                 dev_err(component->dev, "failed to enable regulators (%d)\n", err);
 715                 return err;
 716         }
 717
 718         snd_soc_component_init_regmap(component,
 719                                   dev_get_regmap(component->dev->parent, NULL));
 720         snd_soc_component_set_drvdata(component, priv);
 721         priv->pmic_rev = snd_soc_component_read32(component, CDC_D_REVISION1);
 722         priv->codec_version = snd_soc_component_read32(component, CDC_D_PERPH_SUBTYPE);
 723
 724         dev_info(component->dev, "PMIC REV: %d\t CODEC Version: %d\n",
 725                  priv->pmic_rev, priv->codec_version);
 726
 727         snd_soc_component_write(component, CDC_D_PERPH_RESET_CTL4, 0x01);
 728         snd_soc_component_write(component, CDC_A_PERPH_RESET_CTL4, 0x01);
 729
 730         for (reg = 0; reg < ARRAY_SIZE(wcd_reg_defaults_2_0); reg++)
 731                 snd_soc_component_write(component, wcd_reg_defaults_2_0[reg].reg,
 732                               wcd_reg_defaults_2_0[reg].def);
 733
 734         priv->component = component;
 735
 736         snd_soc_component_update_bits(component, CDC_D_CDC_RST_CTL,
 737                             RST_CTL_DIG_SW_RST_N_MASK,
 738                             RST_CTL_DIG_SW_RST_N_REMOVE_RESET);
 739
 740         pm8916_wcd_setup_mbhc(priv);
 741
 742         return 0;
 743 }
 744
 745 static void pm8916_wcd_analog_remove(struct snd_soc_component *component)
 746 {
 747         struct pm8916_wcd_analog_priv *priv = dev_get_drvdata(component->dev);
 748
 749         snd_soc_component_update_bits(component, CDC_D_CDC_RST_CTL,
 750                             RST_CTL_DIG_SW_RST_N_MASK, 0);
 751
 752         regulator_bulk_disable(ARRAY_SIZE(priv->supplies),
 753                                       priv->supplies);
 754 }
 755
 756 static const struct snd_soc_dapm_route pm8916_wcd_analog_audio_map[] = {
 757
 758         {"PDM_RX1", NULL, "PDM Playback"},
 759         {"PDM_RX2", NULL, "PDM Playback"},
 760         {"PDM_RX3", NULL, "PDM Playback"},
 761         {"PDM Capture", NULL, "PDM_TX"},
 762
 763         /* ADC Connections */
 764         {"PDM_TX", NULL, "ADC2"},
 765         {"PDM_TX", NULL, "ADC3"},
 766         {"ADC2", NULL, "ADC2 MUX"},
 767         {"ADC3", NULL, "ADC2 MUX"},
 768         {"ADC2 MUX", "INP2", "ADC2_INP2"},
 769         {"ADC2 MUX", "INP3", "ADC2_INP3"},
 770
 771         {"PDM_TX", NULL, "ADC1"},
 772         {"ADC1", NULL, "AMIC1"},
 773         {"ADC2_INP2", NULL, "AMIC2"},
 774         {"ADC2_INP3", NULL, "AMIC3"},
 775
 776         /* RDAC Connections */
 777         {"HPHR DAC", NULL, "RDAC2 MUX"},
 778         {"RDAC2 MUX", "RX1", "PDM_RX1"},
 779         {"RDAC2 MUX", "RX2", "PDM_RX2"},
 780         {"HPHL DAC", NULL, "PDM_RX1"},
 781         {"PDM_RX1", NULL, "RXD1_CLK"},
 782         {"PDM_RX2", NULL, "RXD2_CLK"},
 783         {"PDM_RX3", NULL, "RXD3_CLK"},
 784
 785         {"PDM_RX1", NULL, "RXD_PDM_CLK"},
 786         {"PDM_RX2", NULL, "RXD_PDM_CLK"},
 787         {"PDM_RX3", NULL, "RXD_PDM_CLK"},
 788
 789         {"ADC1", NULL, "TXD_CLK"},
 790         {"ADC2", NULL, "TXD_CLK"},
 791         {"ADC3", NULL, "TXD_CLK"},
 792
 793         {"ADC1", NULL, "TXA_CLK25"},
 794         {"ADC2", NULL, "TXA_CLK25"},
 795         {"ADC3", NULL, "TXA_CLK25"},
 796
 797         {"PDM_RX1", NULL, "A_MCLK2"},
 798         {"PDM_RX2", NULL, "A_MCLK2"},
 799         {"PDM_RX3", NULL, "A_MCLK2"},
 800
 801         {"PDM_TX", NULL, "A_MCLK2"},
 802         {"A_MCLK2", NULL, "A_MCLK"},
 803
 804         /* Headset (RX MIX1 and RX MIX2) */
 805         {"HEADPHONE", NULL, "HPHL PA"},
 806         {"HEADPHONE", NULL, "HPHR PA"},
 807
 808         {"HPHL PA", NULL, "EAR_HPHL_CLK"},
 809         {"HPHR PA", NULL, "EAR_HPHR_CLK"},
 810
 811         {"CP", NULL, "NCP_CLK"},
 812
 813         {"HPHL PA", NULL, "HPHL"},
 814         {"HPHR PA", NULL, "HPHR"},
 815         {"HPHL PA", NULL, "CP"},
 816         {"HPHL PA", NULL, "RX_BIAS"},
 817         {"HPHR PA", NULL, "CP"},
 818         {"HPHR PA", NULL, "RX_BIAS"},
 819         {"HPHL", "Switch", "HPHL DAC"},
 820         {"HPHR", "Switch", "HPHR DAC"},
 821
 822         {"RX_BIAS", NULL, "DAC_REF"},
 823
 824         {"SPK_OUT", NULL, "SPK PA"},
 825         {"SPK PA", NULL, "RX_BIAS"},
 826         {"SPK PA", NULL, "SPKR_CLK"},
 827         {"SPK PA", NULL, "SPK DAC"},
 828         {"SPK DAC", "Switch", "PDM_RX3"},
 829
 830         {"MIC BIAS Internal1", NULL, "INT_LDO_H"},
 831         {"MIC BIAS Internal2", NULL, "INT_LDO_H"},
 832         {"MIC BIAS External1", NULL, "INT_LDO_H"},
 833         {"MIC BIAS External2", NULL, "INT_LDO_H"},
 834         {"MIC BIAS Internal1", NULL, "vdd-micbias"},
 835         {"MIC BIAS Internal2", NULL, "vdd-micbias"},
 836         {"MIC BIAS External1", NULL, "vdd-micbias"},
 837         {"MIC BIAS External2", NULL, "vdd-micbias"},
 838 };
 839
 840 static const struct snd_soc_dapm_widget pm8916_wcd_analog_dapm_widgets[] = {
 841
 842         SND_SOC_DAPM_AIF_IN("PDM_RX1", NULL, 0, SND_SOC_NOPM, 0, 0),
 843         SND_SOC_DAPM_AIF_IN("PDM_RX2", NULL, 0, SND_SOC_NOPM, 0, 0),
 844         SND_SOC_DAPM_AIF_IN("PDM_RX3", NULL, 0, SND_SOC_NOPM, 0, 0),
 845         SND_SOC_DAPM_AIF_OUT("PDM_TX", NULL, 0, SND_SOC_NOPM, 0, 0),
 846
 847         SND_SOC_DAPM_INPUT("AMIC1"),
 848         SND_SOC_DAPM_INPUT("AMIC3"),
 849         SND_SOC_DAPM_INPUT("AMIC2"),
 850         SND_SOC_DAPM_OUTPUT("HEADPHONE"),
 851
 852         /* RX stuff */
 853         SND_SOC_DAPM_SUPPLY("INT_LDO_H", SND_SOC_NOPM, 1, 0, NULL, 0),
 854
 855         SND_SOC_DAPM_PGA("HPHL PA", CDC_A_RX_HPH_CNP_EN, 5, 0, NULL, 0),
 856         SND_SOC_DAPM_MUX("HPHL", SND_SOC_NOPM, 0, 0, &hphl_mux),
 857         SND_SOC_DAPM_MIXER("HPHL DAC", CDC_A_RX_HPH_L_PA_DAC_CTL, 3, 0, NULL,
 858                            0),
 859         SND_SOC_DAPM_PGA("HPHR PA", CDC_A_RX_HPH_CNP_EN, 4, 0, NULL, 0),
 860         SND_SOC_DAPM_MUX("HPHR", SND_SOC_NOPM, 0, 0, &hphr_mux),
 861         SND_SOC_DAPM_MIXER("HPHR DAC", CDC_A_RX_HPH_R_PA_DAC_CTL, 3, 0, NULL,
 862                            0),
 863         SND_SOC_DAPM_MIXER("SPK DAC", SND_SOC_NOPM, 0, 0,
 864                            spkr_switch, ARRAY_SIZE(spkr_switch)),
 865
 866         /* Speaker */
 867         SND_SOC_DAPM_OUTPUT("SPK_OUT"),
 868         SND_SOC_DAPM_PGA_E("SPK PA", CDC_A_SPKR_DRV_CTL,
 869                            6, 0, NULL, 0,
 870                            pm8916_wcd_analog_enable_spk_pa,
 871                            SND_SOC_DAPM_PRE_PMU | SND_SOC_DAPM_POST_PMU |
 872                            SND_SOC_DAPM_PRE_PMD | SND_SOC_DAPM_POST_PMD),
 873         SND_SOC_DAPM_REGULATOR_SUPPLY("vdd-micbias", 0, 0),
 874         SND_SOC_DAPM_SUPPLY("CP", CDC_A_NCP_EN, 0, 0, NULL, 0),
 875
 876         SND_SOC_DAPM_SUPPLY("DAC_REF", CDC_A_RX_COM_BIAS_DAC, 0, 0, NULL, 0),
 877         SND_SOC_DAPM_SUPPLY("RX_BIAS", CDC_A_RX_COM_BIAS_DAC, 7, 0, NULL, 0),
 878
 879         /* TX */
 880         SND_SOC_DAPM_SUPPLY("MIC BIAS Internal1", CDC_A_MICB_1_EN, 7, 0,
 881                             pm8916_wcd_analog_enable_micbias_int1,
 882                             SND_SOC_DAPM_PRE_PMU | SND_SOC_DAPM_POST_PMU |
 883                             SND_SOC_DAPM_POST_PMD),
 884         SND_SOC_DAPM_SUPPLY("MIC BIAS Internal2", CDC_A_MICB_2_EN, 7, 0,
 885                             pm8916_wcd_analog_enable_micbias_int2,
 886                             SND_SOC_DAPM_PRE_PMU | SND_SOC_DAPM_POST_PMU |
 887                             SND_SOC_DAPM_POST_PMD),
 888
 889         SND_SOC_DAPM_SUPPLY("MIC BIAS External1", CDC_A_MICB_1_EN, 7, 0,
 890                             pm8916_wcd_analog_enable_micbias_ext1,
 891                             SND_SOC_DAPM_PRE_PMU | SND_SOC_DAPM_POST_PMD),
 892         SND_SOC_DAPM_SUPPLY("MIC BIAS External2", CDC_A_MICB_2_EN, 7, 0,
 893                             pm8916_wcd_analog_enable_micbias_ext2,
 894                             SND_SOC_DAPM_POST_PMU | SND_SOC_DAPM_POST_PMD),
 895
 896         SND_SOC_DAPM_ADC_E("ADC1", NULL, CDC_A_TX_1_EN, 7, 0,
 897                            pm8916_wcd_analog_enable_adc,
 898                            SND_SOC_DAPM_PRE_PMU | SND_SOC_DAPM_POST_PMU |
 899                            SND_SOC_DAPM_POST_PMD),
 900         SND_SOC_DAPM_ADC_E("ADC2_INP2", NULL, CDC_A_TX_2_EN, 7, 0,
 901                            pm8916_wcd_analog_enable_adc,
 902                            SND_SOC_DAPM_PRE_PMU | SND_SOC_DAPM_POST_PMU |
 903                            SND_SOC_DAPM_POST_PMD),
 904         SND_SOC_DAPM_ADC_E("ADC2_INP3", NULL, CDC_A_TX_3_EN, 7, 0,
 905                            pm8916_wcd_analog_enable_adc,
 906                            SND_SOC_DAPM_PRE_PMU | SND_SOC_DAPM_POST_PMU |
 907                            SND_SOC_DAPM_POST_PMD),
 908
 909         SND_SOC_DAPM_MIXER("ADC2", SND_SOC_NOPM, 0, 0, NULL, 0),
 910         SND_SOC_DAPM_MIXER("ADC3", SND_SOC_NOPM, 0, 0, NULL, 0),
 911
 912         SND_SOC_DAPM_MUX("ADC2 MUX", SND_SOC_NOPM, 0, 0, &tx_adc2_mux),
 913         SND_SOC_DAPM_MUX("RDAC2 MUX", SND_SOC_NOPM, 0, 0, &rdac2_mux),
 914
 915         /* Analog path clocks */
 916         SND_SOC_DAPM_SUPPLY("EAR_HPHR_CLK", CDC_D_CDC_ANA_CLK_CTL, 0, 0, NULL,
 917                             0),
 918         SND_SOC_DAPM_SUPPLY("EAR_HPHL_CLK", CDC_D_CDC_ANA_CLK_CTL, 1, 0, NULL,
 919                             0),
 920         SND_SOC_DAPM_SUPPLY("SPKR_CLK", CDC_D_CDC_ANA_CLK_CTL, 4, 0, NULL, 0),
 921         SND_SOC_DAPM_SUPPLY("TXA_CLK25", CDC_D_CDC_ANA_CLK_CTL, 5, 0, NULL, 0),
 922
 923         /* Digital path clocks */
 924
 925         SND_SOC_DAPM_SUPPLY("RXD1_CLK", CDC_D_CDC_DIG_CLK_CTL, 0, 0, NULL, 0),
 926         SND_SOC_DAPM_SUPPLY("RXD2_CLK", CDC_D_CDC_DIG_CLK_CTL, 1, 0, NULL, 0),
 927         SND_SOC_DAPM_SUPPLY("RXD3_CLK", CDC_D_CDC_DIG_CLK_CTL, 2, 0, NULL, 0),
 928
 929         SND_SOC_DAPM_SUPPLY("TXD_CLK", CDC_D_CDC_DIG_CLK_CTL, 4, 0, NULL, 0),
 930         SND_SOC_DAPM_SUPPLY("NCP_CLK", CDC_D_CDC_DIG_CLK_CTL, 6, 0, NULL, 0),
 931         SND_SOC_DAPM_SUPPLY("RXD_PDM_CLK", CDC_D_CDC_DIG_CLK_CTL, 7, 0, NULL,
 932                             0),
 933
 934         /* System Clock source */
 935         SND_SOC_DAPM_SUPPLY("A_MCLK", CDC_D_CDC_TOP_CLK_CTL, 2, 0, NULL, 0),
 936         /* TX ADC and RX DAC Clock source. */
 937         SND_SOC_DAPM_SUPPLY("A_MCLK2", CDC_D_CDC_TOP_CLK_CTL, 3, 0, NULL, 0),
 938 };
 939
 940 static int pm8916_wcd_analog_set_jack(struct snd_soc_component *component,
 941                                       struct snd_soc_jack *jack,
 942                                       void *data)
 943 {
 944         struct pm8916_wcd_analog_priv *wcd = snd_soc_component_get_drvdata(component);
 945
 946         wcd->jack = jack;
 947
 948         return 0;
 949 }
 950
 951 static irqreturn_t mbhc_btn_release_irq_handler(int irq, void *arg)
 952 {
 953         struct pm8916_wcd_analog_priv *priv = arg;
 954
 955         if (priv->detect_accessory_type) {
 956                 struct snd_soc_component *component = priv->component;
 957                 u32 val = snd_soc_component_read32(component, CDC_A_MBHC_RESULT_1);
 958
 959                 /* check if its BTN0 thats released */
 960                 if ((val != -1) && !(val & CDC_A_MBHC_RESULT_1_BTN_RESULT_MASK))
 961                         priv->mbhc_btn0_released = true;
 962
 963         } else {
 964                 snd_soc_jack_report(priv->jack, 0, btn_mask);
 965         }
 966
 967         return IRQ_HANDLED;
 968 }
 969
 970 static irqreturn_t mbhc_btn_press_irq_handler(int irq, void *arg)
 971 {
 972         struct pm8916_wcd_analog_priv *priv = arg;
 973         struct snd_soc_component *component = priv->component;
 974         u32 btn_result;
 975
 976         btn_result = snd_soc_component_read32(component, CDC_A_MBHC_RESULT_1) &
 977                                   CDC_A_MBHC_RESULT_1_BTN_RESULT_MASK;
 978
 979         switch (btn_result) {
 980         case 0xf:
 981                 snd_soc_jack_report(priv->jack, SND_JACK_BTN_4, btn_mask);
 982                 break;
 983         case 0x7:
 984                 snd_soc_jack_report(priv->jack, SND_JACK_BTN_3, btn_mask);
 985                 break;
 986         case 0x3:
 987                 snd_soc_jack_report(priv->jack, SND_JACK_BTN_2, btn_mask);
 988                 break;
 989         case 0x1:
 990                 snd_soc_jack_report(priv->jack, SND_JACK_BTN_1, btn_mask);
 991                 break;
 992         case 0x0:
 993                 /* handle BTN_0 specially for type detection */
 994                 if (!priv->detect_accessory_type)
 995                         snd_soc_jack_report(priv->jack,
 996                                             SND_JACK_BTN_0, btn_mask);
 997                 break;
 998         default:
 999                 dev_err(component->dev,
1000                         "Unexpected button press result (%x)", btn_result);
1001                 break;
1002         }
1003
1004         return IRQ_HANDLED;
1005 }
1006
1007 static irqreturn_t pm8916_mbhc_switch_irq_handler(int irq, void *arg)
1008 {
1009         struct pm8916_wcd_analog_priv *priv = arg;
1010         struct snd_soc_component *component = priv->component;
1011         bool ins = false;
1012
1013         if (snd_soc_component_read32(component, CDC_A_MBHC_DET_CTL_1) &
1014                                 CDC_A_MBHC_DET_CTL_MECH_DET_TYPE_MASK)
1015                 ins = true;
1016
1017         /* Set the detection type appropriately */
1018         snd_soc_component_update_bits(component, CDC_A_MBHC_DET_CTL_1,
1019                             CDC_A_MBHC_DET_CTL_MECH_DET_TYPE_MASK,
1020                             (!ins << CDC_A_MBHC_DET_CTL_MECH_DET_TYPE_SHIFT));
1021
1022
1023         if (ins) { /* hs insertion */
1024                 bool micbias_enabled = false;
1025
1026                 if (snd_soc_component_read32(component, CDC_A_MICB_2_EN) &
1027                                 CDC_A_MICB_2_EN_ENABLE)
1028                         micbias_enabled = true;
1029
1030                 pm8916_mbhc_configure_bias(priv, micbias_enabled);
1031
1032                 /*
1033                  * if only a btn0 press event is receive just before
1034                  * insert event then its a 3 pole headphone else if
1035                  * both press and release event received then its
1036                  * a headset.
1037                  */
1038                 if (priv->mbhc_btn0_released)
1039                         snd_soc_jack_report(priv->jack,
1040                                             SND_JACK_HEADSET, hs_jack_mask);
1041                 else
1042                         snd_soc_jack_report(priv->jack,
1043                                             SND_JACK_HEADPHONE, hs_jack_mask);
1044
1045                 priv->detect_accessory_type = false;
1046
1047         } else { /* removal */
1048                 snd_soc_jack_report(priv->jack, 0, hs_jack_mask);
1049                 priv->detect_accessory_type = true;
1050                 priv->mbhc_btn0_released = false;
1051         }
1052
1053         return IRQ_HANDLED;
1054 }
1055
1056 static struct snd_soc_dai_driver pm8916_wcd_analog_dai[] = {
1057         [0] = {
1058                .name = "pm8916_wcd_analog_pdm_rx",
1059                .id = 0,
1060                .playback = {
1061                             .stream_name = "PDM Playback",
1062                             .rates = MSM8916_WCD_ANALOG_RATES,
1063                             .formats = MSM8916_WCD_ANALOG_FORMATS,
1064                             .channels_min = 1,
1065                             .channels_max = 3,
1066                             },
1067                },
1068         [1] = {
1069                .name = "pm8916_wcd_analog_pdm_tx",
1070                .id = 1,
1071                .capture = {
1072                            .stream_name = "PDM Capture",
1073                            .rates = MSM8916_WCD_ANALOG_RATES,
1074                            .formats = MSM8916_WCD_ANALOG_FORMATS,
1075                            .channels_min = 1,
1076                            .channels_max = 4,
1077                            },
1078                },
1079 };
1080
1081 static const struct snd_soc_component_driver pm8916_wcd_analog = {
1082         .probe                  = pm8916_wcd_analog_probe,
1083         .remove                 = pm8916_wcd_analog_remove,
1084         .set_jack               = pm8916_wcd_analog_set_jack,
1085         .controls               = pm8916_wcd_analog_snd_controls,
1086         .num_controls           = ARRAY_SIZE(pm8916_wcd_analog_snd_controls),
1087         .dapm_widgets           = pm8916_wcd_analog_dapm_widgets,
1088         .num_dapm_widgets       = ARRAY_SIZE(pm8916_wcd_analog_dapm_widgets),
1089         .dapm_routes            = pm8916_wcd_analog_audio_map,
1090         .num_dapm_routes        = ARRAY_SIZE(pm8916_wcd_analog_audio_map),
1091         .idle_bias_on           = 1,
1092         .use_pmdown_time        = 1,
1093         .endianness             = 1,
1094         .non_legacy_dai_naming  = 1,
1095 };
1096
1097 static int pm8916_wcd_analog_parse_dt(struct device *dev,
1098                                        struct pm8916_wcd_analog_priv *priv)
1099 {
1100         int rval;
1101
1102         if (of_property_read_bool(dev->of_node, "qcom,micbias1-ext-cap"))
1103                 priv->micbias1_cap_mode = MICB_1_EN_EXT_BYP_CAP;
1104         else
1105                 priv->micbias1_cap_mode = MICB_1_EN_NO_EXT_BYP_CAP;
1106
1107         if (of_property_read_bool(dev->of_node, "qcom,micbias2-ext-cap"))
1108                 priv->micbias2_cap_mode = MICB_1_EN_EXT_BYP_CAP;
1109         else
1110                 priv->micbias2_cap_mode = MICB_1_EN_NO_EXT_BYP_CAP;
1111
1112         of_property_read_u32(dev->of_node, "qcom,micbias-lvl",
1113                              &priv->micbias_mv);
1114
1115         if (of_property_read_bool(dev->of_node,
1116                                   "qcom,hphl-jack-type-normally-open"))
1117                 priv->hphl_jack_type_normally_open = true;
1118         else
1119                 priv->hphl_jack_type_normally_open = false;
1120
1121         if (of_property_read_bool(dev->of_node,
1122                                   "qcom,gnd-jack-type-normally-open"))
1123                 priv->gnd_jack_type_normally_open = true;
1124         else
1125                 priv->gnd_jack_type_normally_open = false;
1126
1127         priv->mbhc_btn_enabled = true;
1128         rval = of_property_read_u32_array(dev->of_node,
1129                                           "qcom,mbhc-vthreshold-low",
1130                                           &priv->vref_btn_cs[0],
1131                                           MBHC_MAX_BUTTONS);
1132         if (rval < 0) {
1133                 priv->mbhc_btn_enabled = false;
1134         } else {
1135                 rval = of_property_read_u32_array(dev->of_node,
1136                                                   "qcom,mbhc-vthreshold-high",
1137                                                   &priv->vref_btn_micb[0],
1138                                                   MBHC_MAX_BUTTONS);
1139                 if (rval < 0)
1140                         priv->mbhc_btn_enabled = false;
1141         }
1142
1143         if (!priv->mbhc_btn_enabled)
1144                 dev_err(dev,
1145                         "DT property missing, MBHC btn detection disabled\n");
1146
1147
1148         return 0;
1149 }
1150
1151 static int pm8916_wcd_analog_spmi_probe(struct platform_device *pdev)
1152 {
1153         struct pm8916_wcd_analog_priv *priv;
1154         struct device *dev = &pdev->dev;
1155         int ret, i, irq;
1156
1157         priv = devm_kzalloc(dev, sizeof(*priv), GFP_KERNEL);
1158         if (!priv)
1159                 return -ENOMEM;
1160
1161         ret = pm8916_wcd_analog_parse_dt(dev, priv);
1162         if (ret < 0)
1163                 return ret;
1164
1165         priv->mclk = devm_clk_get(dev, "mclk");
1166         if (IS_ERR(priv->mclk)) {
1167                 dev_err(dev, "failed to get mclk\n");
1168                 return PTR_ERR(priv->mclk);
1169         }
1170
1171         for (i = 0; i < ARRAY_SIZE(supply_names); i++)
1172                 priv->supplies[i].supply = supply_names[i];
1173
1174         ret = devm_regulator_bulk_get(dev, ARRAY_SIZE(priv->supplies),
1175                                     priv->supplies);
1176         if (ret) {
1177                 dev_err(dev, "Failed to get regulator supplies %d\n", ret);
1178                 return ret;
1179         }
1180
1181         ret = clk_prepare_enable(priv->mclk);
1182         if (ret < 0) {
1183                 dev_err(dev, "failed to enable mclk %d\n", ret);
1184                 return ret;
1185         }
1186
1187         irq = platform_get_irq_byname(pdev, "mbhc_switch_int");
1188         if (irq < 0) {
1189                 dev_err(dev, "failed to get mbhc switch irq\n");
1190                 return irq;
1191         }
1192
1193         ret = devm_request_threaded_irq(dev, irq, NULL,
1194                                pm8916_mbhc_switch_irq_handler,
1195                                IRQF_TRIGGER_RISING | IRQF_TRIGGER_FALLING |
1196                                IRQF_ONESHOT,
1197                                "mbhc switch irq", priv);
1198         if (ret)
1199                 dev_err(dev, "cannot request mbhc switch irq\n");
1200
1201         if (priv->mbhc_btn_enabled) {
1202                 irq = platform_get_irq_byname(pdev, "mbhc_but_press_det");
1203                 if (irq < 0) {
1204                         dev_err(dev, "failed to get button press irq\n");
1205                         return irq;
1206                 }
1207
1208                 ret = devm_request_threaded_irq(dev, irq, NULL,
1209                                        mbhc_btn_press_irq_handler,
1210                                        IRQF_TRIGGER_RISING |
1211                                        IRQF_TRIGGER_FALLING | IRQF_ONESHOT,
1212                                        "mbhc btn press irq", priv);
1213                 if (ret)
1214                         dev_err(dev, "cannot request mbhc button press irq\n");
1215
1216                 irq = platform_get_irq_byname(pdev, "mbhc_but_rel_det");
1217                 if (irq < 0) {
1218                         dev_err(dev, "failed to get button release irq\n");
1219                         return irq;
1220                 }
1221
1222                 ret = devm_request_threaded_irq(dev, irq, NULL,
1223                                        mbhc_btn_release_irq_handler,
1224                                        IRQF_TRIGGER_RISING |
1225                                        IRQF_TRIGGER_FALLING | IRQF_ONESHOT,
1226                                        "mbhc btn release irq", priv);
1227                 if (ret)
1228                         dev_err(dev, "cannot request mbhc button release irq\n");
1229
1230         }
1231
1232         dev_set_drvdata(dev, priv);
1233
1234         return devm_snd_soc_register_component(dev, &pm8916_wcd_analog,
1235                                       pm8916_wcd_analog_dai,
1236                                       ARRAY_SIZE(pm8916_wcd_analog_dai));
1237 }
1238
1239 static int pm8916_wcd_analog_spmi_remove(struct platform_device *pdev)
1240 {
1241         struct pm8916_wcd_analog_priv *priv = dev_get_drvdata(&pdev->dev);
1242
1243         clk_disable_unprepare(priv->mclk);
1244
1245         return 0;
1246 }
1247
1248 static const struct of_device_id pm8916_wcd_analog_spmi_match_table[] = {
1249         { .compatible = "qcom,pm8916-wcd-analog-codec", },
1250         { }
1251 };
1252
1253 MODULE_DEVICE_TABLE(of, pm8916_wcd_analog_spmi_match_table);
1254
1255 static struct platform_driver pm8916_wcd_analog_spmi_driver = {
1256         .driver = {
1257                    .name = "qcom,pm8916-wcd-spmi-codec",
1258                    .of_match_table = pm8916_wcd_analog_spmi_match_table,
1259         },
1260         .probe = pm8916_wcd_analog_spmi_probe,
1261         .remove = pm8916_wcd_analog_spmi_remove,
1262 };
1263
1264 module_platform_driver(pm8916_wcd_analog_spmi_driver);
1265
1266 MODULE_AUTHOR("Srinivas Kandagatla <srinivas.kandagatla@linaro.org>");
1267 MODULE_DESCRIPTION("PMIC PM8916 WCD Analog Codec driver");
1268 MODULE_LICENSE("GPL v2");