board/renesas/alt/alt.c

   1 /*
   2  * board/renesas/alt/alt.c
   3  *
   4  * Copyright (C) 2014 Renesas Electronics Corporation
   5  *
   6  * SPDX-License-Identifier: GPL-2.0
   7  */
   8
   9 #include <common.h>
  10 #include <malloc.h>
  11 #include <asm/processor.h>
  12 #include <asm/mach-types.h>
  13 #include <asm/io.h>
  14 #include <asm/errno.h>
  15 #include <asm/arch/sys_proto.h>
  16 #include <asm/gpio.h>
  17 #include <asm/arch/rmobile.h>
  18 #include <asm/arch/rcar-mstp.h>
  19 #include <netdev.h>
  20 #include <miiphy.h>
  21 #include <i2c.h>
  22 #include <div64.h>
  23 #include "qos.h"
  24
  25 DECLARE_GLOBAL_DATA_PTR;
  26
  27 #define CLK2MHZ(clk)    (clk / 1000 / 1000)
  28 void s_init(void)
  29 {
  30         struct rcar_rwdt *rwdt = (struct rcar_rwdt *)RWDT_BASE;
  31         struct rcar_swdt *swdt = (struct rcar_swdt *)SWDT_BASE;
  32
  33         /* Watchdog init */
  34         writel(0xA5A5A500, &rwdt->rwtcsra);
  35         writel(0xA5A5A500, &swdt->swtcsra);
  36
  37         /* QoS */
  38         qos_init();
  39 }
  40
  41 #define TMU0_MSTP125    (1 << 25)
  42 #define SCIF2_MSTP719   (1 << 19)
  43 #define ETHER_MSTP813   (1 << 13)
  44 #define IIC1_MSTP323    (1 << 23)
  45
  46 int board_early_init_f(void)
  47 {
  48         /* TMU */
  49         mstp_clrbits_le32(MSTPSR1, SMSTPCR1, TMU0_MSTP125);
  50
  51         /* SCIF2 */
  52         mstp_clrbits_le32(MSTPSR7, SMSTPCR7, SCIF2_MSTP719);
  53
  54         /* ETHER */
  55         mstp_clrbits_le32(MSTPSR8, SMSTPCR8, ETHER_MSTP813);
  56
  57         /* IIC1 / sh-i2c ch1 */
  58         mstp_clrbits_le32(MSTPSR3, SMSTPCR3, IIC1_MSTP323);
  59
  60         return 0;
  61 }
  62
  63 void arch_preboot_os(void)
  64 {
  65         /* Disable TMU0 */
  66         mstp_setbits_le32(MSTPSR1, SMSTPCR1, TMU0_MSTP125);
  67 }
  68
  69 int board_init(void)
  70 {
  71         /* adress of boot parameters */
  72         gd->bd->bi_boot_params = CONFIG_SYS_SDRAM_BASE + 0x100;
  73
  74         /* Init PFC controller */
  75         r8a7794_pinmux_init();
  76
  77         /* Ether Enable */
  78         gpio_request(GPIO_FN_ETH_CRS_DV, NULL);
  79         gpio_request(GPIO_FN_ETH_RX_ER, NULL);
  80         gpio_request(GPIO_FN_ETH_RXD0, NULL);
  81         gpio_request(GPIO_FN_ETH_RXD1, NULL);
  82         gpio_request(GPIO_FN_ETH_LINK, NULL);
  83         gpio_request(GPIO_FN_ETH_REFCLK, NULL);
  84         gpio_request(GPIO_FN_ETH_MDIO, NULL);
  85         gpio_request(GPIO_FN_ETH_TXD1, NULL);
  86         gpio_request(GPIO_FN_ETH_TX_EN, NULL);
  87         gpio_request(GPIO_FN_ETH_MAGIC, NULL);
  88         gpio_request(GPIO_FN_ETH_TXD0, NULL);
  89         gpio_request(GPIO_FN_ETH_MDC, NULL);
  90         gpio_request(GPIO_FN_IRQ8, NULL);
  91
  92         /* PHY reset */
  93         gpio_request(GPIO_GP_1_24, NULL);
  94         gpio_direction_output(GPIO_GP_1_24, 0);
  95         mdelay(20);
  96         gpio_set_value(GPIO_GP_1_24, 1);
  97         udelay(1);
  98
  99         return 0;
 100 }
 101
 102 #define CXR24 0xEE7003C0 /* MAC address high register */
 103 #define CXR25 0xEE7003C8 /* MAC address low register */
 104 int board_eth_init(bd_t *bis)
 105 {
 106 #ifdef CONFIG_SH_ETHER
 107         int ret = -ENODEV;
 108         u32 val;
 109         unsigned char enetaddr[6];
 110
 111         ret = sh_eth_initialize(bis);
 112         if (!eth_getenv_enetaddr("ethaddr", enetaddr))
 113                 return ret;
 114
 115         /* Set Mac address */
 116         val = enetaddr[0] << 24 | enetaddr[1] << 16 |
 117                 enetaddr[2] << 8 | enetaddr[3];
 118         writel(val, CXR24);
 119
 120         val = enetaddr[4] << 8 | enetaddr[5];
 121         writel(val, CXR25);
 122
 123         return ret;
 124 #else
 125         return 0;
 126 #endif
 127 }
 128
 129 int dram_init(void)
 130 {
 131         gd->ram_size = CONFIG_SYS_SDRAM_SIZE;
 132
 133         return 0;
 134 }
 135
 136 const struct rmobile_sysinfo sysinfo = {
 137         CONFIG_RMOBILE_BOARD_STRING
 138 };
 139
 140 void reset_cpu(ulong addr)
 141 {
 142         u8 val;
 143
 144         i2c_set_bus_num(1); /* PowerIC connected to ch1 */
 145         i2c_read(CONFIG_SYS_I2C_POWERIC_ADDR, 0x13, 1, &val, 1);
 146         val |= 0x02;
 147         i2c_write(CONFIG_SYS_I2C_POWERIC_ADDR, 0x13, 1, &val, 1);
 148 }