2 * arch/arm/include/asm/arch-rmobile/rcar-base.h
4 * Copyright (C) 2013,2014 Renesas Electronics Corporation
6 * SPDX-License-Identifier: GPL-2.0
9 #ifndef __ASM_ARCH_RCAR_BASE_H
10 #define __ASM_ARCH_RCAR_BASE_H
13 * R-Car (R8A7790/R8A7791/R8A7793/R8A7794) I/O Addresses
15 #define RWDT_BASE 0xE6020000
16 #define SWDT_BASE 0xE6030000
17 #define LBSC_BASE 0xFEC00200
18 #define DBSC3_0_BASE 0xE6790000
19 #define DBSC3_1_BASE 0xE67A0000
20 #define TMU_BASE 0xE61E0000
21 #define GPIO5_BASE 0xE6055000
22 #define SH_QSPI_BASE 0xE6B10000
25 #define SCIF0_BASE 0xE6E60000
26 #define SCIF1_BASE 0xE6E68000
27 #define SCIF2_BASE 0xE6E58000
28 #define SCIF3_BASE 0xE6EA8000
29 #define SCIF4_BASE 0xE6EE0000
30 #define SCIF5_BASE 0xE6EE8000
34 * Ch2 and ch3 are different address. These are defined
35 * in the header of each SoCs.
37 #define CONFIG_SYS_I2C_SH_BASE0 0xE6500000
38 #define CONFIG_SYS_I2C_SH_BASE1 0xE6510000
41 #define CONFIG_SYS_RCAR_I2C0_BASE 0xE6508000
42 #define CONFIG_SYS_RCAR_I2C1_BASE 0xE6518000
43 #define CONFIG_SYS_RCAR_I2C2_BASE 0xE6530000
44 #define CONFIG_SYS_RCAR_I2C3_BASE 0xE6540000
46 #define S3C_BASE 0xE6784000
47 #define S3C_INT_BASE 0xE6784A00
48 #define S3C_MEDIA_BASE 0xE6784B00
50 #define S3C_QOS_DCACHE_BASE 0xE6784BDC
51 #define S3C_QOS_CCI0_BASE 0xE6784C00
52 #define S3C_QOS_CCI1_BASE 0xE6784C24
53 #define S3C_QOS_MXI_BASE 0xE6784C48
54 #define S3C_QOS_AXI_BASE 0xE6784C6C
56 #define DBSC3_0_QOS_R0_BASE 0xE6791000
57 #define DBSC3_0_QOS_R1_BASE 0xE6791100
58 #define DBSC3_0_QOS_R2_BASE 0xE6791200
59 #define DBSC3_0_QOS_R3_BASE 0xE6791300
60 #define DBSC3_0_QOS_R4_BASE 0xE6791400
61 #define DBSC3_0_QOS_R5_BASE 0xE6791500
62 #define DBSC3_0_QOS_R6_BASE 0xE6791600
63 #define DBSC3_0_QOS_R7_BASE 0xE6791700
64 #define DBSC3_0_QOS_R8_BASE 0xE6791800
65 #define DBSC3_0_QOS_R9_BASE 0xE6791900
66 #define DBSC3_0_QOS_R10_BASE 0xE6791A00
67 #define DBSC3_0_QOS_R11_BASE 0xE6791B00
68 #define DBSC3_0_QOS_R12_BASE 0xE6791C00
69 #define DBSC3_0_QOS_R13_BASE 0xE6791D00
70 #define DBSC3_0_QOS_R14_BASE 0xE6791E00
71 #define DBSC3_0_QOS_R15_BASE 0xE6791F00
72 #define DBSC3_0_QOS_W0_BASE 0xE6792000
73 #define DBSC3_0_QOS_W1_BASE 0xE6792100
74 #define DBSC3_0_QOS_W2_BASE 0xE6792200
75 #define DBSC3_0_QOS_W3_BASE 0xE6792300
76 #define DBSC3_0_QOS_W4_BASE 0xE6792400
77 #define DBSC3_0_QOS_W5_BASE 0xE6792500
78 #define DBSC3_0_QOS_W6_BASE 0xE6792600
79 #define DBSC3_0_QOS_W7_BASE 0xE6792700
80 #define DBSC3_0_QOS_W8_BASE 0xE6792800
81 #define DBSC3_0_QOS_W9_BASE 0xE6792900
82 #define DBSC3_0_QOS_W10_BASE 0xE6792A00
83 #define DBSC3_0_QOS_W11_BASE 0xE6792B00
84 #define DBSC3_0_QOS_W12_BASE 0xE6792C00
85 #define DBSC3_0_QOS_W13_BASE 0xE6792D00
86 #define DBSC3_0_QOS_W14_BASE 0xE6792E00
87 #define DBSC3_0_QOS_W15_BASE 0xE6792F00
88 #define DBSC3_0_DBADJ2 0xE67900C8
90 #define CCI_400_MAXOT_1 0xF0091110
91 #define CCI_400_MAXOT_2 0xF0092110
92 #define CCI_400_QOSCNTL_1 0xF009110C
93 #define CCI_400_QOSCNTL_2 0xF009210C
95 #define MXI_BASE 0xFE960000
96 #define MXI_QOS_BASE 0xFE960300
98 #define SYS_AXI_SYX64TO128_BASE 0xFF800300
99 #define SYS_AXI_AVB_BASE 0xFF800340
100 #define SYS_AXI_G2D_BASE 0xFF800540
101 #define SYS_AXI_IMP0_BASE 0xFF800580
102 #define SYS_AXI_IMP1_BASE 0xFF8005C0
103 #define SYS_AXI_IMUX0_BASE 0xFF800600
104 #define SYS_AXI_IMUX1_BASE 0xFF800640
105 #define SYS_AXI_IMUX2_BASE 0xFF800680
106 #define SYS_AXI_LBS_BASE 0xFF8006C0
107 #define SYS_AXI_MMUDS_BASE 0xFF800700
108 #define SYS_AXI_MMUM_BASE 0xFF800740
109 #define SYS_AXI_MMUR_BASE 0xFF800780
110 #define SYS_AXI_MMUS0_BASE 0xFF8007C0
111 #define SYS_AXI_MMUS1_BASE 0xFF800800
112 #define SYS_AXI_MTSB0_BASE 0xFF800880
113 #define SYS_AXI_MTSB1_BASE 0xFF8008C0
114 #define SYS_AXI_PCI_BASE 0xFF800900
115 #define SYS_AXI_RTX_BASE 0xFF800940
116 #define SYS_AXI_SDS0_BASE 0xFF800A80
117 #define SYS_AXI_SDS1_BASE 0xFF800AC0
118 #define SYS_AXI_USB20_BASE 0xFF800C00
119 #define SYS_AXI_USB21_BASE 0xFF800C40
120 #define SYS_AXI_USB22_BASE 0xFF800C80
121 #define SYS_AXI_USB30_BASE 0xFF800CC0
122 #define SYS_AXI_AX2M_BASE 0xFF800380
123 #define SYS_AXI_CC50_BASE 0xFF8003C0
124 #define SYS_AXI_CCI_BASE 0xFF800440
125 #define SYS_AXI_CS_BASE 0xFF800480
126 #define SYS_AXI_DDM_BASE 0xFF8004C0
127 #define SYS_AXI_ETH_BASE 0xFF800500
128 #define SYS_AXI_MPXM_BASE 0xFF800840
129 #define SYS_AXI_SAT0_BASE 0xFF800980
130 #define SYS_AXI_SAT1_BASE 0xFF8009C0
131 #define SYS_AXI_SDM0_BASE 0xFF800A00
132 #define SYS_AXI_SDM1_BASE 0xFF800A40
133 #define SYS_AXI_TRAB_BASE 0xFF800B00 /* SYS_AXI_TRKF_BASE in R*A7794 */
134 #define SYS_AXI_UDM0_BASE 0xFF800B80
135 #define SYS_AXI_UDM1_BASE 0xFF800BC0
137 #define RT_AXI_SHX_BASE 0xFF810100
138 #define RT_AXI_DBG_BASE 0xFF810140 /* R8A7791 only */
139 #define RT_AXI_RDM_BASE 0xFF810180 /* R8A7791 only */
140 #define RT_AXI_RDS_BASE 0xFF8101C0
141 #define RT_AXI_RTX64TO128_BASE 0xFF810200
142 #define RT_AXI_STPRO_BASE 0xFF810240
143 #define RT_AXI_SY2RT_BASE 0xFF810280 /* R8A7791 only */
145 #define MP_AXI_ADSP_BASE 0xFF820100
146 #define MP_AXI_ASDS0_BASE 0xFF8201C0
147 #define MP_AXI_ASDS1_BASE 0xFF820200
148 #define MP_AXI_MLP_BASE 0xFF820240
149 #define MP_AXI_MMUMP_BASE 0xFF820280
150 #define MP_AXI_SPU_BASE 0xFF8202C0
151 #define MP_AXI_SPUC_BASE 0xFF820300
153 #define SYS_AXI256_AXI128TO256_BASE 0xFF860100
154 #define SYS_AXI256_SYX_BASE 0xFF860140
155 #define SYS_AXI256_MPX_BASE 0xFF860180
156 #define SYS_AXI256_MXI_BASE 0xFF8601C0
158 #define CCI_AXI_MMUS0_BASE 0xFF880100
159 #define CCI_AXI_SYX2_BASE 0xFF880140
160 #define CCI_AXI_MMUR_BASE 0xFF880180
161 #define CCI_AXI_MMUDS_BASE 0xFF8801C0
162 #define CCI_AXI_MMUM_BASE 0xFF880200
163 #define CCI_AXI_MXI_BASE 0xFF880240
164 #define CCI_AXI_MMUS1_BASE 0xFF880280
165 #define CCI_AXI_MMUMP_BASE 0xFF8802C0
167 #define MEDIA_AXI_MXR_BASE 0xFE960080 /* R8A7791 only */
168 #define MEDIA_AXI_MXW_BASE 0xFE9600C0 /* R8A7791 only */
169 #define MEDIA_AXI_JPR_BASE 0xFE964100
170 #define MEDIA_AXI_JPW_BASE 0xFE966100
171 #define MEDIA_AXI_GCU0R_BASE 0xFE964140
172 #define MEDIA_AXI_GCU0W_BASE 0xFE966140
173 #define MEDIA_AXI_GCU1R_BASE 0xFE964180
174 #define MEDIA_AXI_GCU1W_BASE 0xFE966180
175 #define MEDIA_AXI_TDMR_BASE 0xFE964500
176 #define MEDIA_AXI_TDMW_BASE 0xFE966500
177 #define MEDIA_AXI_VSP0CR_BASE 0xFE964540
178 #define MEDIA_AXI_VSP0CW_BASE 0xFE966540
179 #define MEDIA_AXI_VSP1CR_BASE 0xFE964580
180 #define MEDIA_AXI_VSP1CW_BASE 0xFE966580
181 #define MEDIA_AXI_VSPDU0CR_BASE 0xFE9645C0
182 #define MEDIA_AXI_VSPDU0CW_BASE 0xFE9665C0
183 #define MEDIA_AXI_VSPDU1CR_BASE 0xFE964600
184 #define MEDIA_AXI_VSPDU1CW_BASE 0xFE966600
185 #define MEDIA_AXI_VIN0W_BASE 0xFE966900
186 #define MEDIA_AXI_VSP0R_BASE 0xFE964D00
187 #define MEDIA_AXI_VSP0W_BASE 0xFE966D00
188 #define MEDIA_AXI_FDP0R_BASE 0xFE964D40
189 #define MEDIA_AXI_FDP0W_BASE 0xFE966D40
190 #define MEDIA_AXI_IMSR_BASE 0xFE964D80
191 #define MEDIA_AXI_IMSW_BASE 0xFE966D80
192 #define MEDIA_AXI_VSP1R_BASE 0xFE965100
193 #define MEDIA_AXI_VSP1W_BASE 0xFE967100
194 #define MEDIA_AXI_FDP1R_BASE 0xFE965140
195 #define MEDIA_AXI_FDP1W_BASE 0xFE967140
196 #define MEDIA_AXI_IMRR_BASE 0xFE965180
197 #define MEDIA_AXI_IMRW_BASE 0xFE967180
198 #define MEDIA_AXI_FDP2R_BASE 0xFE9651C0
199 #define MEDIA_AXI_FDP2W_BASE 0xFE966DC0
200 #define MEDIA_AXI_VSPD0R_BASE 0xFE965500
201 #define MEDIA_AXI_VSPD0W_BASE 0xFE967500
202 #define MEDIA_AXI_VSPD1R_BASE 0xFE965540
203 #define MEDIA_AXI_VSPD1W_BASE 0xFE967540
204 #define MEDIA_AXI_DU0R_BASE 0xFE965580
205 #define MEDIA_AXI_DU0W_BASE 0xFE967580
206 #define MEDIA_AXI_DU1R_BASE 0xFE9655C0
207 #define MEDIA_AXI_DU1W_BASE 0xFE9675C0
208 #define MEDIA_AXI_VCP0CR_BASE 0xFE965900
209 #define MEDIA_AXI_VCP0CW_BASE 0xFE967900
210 #define MEDIA_AXI_VCP0VR_BASE 0xFE965940
211 #define MEDIA_AXI_VCP0VW_BASE 0xFE967940
212 #define MEDIA_AXI_VPC0R_BASE 0xFE965980
213 #define MEDIA_AXI_VCP1CR_BASE 0xFE965D00
214 #define MEDIA_AXI_VCP1CW_BASE 0xFE967D00
215 #define MEDIA_AXI_VCP1VR_BASE 0xFE965D40
216 #define MEDIA_AXI_VCP1VW_BASE 0xFE967D40
217 #define MEDIA_AXI_VPC1R_BASE 0xFE965D80
219 #define SYS_AXI_AVBDMSCR 0xFF802000
220 #define SYS_AXI_SYX2DMSCR 0xFF802004
221 #define SYS_AXI_CC50DMSCR 0xFF802008
222 #define SYS_AXI_CC51DMSCR 0xFF80200C
223 #define SYS_AXI_CCIDMSCR 0xFF802010
224 #define SYS_AXI_CSDMSCR 0xFF802014
225 #define SYS_AXI_DDMDMSCR 0xFF802018
226 #define SYS_AXI_ETHDMSCR 0xFF80201C
227 #define SYS_AXI_G2DDMSCR 0xFF802020
228 #define SYS_AXI_IMP0DMSCR 0xFF802024
229 #define SYS_AXI_IMP1DMSCR 0xFF802028
230 #define SYS_AXI_LBSDMSCR 0xFF80202C
231 #define SYS_AXI_MMUDSDMSCR 0xFF802030
232 #define SYS_AXI_MMUMXDMSCR 0xFF802034
233 #define SYS_AXI_MMURDDMSCR 0xFF802038
234 #define SYS_AXI_MMUS0DMSCR 0xFF80203C
235 #define SYS_AXI_MMUS1DMSCR 0xFF802040
236 #define SYS_AXI_MPXDMSCR 0xFF802044
237 #define SYS_AXI_MTSB0DMSCR 0xFF802048
238 #define SYS_AXI_MTSB1DMSCR 0xFF80204C
239 #define SYS_AXI_PCIDMSCR 0xFF802050
240 #define SYS_AXI_RTXDMSCR 0xFF802054
241 #define SYS_AXI_SAT0DMSCR 0xFF802058
242 #define SYS_AXI_SAT1DMSCR 0xFF80205C
243 #define SYS_AXI_SDM0DMSCR 0xFF802060
244 #define SYS_AXI_SDM1DMSCR 0xFF802064
245 #define SYS_AXI_SDS0DMSCR 0xFF802068
246 #define SYS_AXI_SDS1DMSCR 0xFF80206C
247 #define SYS_AXI_ETRABDMSCR 0xFF802070
248 #define SYS_AXI_ETRKFDMSCR 0xFF802074
249 #define SYS_AXI_UDM0DMSCR 0xFF802078
250 #define SYS_AXI_UDM1DMSCR 0xFF80207C
251 #define SYS_AXI_USB20DMSCR 0xFF802080
252 #define SYS_AXI_USB21DMSCR 0xFF802084
253 #define SYS_AXI_USB22DMSCR 0xFF802088
254 #define SYS_AXI_USB30DMSCR 0xFF80208C
255 #define SYS_AXI_X128TO64SLVDMSCR 0xFF802100
256 #define SYS_AXI_X64TO128SLVDMSCR 0xFF802104
257 #define SYS_AXI_AVBSLVDMSCR 0xFF802108
258 #define SYS_AXI_SYX2SLVDMSCR 0xFF80210C
259 #define SYS_AXI_ETHSLVDMSCR 0xFF802110
260 #define SYS_AXI_GICSLVDMSCR 0xFF802114
261 #define SYS_AXI_IMPSLVDMSCR 0xFF802118
262 #define SYS_AXI_IMX0SLVDMSCR 0xFF80211C
263 #define SYS_AXI_IMX1SLVDMSCR 0xFF802120
264 #define SYS_AXI_IMX2SLVDMSCR 0xFF802124
265 #define SYS_AXI_LBSSLVDMSCR 0xFF802128
266 #define SYS_AXI_MMC0SLVDMSCR 0xFF80212C
267 #define SYS_AXI_MMC1SLVDMSCR 0xFF802130
268 #define SYS_AXI_MPXSLVDMSCR 0xFF802134
269 #define SYS_AXI_MTSB0SLVDMSCR 0xFF802138
270 #define SYS_AXI_MTSB1SLVDMSCR 0xFF80213C
271 #define SYS_AXI_MXTSLVDMSCR 0xFF802140
272 #define SYS_AXI_PCISLVDMSCR 0xFF802144
273 #define SYS_AXI_SYAPBSLVDMSCR 0xFF802148
274 #define SYS_AXI_QSAPBSLVDMSCR 0xFF80214C
275 #define SYS_AXI_RTXSLVDMSCR 0xFF802150
276 #define SYS_AXI_SAT0SLVDMSCR 0xFF802168
277 #define SYS_AXI_SAT1SLVDMSCR 0xFF80216C
278 #define SYS_AXI_SDAP0SLVDMSCR 0xFF802170
279 #define SYS_AXI_SDAP1SLVDMSCR 0xFF802174
280 #define SYS_AXI_SDAP2SLVDMSCR 0xFF802178
281 #define SYS_AXI_SDAP3SLVDMSCR 0xFF80217C
282 #define SYS_AXI_SGXSLVDMSCR 0xFF802180
283 #define SYS_AXI_STBSLVDMSCR 0xFF802188
284 #define SYS_AXI_STMSLVDMSCR 0xFF80218C
285 #define SYS_AXI_TSPL0SLVDMSCR 0xFF802194
286 #define SYS_AXI_TSPL1SLVDMSCR 0xFF802198
287 #define SYS_AXI_TSPL2SLVDMSCR 0xFF80219C
288 #define SYS_AXI_USB20SLVDMSCR 0xFF8021A0
289 #define SYS_AXI_USB21SLVDMSCR 0xFF8021A4
290 #define SYS_AXI_USB22SLVDMSCR 0xFF8021A8
291 #define SYS_AXI_USB30SLVDMSCR 0xFF8021AC
293 #define RT_AXI_CBMDMSCR 0xFF812000
294 #define RT_AXI_DBDMSCR 0xFF812004
295 #define RT_AXI_RDMDMSCR 0xFF812008
296 #define RT_AXI_RDSDMSCR 0xFF81200C
297 #define RT_AXI_STRDMSCR 0xFF812010
298 #define RT_AXI_SY2RTDMSCR 0xFF812014
299 #define RT_AXI_CBSSLVDMSCR 0xFF812100
300 #define RT_AXI_DBSSLVDMSCR 0xFF812104
301 #define RT_AXI_RTAP1SLVDMSCR 0xFF812108
302 #define RT_AXI_RTAP2SLVDMSCR 0xFF81210C
303 #define RT_AXI_RTAP3SLVDMSCR 0xFF812110
304 #define RT_AXI_RT2SYSLVDMSCR 0xFF812114
305 #define RT_AXI_A128TO64SLVDMSCR 0xFF812118
306 #define RT_AXI_A64TO128SLVDMSCR 0xFF81211C
307 #define RT_AXI_A64TO128CSLVDMSCR 0xFF812120
308 #define RT_AXI_UTLBRSLVDMSCR 0xFF812128
310 #define MP_AXI_ADSPDMSCR 0xFF822000
311 #define MP_AXI_ASDM0DMSCR 0xFF822004
312 #define MP_AXI_ASDM1DMSCR 0xFF822008
313 #define MP_AXI_ASDS0DMSCR 0xFF82200C
314 #define MP_AXI_ASDS1DMSCR 0xFF822010
315 #define MP_AXI_MLPDMSCR 0xFF822014
316 #define MP_AXI_MMUMPDMSCR 0xFF822018
317 #define MP_AXI_SPUDMSCR 0xFF82201C
318 #define MP_AXI_SPUCDMSCR 0xFF822020
319 #define MP_AXI_SY2MPDMSCR 0xFF822024
320 #define MP_AXI_ADSPSLVDMSCR 0xFF822100
321 #define MP_AXI_MLMSLVDMSCR 0xFF822104
322 #define MP_AXI_MPAP4SLVDMSCR 0xFF822108
323 #define MP_AXI_MPAP5SLVDMSCR 0xFF82210C
324 #define MP_AXI_MPAP6SLVDMSCR 0xFF822110
325 #define MP_AXI_MPAP7SLVDMSCR 0xFF822114
326 #define MP_AXI_MP2SYSLVDMSCR 0xFF822118
327 #define MP_AXI_MP2SY2SLVDMSCR 0xFF82211C
328 #define MP_AXI_MPXAPSLVDMSCR 0xFF822124
329 #define MP_AXI_SPUSLVDMSCR 0xFF822128
330 #define MP_AXI_UTLBMPSLVDMSCR 0xFF82212C
332 #define ADM_AXI_ASDM0DMSCR 0xFF842000
333 #define ADM_AXI_ASDM1DMSCR 0xFF842004
334 #define ADM_AXI_MPAP1SLVDMSCR 0xFF842104
335 #define ADM_AXI_MPAP2SLVDMSCR 0xFF842108
336 #define ADM_AXI_MPAP3SLVDMSCR 0xFF84210C
338 #define DM_AXI_RDMDMSCR 0xFF852000
339 #define DM_AXI_SDM0DMSCR 0xFF852004
340 #define DM_AXI_SDM1DMSCR 0xFF852008
341 #define DM_AXI_MMAP0SLVDMSCR 0xFF852100
342 #define DM_AXI_MMAP1SLVDMSCR 0xFF852104
343 #define DM_AXI_QSPAPSLVDMSCR 0xFF852108
344 #define DM_AXI_RAP4SLVDMSCR 0xFF85210C
345 #define DM_AXI_RAP5SLVDMSCR 0xFF852110
346 #define DM_AXI_SAP4SLVDMSCR 0xFF852114
347 #define DM_AXI_SAP5SLVDMSCR 0xFF852118
348 #define DM_AXI_SAP6SLVDMSCR 0xFF85211C
349 #define DM_AXI_SAP65SLVDMSCR 0xFF852120
350 #define DM_AXI_SDAP0SLVDMSCR 0xFF852124
351 #define DM_AXI_SDAP1SLVDMSCR 0xFF852128
352 #define DM_AXI_SDAP2SLVDMSCR 0xFF85212C
353 #define DM_AXI_SDAP3SLVDMSCR 0xFF852130
355 #define SYS_AXI256_SYXDMSCR 0xFF862000
356 #define SYS_AXI256_MPXDMSCR 0xFF862004
357 #define SYS_AXI256_MXIDMSCR 0xFF862008
358 #define SYS_AXI256_X128TO256SLVDMSCR 0xFF862100
359 #define SYS_AXI256_X256TO128SLVDMSCR 0xFF862104
360 #define SYS_AXI256_SYXSLVDMSCR 0xFF862108
361 #define SYS_AXI256_CCXSLVDMSCR 0xFF86210C
362 #define SYS_AXI256_S3CSLVDMSCR 0xFF862110
364 #define MXT_SYXDMSCR 0xFF872000
365 #define MXT_CMM0SLVDMSCR 0xFF872100
366 #define MXT_CMM1SLVDMSCR 0xFF872104
367 #define MXT_CMM2SLVDMSCR 0xFF872108
368 #define MXT_FDPSLVDMSCR 0xFF87210C
369 #define MXT_IMRSLVDMSCR 0xFF872110
370 #define MXT_VINSLVDMSCR 0xFF872114
371 #define MXT_VPC0SLVDMSCR 0xFF872118
372 #define MXT_VPC1SLVDMSCR 0xFF87211C
373 #define MXT_VSP0SLVDMSCR 0xFF872120
374 #define MXT_VSP1SLVDMSCR 0xFF872124
375 #define MXT_VSPD0SLVDMSCR 0xFF872128
376 #define MXT_VSPD1SLVDMSCR 0xFF87212C
377 #define MXT_MAP1SLVDMSCR 0xFF872130
378 #define MXT_MAP2SLVDMSCR 0xFF872134
380 #define CCI_AXI_MMUS0DMSCR 0xFF882000
381 #define CCI_AXI_SYX2DMSCR 0xFF882004
382 #define CCI_AXI_MMURDMSCR 0xFF882008
383 #define CCI_AXI_MMUDSDMSCR 0xFF88200C
384 #define CCI_AXI_MMUMDMSCR 0xFF882010
385 #define CCI_AXI_MXIDMSCR 0xFF882014
386 #define CCI_AXI_MMUS1DMSCR 0xFF882018
387 #define CCI_AXI_MMUMPDMSCR 0xFF88201C
388 #define CCI_AXI_DVMDMSCR 0xFF882020
389 #define CCI_AXI_CCISLVDMSCR 0xFF882100
391 #define CCI_AXI_IPMMUIDVMCR 0xFF880400
392 #define CCI_AXI_IPMMURDVMCR 0xFF880404
393 #define CCI_AXI_IPMMUS0DVMCR 0xFF880408
394 #define CCI_AXI_IPMMUS1DVMCR 0xFF88040C
395 #define CCI_AXI_IPMMUMPDVMCR 0xFF880410
396 #define CCI_AXI_IPMMUDSDVMCR 0xFF880414
397 #define CCI_AXI_AX2ADDRMASK 0xFF88041C
399 #define PLL0CR 0xE61500D8
400 #define PLL0_STC_MASK 0x7F000000
401 #define PLL0_STC_BIT 24
402 #define PLLECR 0xE61500D0
406 #include <asm/types.h>
410 u32 rwtcnt; /* 0x00 */
411 u32 rwtcsra; /* 0x04 */
412 u16 rwtcsrb; /* 0x08 */
417 u32 swtcnt; /* 0x00 */
418 u32 swtcsra; /* 0x04 */
419 u16 swtcsrb; /* 0x08 */
432 u32 dummy0[4]; /* 0x20 .. 0x2C */
444 u32 dummy1[9]; /* 0x5C .. 0x7C */
454 u32 dummy2[3]; /* 0xA4 .. 0xAC */
457 u32 dummy3[2]; /* 0xB8 .. 0xBC */
465 u32 dummy4[5]; /* 0xDC .. 0xEC */
469 u32 dummy5[5]; /* 0xFC .. 0x10C */
473 u32 dummy6[5]; /* 0x11C .. 0x12C */
477 u32 dummy7; /* 0x13C */
480 u32 dummy8[14]; /* 0x148 .. 0x17C */
482 u32 dummy9[15]; /* 0x184 .. 0x1BC */
489 u32 dummy0[3]; /* 0x00 .. 0x08 */
497 u32 dummy1[2]; /* 0x28 .. 0x2C */
499 u32 dummy2[3]; /* 0x34 .. 0x3C */
503 u32 dummy3; /* 0x4C */
521 u32 dummy4[7]; /* 0x94 .. 0xAC */
523 u32 dummy5[3]; /* 0xB4 .. 0xBC */
525 u32 dummy6; /* 0xC4 */
527 u32 dummy7[5]; /* 0xCC .. 0xDC */
531 u32 dummy8[2]; /* 0xEC .. 0xF0 */
534 u32 dummy9; /* 0xFC */
536 u32 dummy10[31]; /* 0x104 .. 0x17C */
538 u32 dummy11[47]; /* 0x184 ..0x23C */
541 u32 dummy12[14]; /* 0x248 .. 0x27C */
543 u32 dummy13[3]; /* 0x284 .. 0x28C */
545 u32 dummy14[3]; /* 0x294 .. 0x29C */
547 u32 dummy15[24]; /* 0x2A4 .. 0x300 */
549 u32 dummy16[30]; /* 0x308 .. 0x37C */
587 u32 dummy1[2]; /* 0x20 .. 0x24 */
589 u32 dummy2; /* 0x2C */
596 struct rcar_s3c_qos {
609 struct rcar_dbsc3_qos {
619 u32 dummy0; /* 0x24 */
627 u32 dummy0[7]; /* 0x08 .. 0x20 */
628 u32 mxaxiracr; /* R8a7790 only */
630 u32 dummy1[2]; /* 0x2C .. 0x30 */
631 u32 mxaxiwacr; /* R8a7790 only */
633 u32 dummy2; /* 0x3C */
638 struct rcar_mxi_qos {
646 struct rcar_axi_qos {
661 #endif /* __ASM_ARCH_RCAR_BASE_H */