2 * arch/arm/include/asm/arch-rmobile/rcar-base.h
4 * Copyright (C) 2013,2014 Renesas Electronics Corporation
6 * SPDX-License-Identifier: GPL-2.0
9 #ifndef __ASM_ARCH_RCAR_BASE_H
10 #define __ASM_ARCH_RCAR_BASE_H
13 * R-Car (R8A7790/R8A7791/R8A7793/R8A7794) I/O Addresses
15 #define RWDT_BASE 0xE6020000
16 #define SWDT_BASE 0xE6030000
17 #define LBSC_BASE 0xFEC00200
18 #define DBSC3_0_BASE 0xE6790000
19 #define DBSC3_1_BASE 0xE67A0000
20 #define TMU_BASE 0xE61E0000
21 #define GPIO5_BASE 0xE6055000
22 #define SH_QSPI_BASE 0xE6B10000
25 #define SCIF0_BASE 0xE6E60000
26 #define SCIF1_BASE 0xE6E68000
27 #define SCIF2_BASE 0xE6E58000
28 #define SCIF3_BASE 0xE6EA8000
29 #define SCIF4_BASE 0xE6EE0000
30 #define SCIF5_BASE 0xE6EE8000
32 /* Module stop status register */
33 #define MSTPSR0 0xE6150030
34 #define MSTPSR1 0xE6150038
35 #define MSTPSR2 0xE6150040
36 #define MSTPSR3 0xE6150048
37 #define MSTPSR4 0xE615004C
38 #define MSTPSR5 0xE615003C
39 #define MSTPSR7 0xE61501C4
40 #define MSTPSR8 0xE61509A0
41 #define MSTPSR9 0xE61509A4
42 #define MSTPSR10 0xE61509A8
43 #define MSTPSR11 0xE61509AC
45 /* Realtime module stop control register */
46 #define RMSTPCR0 0xE6150110
47 #define RMSTPCR1 0xE6150114
48 #define RMSTPCR2 0xE6150118
49 #define RMSTPCR3 0xE615011C
50 #define RMSTPCR4 0xE6150120
51 #define RMSTPCR5 0xE6150124
52 #define RMSTPCR7 0xE615012C
53 #define RMSTPCR8 0xE6150980
54 #define RMSTPCR9 0xE6150984
55 #define RMSTPCR10 0xE6150988
56 #define RMSTPCR11 0xE615098C
58 /* System module stop control register */
59 #define SMSTPCR0 0xE6150130
60 #define SMSTPCR1 0xE6150134
61 #define SMSTPCR2 0xE6150138
62 #define SMSTPCR3 0xE615013C
63 #define SMSTPCR4 0xE6150140
64 #define SMSTPCR5 0xE6150144
65 #define SMSTPCR7 0xE615014C
66 #define SMSTPCR8 0xE6150990
67 #define SMSTPCR9 0xE6150994
68 #define SMSTPCR10 0xE6150998
69 #define SMSTPCR11 0xE615099C
73 * Ch2 and ch3 are different address. These are defined
74 * in the header of each SoCs.
76 #define CONFIG_SYS_I2C_SH_BASE0 0xE6500000
77 #define CONFIG_SYS_I2C_SH_BASE1 0xE6510000
80 #define CONFIG_SYS_RCAR_I2C0_BASE 0xE6508000
81 #define CONFIG_SYS_RCAR_I2C1_BASE 0xE6518000
82 #define CONFIG_SYS_RCAR_I2C2_BASE 0xE6530000
83 #define CONFIG_SYS_RCAR_I2C3_BASE 0xE6540000
85 #define S3C_BASE 0xE6784000
86 #define S3C_INT_BASE 0xE6784A00
87 #define S3C_MEDIA_BASE 0xE6784B00
89 #define S3C_QOS_DCACHE_BASE 0xE6784BDC
90 #define S3C_QOS_CCI0_BASE 0xE6784C00
91 #define S3C_QOS_CCI1_BASE 0xE6784C24
92 #define S3C_QOS_MXI_BASE 0xE6784C48
93 #define S3C_QOS_AXI_BASE 0xE6784C6C
95 #define DBSC3_0_QOS_R0_BASE 0xE6791000
96 #define DBSC3_0_QOS_R1_BASE 0xE6791100
97 #define DBSC3_0_QOS_R2_BASE 0xE6791200
98 #define DBSC3_0_QOS_R3_BASE 0xE6791300
99 #define DBSC3_0_QOS_R4_BASE 0xE6791400
100 #define DBSC3_0_QOS_R5_BASE 0xE6791500
101 #define DBSC3_0_QOS_R6_BASE 0xE6791600
102 #define DBSC3_0_QOS_R7_BASE 0xE6791700
103 #define DBSC3_0_QOS_R8_BASE 0xE6791800
104 #define DBSC3_0_QOS_R9_BASE 0xE6791900
105 #define DBSC3_0_QOS_R10_BASE 0xE6791A00
106 #define DBSC3_0_QOS_R11_BASE 0xE6791B00
107 #define DBSC3_0_QOS_R12_BASE 0xE6791C00
108 #define DBSC3_0_QOS_R13_BASE 0xE6791D00
109 #define DBSC3_0_QOS_R14_BASE 0xE6791E00
110 #define DBSC3_0_QOS_R15_BASE 0xE6791F00
111 #define DBSC3_0_QOS_W0_BASE 0xE6792000
112 #define DBSC3_0_QOS_W1_BASE 0xE6792100
113 #define DBSC3_0_QOS_W2_BASE 0xE6792200
114 #define DBSC3_0_QOS_W3_BASE 0xE6792300
115 #define DBSC3_0_QOS_W4_BASE 0xE6792400
116 #define DBSC3_0_QOS_W5_BASE 0xE6792500
117 #define DBSC3_0_QOS_W6_BASE 0xE6792600
118 #define DBSC3_0_QOS_W7_BASE 0xE6792700
119 #define DBSC3_0_QOS_W8_BASE 0xE6792800
120 #define DBSC3_0_QOS_W9_BASE 0xE6792900
121 #define DBSC3_0_QOS_W10_BASE 0xE6792A00
122 #define DBSC3_0_QOS_W11_BASE 0xE6792B00
123 #define DBSC3_0_QOS_W12_BASE 0xE6792C00
124 #define DBSC3_0_QOS_W13_BASE 0xE6792D00
125 #define DBSC3_0_QOS_W14_BASE 0xE6792E00
126 #define DBSC3_0_QOS_W15_BASE 0xE6792F00
127 #define DBSC3_0_DBADJ2 0xE67900C8
129 #define CCI_400_MAXOT_1 0xF0091110
130 #define CCI_400_MAXOT_2 0xF0092110
131 #define CCI_400_QOSCNTL_1 0xF009110C
132 #define CCI_400_QOSCNTL_2 0xF009210C
134 #define MXI_BASE 0xFE960000
135 #define MXI_QOS_BASE 0xFE960300
137 #define SYS_AXI_SYX64TO128_BASE 0xFF800300
138 #define SYS_AXI_AVB_BASE 0xFF800340
139 #define SYS_AXI_G2D_BASE 0xFF800540
140 #define SYS_AXI_IMP0_BASE 0xFF800580
141 #define SYS_AXI_IMP1_BASE 0xFF8005C0
142 #define SYS_AXI_IMUX0_BASE 0xFF800600
143 #define SYS_AXI_IMUX1_BASE 0xFF800640
144 #define SYS_AXI_IMUX2_BASE 0xFF800680
145 #define SYS_AXI_LBS_BASE 0xFF8006C0
146 #define SYS_AXI_MMUDS_BASE 0xFF800700
147 #define SYS_AXI_MMUM_BASE 0xFF800740
148 #define SYS_AXI_MMUR_BASE 0xFF800780
149 #define SYS_AXI_MMUS0_BASE 0xFF8007C0
150 #define SYS_AXI_MMUS1_BASE 0xFF800800
151 #define SYS_AXI_MTSB0_BASE 0xFF800880
152 #define SYS_AXI_MTSB1_BASE 0xFF8008C0
153 #define SYS_AXI_PCI_BASE 0xFF800900
154 #define SYS_AXI_RTX_BASE 0xFF800940
155 #define SYS_AXI_SDS0_BASE 0xFF800A80
156 #define SYS_AXI_SDS1_BASE 0xFF800AC0
157 #define SYS_AXI_USB20_BASE 0xFF800C00
158 #define SYS_AXI_USB21_BASE 0xFF800C40
159 #define SYS_AXI_USB22_BASE 0xFF800C80
160 #define SYS_AXI_USB30_BASE 0xFF800CC0
161 #define SYS_AXI_AX2M_BASE 0xFF800380
162 #define SYS_AXI_CC50_BASE 0xFF8003C0
163 #define SYS_AXI_CCI_BASE 0xFF800440
164 #define SYS_AXI_CS_BASE 0xFF800480
165 #define SYS_AXI_DDM_BASE 0xFF8004C0
166 #define SYS_AXI_ETH_BASE 0xFF800500
167 #define SYS_AXI_MPXM_BASE 0xFF800840
168 #define SYS_AXI_SAT0_BASE 0xFF800980
169 #define SYS_AXI_SAT1_BASE 0xFF8009C0
170 #define SYS_AXI_SDM0_BASE 0xFF800A00
171 #define SYS_AXI_SDM1_BASE 0xFF800A40
172 #define SYS_AXI_TRAB_BASE 0xFF800B00 /* SYS_AXI_TRKF_BASE in R*A7794 */
173 #define SYS_AXI_UDM0_BASE 0xFF800B80
174 #define SYS_AXI_UDM1_BASE 0xFF800BC0
176 #define RT_AXI_SHX_BASE 0xFF810100
177 #define RT_AXI_DBG_BASE 0xFF810140 /* R8A7791 only */
178 #define RT_AXI_RDM_BASE 0xFF810180 /* R8A7791 only */
179 #define RT_AXI_RDS_BASE 0xFF8101C0
180 #define RT_AXI_RTX64TO128_BASE 0xFF810200
181 #define RT_AXI_STPRO_BASE 0xFF810240
182 #define RT_AXI_SY2RT_BASE 0xFF810280 /* R8A7791 only */
184 #define MP_AXI_ADSP_BASE 0xFF820100
185 #define MP_AXI_ASDS0_BASE 0xFF8201C0
186 #define MP_AXI_ASDS1_BASE 0xFF820200
187 #define MP_AXI_MLP_BASE 0xFF820240
188 #define MP_AXI_MMUMP_BASE 0xFF820280
189 #define MP_AXI_SPU_BASE 0xFF8202C0
190 #define MP_AXI_SPUC_BASE 0xFF820300
192 #define SYS_AXI256_AXI128TO256_BASE 0xFF860100
193 #define SYS_AXI256_SYX_BASE 0xFF860140
194 #define SYS_AXI256_MPX_BASE 0xFF860180
195 #define SYS_AXI256_MXI_BASE 0xFF8601C0
197 #define CCI_AXI_MMUS0_BASE 0xFF880100
198 #define CCI_AXI_SYX2_BASE 0xFF880140
199 #define CCI_AXI_MMUR_BASE 0xFF880180
200 #define CCI_AXI_MMUDS_BASE 0xFF8801C0
201 #define CCI_AXI_MMUM_BASE 0xFF880200
202 #define CCI_AXI_MXI_BASE 0xFF880240
203 #define CCI_AXI_MMUS1_BASE 0xFF880280
204 #define CCI_AXI_MMUMP_BASE 0xFF8802C0
206 #define MEDIA_AXI_MXR_BASE 0xFE960080 /* R8A7791 only */
207 #define MEDIA_AXI_MXW_BASE 0xFE9600C0 /* R8A7791 only */
208 #define MEDIA_AXI_JPR_BASE 0xFE964100
209 #define MEDIA_AXI_JPW_BASE 0xFE966100
210 #define MEDIA_AXI_GCU0R_BASE 0xFE964140
211 #define MEDIA_AXI_GCU0W_BASE 0xFE966140
212 #define MEDIA_AXI_GCU1R_BASE 0xFE964180
213 #define MEDIA_AXI_GCU1W_BASE 0xFE966180
214 #define MEDIA_AXI_TDMR_BASE 0xFE964500
215 #define MEDIA_AXI_TDMW_BASE 0xFE966500
216 #define MEDIA_AXI_VSP0CR_BASE 0xFE964540
217 #define MEDIA_AXI_VSP0CW_BASE 0xFE966540
218 #define MEDIA_AXI_VSP1CR_BASE 0xFE964580
219 #define MEDIA_AXI_VSP1CW_BASE 0xFE966580
220 #define MEDIA_AXI_VSPDU0CR_BASE 0xFE9645C0
221 #define MEDIA_AXI_VSPDU0CW_BASE 0xFE9665C0
222 #define MEDIA_AXI_VSPDU1CR_BASE 0xFE964600
223 #define MEDIA_AXI_VSPDU1CW_BASE 0xFE966600
224 #define MEDIA_AXI_VIN0W_BASE 0xFE966900
225 #define MEDIA_AXI_VSP0R_BASE 0xFE964D00
226 #define MEDIA_AXI_VSP0W_BASE 0xFE966D00
227 #define MEDIA_AXI_FDP0R_BASE 0xFE964D40
228 #define MEDIA_AXI_FDP0W_BASE 0xFE966D40
229 #define MEDIA_AXI_IMSR_BASE 0xFE964D80
230 #define MEDIA_AXI_IMSW_BASE 0xFE966D80
231 #define MEDIA_AXI_VSP1R_BASE 0xFE965100
232 #define MEDIA_AXI_VSP1W_BASE 0xFE967100
233 #define MEDIA_AXI_FDP1R_BASE 0xFE965140
234 #define MEDIA_AXI_FDP1W_BASE 0xFE967140
235 #define MEDIA_AXI_IMRR_BASE 0xFE965180
236 #define MEDIA_AXI_IMRW_BASE 0xFE967180
237 #define MEDIA_AXI_FDP2R_BASE 0xFE9651C0
238 #define MEDIA_AXI_FDP2W_BASE 0xFE966DC0
239 #define MEDIA_AXI_VSPD0R_BASE 0xFE965500
240 #define MEDIA_AXI_VSPD0W_BASE 0xFE967500
241 #define MEDIA_AXI_VSPD1R_BASE 0xFE965540
242 #define MEDIA_AXI_VSPD1W_BASE 0xFE967540
243 #define MEDIA_AXI_DU0R_BASE 0xFE965580
244 #define MEDIA_AXI_DU0W_BASE 0xFE967580
245 #define MEDIA_AXI_DU1R_BASE 0xFE9655C0
246 #define MEDIA_AXI_DU1W_BASE 0xFE9675C0
247 #define MEDIA_AXI_VCP0CR_BASE 0xFE965900
248 #define MEDIA_AXI_VCP0CW_BASE 0xFE967900
249 #define MEDIA_AXI_VCP0VR_BASE 0xFE965940
250 #define MEDIA_AXI_VCP0VW_BASE 0xFE967940
251 #define MEDIA_AXI_VPC0R_BASE 0xFE965980
252 #define MEDIA_AXI_VCP1CR_BASE 0xFE965D00
253 #define MEDIA_AXI_VCP1CW_BASE 0xFE967D00
254 #define MEDIA_AXI_VCP1VR_BASE 0xFE965D40
255 #define MEDIA_AXI_VCP1VW_BASE 0xFE967D40
256 #define MEDIA_AXI_VPC1R_BASE 0xFE965D80
258 #define SYS_AXI_AVBDMSCR 0xFF802000
259 #define SYS_AXI_SYX2DMSCR 0xFF802004
260 #define SYS_AXI_CC50DMSCR 0xFF802008
261 #define SYS_AXI_CC51DMSCR 0xFF80200C
262 #define SYS_AXI_CCIDMSCR 0xFF802010
263 #define SYS_AXI_CSDMSCR 0xFF802014
264 #define SYS_AXI_DDMDMSCR 0xFF802018
265 #define SYS_AXI_ETHDMSCR 0xFF80201C
266 #define SYS_AXI_G2DDMSCR 0xFF802020
267 #define SYS_AXI_IMP0DMSCR 0xFF802024
268 #define SYS_AXI_IMP1DMSCR 0xFF802028
269 #define SYS_AXI_LBSDMSCR 0xFF80202C
270 #define SYS_AXI_MMUDSDMSCR 0xFF802030
271 #define SYS_AXI_MMUMXDMSCR 0xFF802034
272 #define SYS_AXI_MMURDDMSCR 0xFF802038
273 #define SYS_AXI_MMUS0DMSCR 0xFF80203C
274 #define SYS_AXI_MMUS1DMSCR 0xFF802040
275 #define SYS_AXI_MPXDMSCR 0xFF802044
276 #define SYS_AXI_MTSB0DMSCR 0xFF802048
277 #define SYS_AXI_MTSB1DMSCR 0xFF80204C
278 #define SYS_AXI_PCIDMSCR 0xFF802050
279 #define SYS_AXI_RTXDMSCR 0xFF802054
280 #define SYS_AXI_SAT0DMSCR 0xFF802058
281 #define SYS_AXI_SAT1DMSCR 0xFF80205C
282 #define SYS_AXI_SDM0DMSCR 0xFF802060
283 #define SYS_AXI_SDM1DMSCR 0xFF802064
284 #define SYS_AXI_SDS0DMSCR 0xFF802068
285 #define SYS_AXI_SDS1DMSCR 0xFF80206C
286 #define SYS_AXI_ETRABDMSCR 0xFF802070
287 #define SYS_AXI_ETRKFDMSCR 0xFF802074
288 #define SYS_AXI_UDM0DMSCR 0xFF802078
289 #define SYS_AXI_UDM1DMSCR 0xFF80207C
290 #define SYS_AXI_USB20DMSCR 0xFF802080
291 #define SYS_AXI_USB21DMSCR 0xFF802084
292 #define SYS_AXI_USB22DMSCR 0xFF802088
293 #define SYS_AXI_USB30DMSCR 0xFF80208C
294 #define SYS_AXI_X128TO64SLVDMSCR 0xFF802100
295 #define SYS_AXI_X64TO128SLVDMSCR 0xFF802104
296 #define SYS_AXI_AVBSLVDMSCR 0xFF802108
297 #define SYS_AXI_SYX2SLVDMSCR 0xFF80210C
298 #define SYS_AXI_ETHSLVDMSCR 0xFF802110
299 #define SYS_AXI_GICSLVDMSCR 0xFF802114
300 #define SYS_AXI_IMPSLVDMSCR 0xFF802118
301 #define SYS_AXI_IMX0SLVDMSCR 0xFF80211C
302 #define SYS_AXI_IMX1SLVDMSCR 0xFF802120
303 #define SYS_AXI_IMX2SLVDMSCR 0xFF802124
304 #define SYS_AXI_LBSSLVDMSCR 0xFF802128
305 #define SYS_AXI_MMC0SLVDMSCR 0xFF80212C
306 #define SYS_AXI_MMC1SLVDMSCR 0xFF802130
307 #define SYS_AXI_MPXSLVDMSCR 0xFF802134
308 #define SYS_AXI_MTSB0SLVDMSCR 0xFF802138
309 #define SYS_AXI_MTSB1SLVDMSCR 0xFF80213C
310 #define SYS_AXI_MXTSLVDMSCR 0xFF802140
311 #define SYS_AXI_PCISLVDMSCR 0xFF802144
312 #define SYS_AXI_SYAPBSLVDMSCR 0xFF802148
313 #define SYS_AXI_QSAPBSLVDMSCR 0xFF80214C
314 #define SYS_AXI_RTXSLVDMSCR 0xFF802150
315 #define SYS_AXI_SAT0SLVDMSCR 0xFF802168
316 #define SYS_AXI_SAT1SLVDMSCR 0xFF80216C
317 #define SYS_AXI_SDAP0SLVDMSCR 0xFF802170
318 #define SYS_AXI_SDAP1SLVDMSCR 0xFF802174
319 #define SYS_AXI_SDAP2SLVDMSCR 0xFF802178
320 #define SYS_AXI_SDAP3SLVDMSCR 0xFF80217C
321 #define SYS_AXI_SGXSLVDMSCR 0xFF802180
322 #define SYS_AXI_STBSLVDMSCR 0xFF802188
323 #define SYS_AXI_STMSLVDMSCR 0xFF80218C
324 #define SYS_AXI_TSPL0SLVDMSCR 0xFF802194
325 #define SYS_AXI_TSPL1SLVDMSCR 0xFF802198
326 #define SYS_AXI_TSPL2SLVDMSCR 0xFF80219C
327 #define SYS_AXI_USB20SLVDMSCR 0xFF8021A0
328 #define SYS_AXI_USB21SLVDMSCR 0xFF8021A4
329 #define SYS_AXI_USB22SLVDMSCR 0xFF8021A8
330 #define SYS_AXI_USB30SLVDMSCR 0xFF8021AC
332 #define RT_AXI_CBMDMSCR 0xFF812000
333 #define RT_AXI_DBDMSCR 0xFF812004
334 #define RT_AXI_RDMDMSCR 0xFF812008
335 #define RT_AXI_RDSDMSCR 0xFF81200C
336 #define RT_AXI_STRDMSCR 0xFF812010
337 #define RT_AXI_SY2RTDMSCR 0xFF812014
338 #define RT_AXI_CBSSLVDMSCR 0xFF812100
339 #define RT_AXI_DBSSLVDMSCR 0xFF812104
340 #define RT_AXI_RTAP1SLVDMSCR 0xFF812108
341 #define RT_AXI_RTAP2SLVDMSCR 0xFF81210C
342 #define RT_AXI_RTAP3SLVDMSCR 0xFF812110
343 #define RT_AXI_RT2SYSLVDMSCR 0xFF812114
344 #define RT_AXI_A128TO64SLVDMSCR 0xFF812118
345 #define RT_AXI_A64TO128SLVDMSCR 0xFF81211C
346 #define RT_AXI_A64TO128CSLVDMSCR 0xFF812120
347 #define RT_AXI_UTLBRSLVDMSCR 0xFF812128
349 #define MP_AXI_ADSPDMSCR 0xFF822000
350 #define MP_AXI_ASDM0DMSCR 0xFF822004
351 #define MP_AXI_ASDM1DMSCR 0xFF822008
352 #define MP_AXI_ASDS0DMSCR 0xFF82200C
353 #define MP_AXI_ASDS1DMSCR 0xFF822010
354 #define MP_AXI_MLPDMSCR 0xFF822014
355 #define MP_AXI_MMUMPDMSCR 0xFF822018
356 #define MP_AXI_SPUDMSCR 0xFF82201C
357 #define MP_AXI_SPUCDMSCR 0xFF822020
358 #define MP_AXI_SY2MPDMSCR 0xFF822024
359 #define MP_AXI_ADSPSLVDMSCR 0xFF822100
360 #define MP_AXI_MLMSLVDMSCR 0xFF822104
361 #define MP_AXI_MPAP4SLVDMSCR 0xFF822108
362 #define MP_AXI_MPAP5SLVDMSCR 0xFF82210C
363 #define MP_AXI_MPAP6SLVDMSCR 0xFF822110
364 #define MP_AXI_MPAP7SLVDMSCR 0xFF822114
365 #define MP_AXI_MP2SYSLVDMSCR 0xFF822118
366 #define MP_AXI_MP2SY2SLVDMSCR 0xFF82211C
367 #define MP_AXI_MPXAPSLVDMSCR 0xFF822124
368 #define MP_AXI_SPUSLVDMSCR 0xFF822128
369 #define MP_AXI_UTLBMPSLVDMSCR 0xFF82212C
371 #define ADM_AXI_ASDM0DMSCR 0xFF842000
372 #define ADM_AXI_ASDM1DMSCR 0xFF842004
373 #define ADM_AXI_MPAP1SLVDMSCR 0xFF842104
374 #define ADM_AXI_MPAP2SLVDMSCR 0xFF842108
375 #define ADM_AXI_MPAP3SLVDMSCR 0xFF84210C
377 #define DM_AXI_RDMDMSCR 0xFF852000
378 #define DM_AXI_SDM0DMSCR 0xFF852004
379 #define DM_AXI_SDM1DMSCR 0xFF852008
380 #define DM_AXI_MMAP0SLVDMSCR 0xFF852100
381 #define DM_AXI_MMAP1SLVDMSCR 0xFF852104
382 #define DM_AXI_QSPAPSLVDMSCR 0xFF852108
383 #define DM_AXI_RAP4SLVDMSCR 0xFF85210C
384 #define DM_AXI_RAP5SLVDMSCR 0xFF852110
385 #define DM_AXI_SAP4SLVDMSCR 0xFF852114
386 #define DM_AXI_SAP5SLVDMSCR 0xFF852118
387 #define DM_AXI_SAP6SLVDMSCR 0xFF85211C
388 #define DM_AXI_SAP65SLVDMSCR 0xFF852120
389 #define DM_AXI_SDAP0SLVDMSCR 0xFF852124
390 #define DM_AXI_SDAP1SLVDMSCR 0xFF852128
391 #define DM_AXI_SDAP2SLVDMSCR 0xFF85212C
392 #define DM_AXI_SDAP3SLVDMSCR 0xFF852130
394 #define SYS_AXI256_SYXDMSCR 0xFF862000
395 #define SYS_AXI256_MPXDMSCR 0xFF862004
396 #define SYS_AXI256_MXIDMSCR 0xFF862008
397 #define SYS_AXI256_X128TO256SLVDMSCR 0xFF862100
398 #define SYS_AXI256_X256TO128SLVDMSCR 0xFF862104
399 #define SYS_AXI256_SYXSLVDMSCR 0xFF862108
400 #define SYS_AXI256_CCXSLVDMSCR 0xFF86210C
401 #define SYS_AXI256_S3CSLVDMSCR 0xFF862110
403 #define MXT_SYXDMSCR 0xFF872000
404 #define MXT_CMM0SLVDMSCR 0xFF872100
405 #define MXT_CMM1SLVDMSCR 0xFF872104
406 #define MXT_CMM2SLVDMSCR 0xFF872108
407 #define MXT_FDPSLVDMSCR 0xFF87210C
408 #define MXT_IMRSLVDMSCR 0xFF872110
409 #define MXT_VINSLVDMSCR 0xFF872114
410 #define MXT_VPC0SLVDMSCR 0xFF872118
411 #define MXT_VPC1SLVDMSCR 0xFF87211C
412 #define MXT_VSP0SLVDMSCR 0xFF872120
413 #define MXT_VSP1SLVDMSCR 0xFF872124
414 #define MXT_VSPD0SLVDMSCR 0xFF872128
415 #define MXT_VSPD1SLVDMSCR 0xFF87212C
416 #define MXT_MAP1SLVDMSCR 0xFF872130
417 #define MXT_MAP2SLVDMSCR 0xFF872134
419 #define CCI_AXI_MMUS0DMSCR 0xFF882000
420 #define CCI_AXI_SYX2DMSCR 0xFF882004
421 #define CCI_AXI_MMURDMSCR 0xFF882008
422 #define CCI_AXI_MMUDSDMSCR 0xFF88200C
423 #define CCI_AXI_MMUMDMSCR 0xFF882010
424 #define CCI_AXI_MXIDMSCR 0xFF882014
425 #define CCI_AXI_MMUS1DMSCR 0xFF882018
426 #define CCI_AXI_MMUMPDMSCR 0xFF88201C
427 #define CCI_AXI_DVMDMSCR 0xFF882020
428 #define CCI_AXI_CCISLVDMSCR 0xFF882100
430 #define CCI_AXI_IPMMUIDVMCR 0xFF880400
431 #define CCI_AXI_IPMMURDVMCR 0xFF880404
432 #define CCI_AXI_IPMMUS0DVMCR 0xFF880408
433 #define CCI_AXI_IPMMUS1DVMCR 0xFF88040C
434 #define CCI_AXI_IPMMUMPDVMCR 0xFF880410
435 #define CCI_AXI_IPMMUDSDVMCR 0xFF880414
436 #define CCI_AXI_AX2ADDRMASK 0xFF88041C
438 #define PLL0CR 0xE61500D8
439 #define PLL0_STC_MASK 0x7F000000
440 #define PLL0_STC_BIT 24
441 #define PLLECR 0xE61500D0
445 #include <asm/types.h>
449 u32 rwtcnt; /* 0x00 */
450 u32 rwtcsra; /* 0x04 */
451 u16 rwtcsrb; /* 0x08 */
456 u32 swtcnt; /* 0x00 */
457 u32 swtcsra; /* 0x04 */
458 u16 swtcsrb; /* 0x08 */
471 u32 dummy0[4]; /* 0x20 .. 0x2C */
483 u32 dummy1[9]; /* 0x5C .. 0x7C */
493 u32 dummy2[3]; /* 0xA4 .. 0xAC */
496 u32 dummy3[2]; /* 0xB8 .. 0xBC */
504 u32 dummy4[5]; /* 0xDC .. 0xEC */
508 u32 dummy5[5]; /* 0xFC .. 0x10C */
512 u32 dummy6[5]; /* 0x11C .. 0x12C */
516 u32 dummy7; /* 0x13C */
519 u32 dummy8[14]; /* 0x148 .. 0x17C */
521 u32 dummy9[15]; /* 0x184 .. 0x1BC */
528 u32 dummy0[3]; /* 0x00 .. 0x08 */
536 u32 dummy1[2]; /* 0x28 .. 0x2C */
538 u32 dummy2[3]; /* 0x34 .. 0x3C */
542 u32 dummy3; /* 0x4C */
560 u32 dummy4[7]; /* 0x94 .. 0xAC */
562 u32 dummy5[3]; /* 0xB4 .. 0xBC */
564 u32 dummy6; /* 0xC4 */
566 u32 dummy7[5]; /* 0xCC .. 0xDC */
570 u32 dummy8[2]; /* 0xEC .. 0xF0 */
573 u32 dummy9; /* 0xFC */
575 u32 dummy10[31]; /* 0x104 .. 0x17C */
577 u32 dummy11[47]; /* 0x184 ..0x23C */
580 u32 dummy12[14]; /* 0x248 .. 0x27C */
582 u32 dummy13[3]; /* 0x284 .. 0x28C */
584 u32 dummy14[3]; /* 0x294 .. 0x29C */
586 u32 dummy15[24]; /* 0x2A4 .. 0x300 */
588 u32 dummy16[30]; /* 0x308 .. 0x37C */
626 u32 dummy1[2]; /* 0x20 .. 0x24 */
628 u32 dummy2; /* 0x2C */
635 struct rcar_s3c_qos {
648 struct rcar_dbsc3_qos {
658 u32 dummy0; /* 0x24 */
666 u32 dummy0[7]; /* 0x08 .. 0x20 */
667 u32 mxaxiracr; /* R8a7790 only */
669 u32 dummy1[2]; /* 0x2C .. 0x30 */
670 u32 mxaxiwacr; /* R8a7790 only */
672 u32 dummy2; /* 0x3C */
677 struct rcar_mxi_qos {
685 struct rcar_axi_qos {
700 #endif /* __ASM_ARCH_RCAR_BASE_H */